DS90C032
- TIA/EIA-644規格に適合
- > 155.5Mbps（77.7Mhz）の転送レート
- 差動入力電圧± 350mV
- 低消費電力設計
- 差動出力スキュー 600ps（5V、25°C)
- 伝搬遅延時間： . . . 6.0ns（最大）
- フェイルセーフ動作： . . . 入力開放、終端時出力"H"
- DS26C32A、MB570（PECL）、41LF（PECL）とピンコンパチブル
- 電源オフ時、ハイ・インピーダンスLVDS 入力
- 表面実装パッケージ（SOIC）で供給
- 動作温度範囲： . . . –40°C～＋ 85°C
DS90C032B は、超低消費電力、高速伝送を必要とするアプリケーション用に設計された4 回路入りCMOS差動入力ライン・レシーバで す。Low Voltage Differential Signaling (LVDS)の技術を用いており、155.5Mbps(77.7MHz)以上のデータレートをサポートします。
DS90C032B は、小振幅(350mV)の差動信号を受信し、それをCMOSレベルに変換します。本レシーバは、TRI-STATEÒ機能をサポートして おり、出力をマルチプレクスすることが可能です。さらに入力開放、終端(100W)の全ての状態においてフェイルセーフ機能が働き、出力を High に固定します。
DS90C032B では、電源オフ時には、ハイ・インピーダンスのLVDS入力となります。この機能により、VCC が供給されていないとき、 LVDS バス・ラインに影響する負荷は最小となります。
DS90C032B、およびこれと対になるライン・ドライバ(DS90C031B)は、消費電力の大きいPECLなどの代替として、1 対1 の高速通信に用 いられます。
技術資料
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7 をすべて表示 | 種類 | タイトル | 最新の英語版をダウンロード | 日付 | |||
|---|---|---|---|---|---|---|
| * | データシート | DS90C032 LVDS Quad CMOS Differential Line Receiver (jp) データシート (Rev. C 翻訳版) | 最新英語版 (Rev.D) | PDF | HTML | 2007年 5月 3日 | |
| アプリケーション概要 | How Far, How Fast Can You Operate LVDS Drivers and Receivers? | 2018年 8月 3日 | ||||
| アプリケーション概要 | How to Terminate LVDS Connections with DC and AC Coupling | 2018年 5月 16日 | ||||
| その他の技術資料 | Die D/S DS90C032 MD8 MW8 LVDS Quad CMOS Differential Line Receiver | 2012年 12月 20日 | ||||
| アプリケーション・ノート | AN-1110 LVDS Quad Dynamic I CC vs Frequency | 2004年 5月 15日 | ||||
| アプリケーション・ノート | LVDS信号の品質：アイ・パターンによるジッタの測定 Test Report #1 | 英語版 | 1998年 10月 5日 | |||
| アプリケーション・ノート | LVDS技術の概要 | 英語版 | 1998年 10月 5日 |
設計と開発
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| パッケージ | ピン数 | ダウンロード |
|---|---|---|
| SOIC (D) | 16 | オプションの表示 |
購入と品質
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