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DS92LX2122

アクティブ

10 ~ 50MHz、DC 平衡、チャネル・リンク III、双方向制御デシリアライザ

製品詳細

Protocols Catalog Rating Catalog Operating temperature range (°C) -40 to 85
Protocols Catalog Rating Catalog Operating temperature range (°C) -40 to 85
WQFN (RHS) 48 49 mm² 7 x 7
  • General
    • Up to 1050 Mbits/sec Data Throughput
    • 10 MHz to 50 MHz Input Clock Support
    • Supports 18-bit Color Depth
      (RGB666 + HS, VS, DE)
    • Embedded Clock with DC Balanced Coding to
      Support AC-Coupled Interconnects
    • Capable to Drive up to 10 Meters Shielded
      Twisted-Pair
    • Bi-Directional Control Interface Channel
      with I2C Support
    • I2C Interface for Device
      Configuration. Single-Pin ID Addressing
    • Up to 4 GPI on DES and GPO on SER
    • AT-SPEED BIST Diagnosis Feature to Validate
      Link Integrity
    • Individual Power-Down Controls for both SER
      and DES
    • User-Selectable Clock Edge for Parallel Data
      on both SER and DES
    • Integrated Termination Resistors
    • 1.8V- or 3.3V-Compatible Parallel Bus Interface
    • Single Power Supply at 1.8V
    • IEC 61000–4–2 ESD Compliant
    • Temperature Range −40°C to +85°C
  • DESERIALIZER — DS92LX2122
    • No Reference Clock Required on Deserializer
    • Programmable Receive Equalization
    • LOCK Output Reporting Pin to Ensure
    • EMI/EMC Mitigation
      • Programmable Spread Spectrum (SSCG) Outputs
      • Receiver Output Drive Strength Control (RDS)
      • Receiver Staggered Outputs
  • General
    • Up to 1050 Mbits/sec Data Throughput
    • 10 MHz to 50 MHz Input Clock Support
    • Supports 18-bit Color Depth
      (RGB666 + HS, VS, DE)
    • Embedded Clock with DC Balanced Coding to
      Support AC-Coupled Interconnects
    • Capable to Drive up to 10 Meters Shielded
      Twisted-Pair
    • Bi-Directional Control Interface Channel
      with I2C Support
    • I2C Interface for Device
      Configuration. Single-Pin ID Addressing
    • Up to 4 GPI on DES and GPO on SER
    • AT-SPEED BIST Diagnosis Feature to Validate
      Link Integrity
    • Individual Power-Down Controls for both SER
      and DES
    • User-Selectable Clock Edge for Parallel Data
      on both SER and DES
    • Integrated Termination Resistors
    • 1.8V- or 3.3V-Compatible Parallel Bus Interface
    • Single Power Supply at 1.8V
    • IEC 61000–4–2 ESD Compliant
    • Temperature Range −40°C to +85°C
  • DESERIALIZER — DS92LX2122
    • No Reference Clock Required on Deserializer
    • Programmable Receive Equalization
    • LOCK Output Reporting Pin to Ensure
    • EMI/EMC Mitigation
      • Programmable Spread Spectrum (SSCG) Outputs
      • Receiver Output Drive Strength Control (RDS)
      • Receiver Staggered Outputs

The DS92LX2121/DS92LX2122 chipset offers a Channel Link III interface with a high-speed forward channel and a full-duplex control channel for data transmission over a single differential pair. The DS92LX2121/DS92LX2122 incorporates differential signaling on both the high-speed and bi-directional back channel control data paths. The Serializer/ Deserializer pair is targeted for direct connections between graphics host controller and displays modules. This chipset is ideally suited for driving video data to displays requiring 18-bit color depth (RGB666 + HS, VS, and DE) along with a bi-directional back channel control bus. The primary transport converts 21 bit data over a single high-speed serial stream, along with a separate low latency bi-directional back channel transport that accepts control information from an I2C port. Using TI’s embedded clock technology allows transparent full-duplex communication over a single differential pair, carrying asymmetrical bi-directional back channel control information in both directions. This single serial stream simplifies transferring a wide data bus over PCB traces and cable by eliminating the skew problems between parallel data and clock paths. This significantly saves system cost by narrowing data paths that in turn reduce cable width, connector size and pins.

In addition, the Deserializer provides input equalization to compensate for loss from the media over longer distances. Internal DC balanced encoding/decoding is used to support AC-Coupled interconnects.

A sleep function provides a power-savings mode when the high speed forward channel and embedded bi-directional control channel are not needed.

The Serializer is offered in a 40-pin lead in WQFN and Deserializer is offered in a 48-pin WQFN packages.

The DS92LX2121/DS92LX2122 chipset offers a Channel Link III interface with a high-speed forward channel and a full-duplex control channel for data transmission over a single differential pair. The DS92LX2121/DS92LX2122 incorporates differential signaling on both the high-speed and bi-directional back channel control data paths. The Serializer/ Deserializer pair is targeted for direct connections between graphics host controller and displays modules. This chipset is ideally suited for driving video data to displays requiring 18-bit color depth (RGB666 + HS, VS, and DE) along with a bi-directional back channel control bus. The primary transport converts 21 bit data over a single high-speed serial stream, along with a separate low latency bi-directional back channel transport that accepts control information from an I2C port. Using TI’s embedded clock technology allows transparent full-duplex communication over a single differential pair, carrying asymmetrical bi-directional back channel control information in both directions. This single serial stream simplifies transferring a wide data bus over PCB traces and cable by eliminating the skew problems between parallel data and clock paths. This significantly saves system cost by narrowing data paths that in turn reduce cable width, connector size and pins.

In addition, the Deserializer provides input equalization to compensate for loss from the media over longer distances. Internal DC balanced encoding/decoding is used to support AC-Coupled interconnects.

A sleep function provides a power-savings mode when the high speed forward channel and embedded bi-directional control channel are not needed.

The Serializer is offered in a 40-pin lead in WQFN and Deserializer is offered in a 48-pin WQFN packages.

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技術資料

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4 をすべて表示
種類 タイトル 最新の英語版をダウンロード 日付
* データシート DS92LX2121/22 10 - 50 MHz DC-Balanced Ch Link III Bi-Directional Control SER/DES データシート (Rev. J) 2014年 1月 17日
アプリケーション・ノート High-Speed Layout Guidelines for Reducing EMI for LVDS SerDes Designs 2018年 11月 9日
アプリケーション・ノート DS15BA101 & DS15EA101 Enable Long Reach Applications for Embedded Clock SER/DES (Rev. E) 2013年 4月 29日
ユーザー・ガイド LX21EVK01 Channel Link III Ser/Des Evaluation Kit 2012年 2月 1日

設計と開発

その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページをご覧ください。

評価ボード

LX21EVK01 — LX21EVK01 評価キット

The LX21EVK01 is an evaluation kit designed to demonstrate the performance and capabilities of the DS92LX2121 and DS92LX2122 Channel Link III Serializer/Deserializer chipset.

The DS92LX2121 serializer board accepts LVCMOS input signals for the high speed forward channel and provides additional (...)

ユーザー ガイド: PDF
シミュレーション・モデル

DS92LX2122 IBIS Model

SNLM111.ZIP (147 KB) - IBIS Model
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TINA は DesignSoft (...)

ユーザー ガイド: PDF
英語版 (Rev.A): PDF
パッケージ ピン数 ダウンロード
WQFN (RHS) 48 オプションの表示

購入と品質

記載されている情報:
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL 定格 / ピーク リフロー
  • MTBF/FIT 推定値
  • 材質成分
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果
記載されている情報:
  • ファブの拠点
  • 組み立てを実施した拠点

推奨製品には、この TI 製品に関連するパラメータ、評価基板、またはリファレンス デザインが存在する可能性があります。

サポートとトレーニング

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