SN74AUP1G08
- Available in the Ultra Small 0.64 mm2 Package
(DPW) With 0.5-mm Pitch - Low Static-Power Consumption:
ICC = 0.9 µA Maximum - Low Dynamic-Power Consumption:
Cpd = 4.3 pF Typical at 3.3 V - Low Input Capacitance: Ci = 1.5 pF Typical
- Low Noise: Overshoot and Undershoot
<10% of VCC - Ioff Supports Live Insertion, Partial-Power-Down
Mode, and Back Drive Protection - Schmitt-Trigger Action Allows Slow Input
Transition and Better Switching Noise Immunity at
the Input (Vhys = 250 mV Typical at 3.3 V) - Wide Operating VCC Range of 0.8 V to 3.6 V
- Optimized for 3.3-V Operation
- 3.6-V I/O Tolerant to Support Mixed-Mode Signal
Operation - tpd = 4.3 ns Maximum at 3.3 V
- Suitable for Point-to-Point Applications
- Latch-Up Performance Exceeds 100 mA Per
JESD 78, Class II - ESD Performance Tested Per JESD 22
- 2000-V Human-Body Model
(A114-B, Class II) - 1000-V Charged-Device Model (C101)
- 2000-V Human-Body Model
This single 2-input positive-AND gate is designed for 0.8-V to 3.6-V VCC operation and performs the Boolean function Y = A B or Y = A\ + B\ in positive logic.
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技術資料
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設計と開発
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評価ボード
5-8-LOGIC-EVM — 5 ~ 8 ピンの DCK、DCT、DCU、DRL、DBV の各パッケージをサポートする汎用ロジックの評価基板 (EVM)
5 ~ 8 ピンで DCK、DCT、DCU、DRL、DBV の各パッケージを使用する多様なデバイスをサポートできる設計のフレキシブルな評価基板です。
ユーザー ガイド: PDF
パッケージ | ピン数 | ダウンロード |
---|---|---|
DSBGA (YFP) | 6 | オプションの表示 |
DSBGA (YZP) | 5 | オプションの表示 |
SOT-23 (DBV) | 5 | オプションの表示 |
SOT-5X3 (DRL) | 5 | オプションの表示 |
SOT-SC70 (DCK) | 5 | オプションの表示 |
USON (DRY) | 6 | オプションの表示 |
X2SON (DPW) | 5 | オプションの表示 |
X2SON (DSF) | 6 | オプションの表示 |
購入と品質
記載されている情報:
- RoHS
- REACH
- デバイスのマーキング
- リード端子の仕上げ / ボールの原材料
- MSL 定格 / ピーク リフロー
- MTBF/FIT 推定値
- 材質成分
- 認定試験結果
- 継続的な信頼性モニタ試験結果
記載されている情報:
- ファブの拠点
- 組み立てを実施した拠点