SN74LVC125A

アクティブ

4 チャネル、3 ステート出力、1.65V ~ 3.6V、バッファ

製品詳細

Technology family LVC Supply voltage (min) (V) 1.65 Supply voltage (max) (V) 3.6 Number of channels 4 IOL (max) (mA) 24 Supply current (max) (µA) 40 IOH (max) (mA) -24 Input type Standard CMOS Output type 3-State Features Balanced outputs, Over-voltage tolerant inputs, Very high speed (tpd 5-10ns) Rating Catalog Operating temperature range (°C) -40 to 125
Technology family LVC Supply voltage (min) (V) 1.65 Supply voltage (max) (V) 3.6 Number of channels 4 IOL (max) (mA) 24 Supply current (max) (µA) 40 IOH (max) (mA) -24 Input type Standard CMOS Output type 3-State Features Balanced outputs, Over-voltage tolerant inputs, Very high speed (tpd 5-10ns) Rating Catalog Operating temperature range (°C) -40 to 125
SOIC (D) 14 51.9 mm² 8.65 x 6 SOP (NS) 14 79.56 mm² 10.2 x 7.8 SSOP (DB) 14 48.36 mm² 6.2 x 7.8 TSSOP (PW) 14 32 mm² 5 x 6.4 VQFN (RGY) 14 12.25 mm² 3.5 x 3.5 WQFN (BQA) 14 7.5 mm² 3 x 2.5
  • 3 ステート出力
  • 4 つのバッファすべてに個別の OE
  • 1.65V~3.6V で動作
  • –40℃~85℃と–40℃~125℃で動作が規定
  • 5.5V までの入力電圧に対応
  • 最大 tpd:4.8ns (3.3V 時)
  • 標準 VOLP (出力グランド バウンス) < 0.8V (VCC = 3.3V、TA = 25℃)
  • VOHV (代表値) (出力 VOH アンダーシュート) > 2V (VCC = 3.3V、TA = 25℃)
  • JESD 17 準拠250mA 超のラッチアップ性能
  • 3 ステート出力
  • 4 つのバッファすべてに個別の OE
  • 1.65V~3.6V で動作
  • –40℃~85℃と–40℃~125℃で動作が規定
  • 5.5V までの入力電圧に対応
  • 最大 tpd:4.8ns (3.3V 時)
  • 標準 VOLP (出力グランド バウンス) < 0.8V (VCC = 3.3V、TA = 25℃)
  • VOHV (代表値) (出力 VOH アンダーシュート) > 2V (VCC = 3.3V、TA = 25℃)
  • JESD 17 準拠250mA 超のラッチアップ性能

このクワッド バス バッファ ゲートは、1.65V~3.6V の VCC で動作するように設計されています。

SN74LVC125A デバイスは、3 ステート出力の独立ライン ドライバを備えています。各出力は、対応する出力イネーブル (OE) 入力が High のときディセーブルになります。

電源投入または電源切断時に高インピーダンス状態を確保するため、OE はプルアップ抵抗経由で VCC に接続する必要があります。この抵抗の最小値は、ドライバの電流シンク能力によって決定されます。

入力は 3.3V または 5V のデバイスから駆動できます。この機能により、3.3V と 5V が混在するシステム環境での変換装置としてこのデバイスを使用できます。

このクワッド バス バッファ ゲートは、1.65V~3.6V の VCC で動作するように設計されています。

SN74LVC125A デバイスは、3 ステート出力の独立ライン ドライバを備えています。各出力は、対応する出力イネーブル (OE) 入力が High のときディセーブルになります。

電源投入または電源切断時に高インピーダンス状態を確保するため、OE はプルアップ抵抗経由で VCC に接続する必要があります。この抵抗の最小値は、ドライバの電流シンク能力によって決定されます。

入力は 3.3V または 5V のデバイスから駆動できます。この機能により、3.3V と 5V が混在するシステム環境での変換装置としてこのデバイスを使用できます。

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技術資料

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アプリケーション・ノート CMOS Power Consumption and CPD Calculation (Rev. B) 1997年 6月 1日
アプリケーション・ノート LVC Characterization Information 1996年 12月 1日
アプリケーション・ノート Input and Output Characteristics of Digital Integrated Circuits 1996年 10月 1日
アプリケーション・ノート Live Insertion 1996年 10月 1日
設計ガイド Low-Voltage Logic (LVC) Designer's Guide 1996年 9月 1日
アプリケーション・ノート Understanding Advanced Bus-Interface Products Design Guide 1996年 5月 1日

設計と開発

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評価ボード

14-24-LOGIC-EVM — 14 ピンから 24 ピンの D、DB、DGV、DW、DYY、NS、PW の各パッケージに封止した各種ロジック製品向けの汎用評価基板

14-24-logic-EVM 評価基板は、14 ピンから 24 ピンの D、DW、DB、NS、PW、DYY、DGV の各パッケージに封止した各種ロジック デバイスをサポートする設計を採用しています。

ユーザー ガイド: PDF | HTML
評価ボード

14-24-NL-LOGIC-EVM — 14 ピンから 24 ピンのリードなしパッケージ向け、ロジック製品の汎用評価基板

14-24-NL-LOGIC-EVM は、14 ピンから24 ピンの BQA、BQB、RGY、RSV、RJW、RHL の各パッケージに封止した各種ロジック デバイスや変換デバイスをサポートする設計を採用したフレキシブルな評価基板 (EVM) です。

ユーザー ガイド: PDF | HTML
シミュレーション・モデル

HSPICE Model for SN74LVC125A

SCEJ248.ZIP (97 KB) - HSpice Model
シミュレーション・モデル

SN74LVC125A Behavioral SPICE Model

SCAM111.ZIP (7 KB) - PSpice Model
シミュレーション・モデル

SN74LVC125A IBIS Model (Rev. C)

SCEM013C.ZIP (45 KB) - IBIS Model
シミュレーション・モデル

SN74LVC125A PSpice Transient Model

SCAM059.ZIP (30 KB) - PSpice Model
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SN74LVC125A TINA-TI Transient Reference Design

SCAM060.ZIP (44 KB) - TINA-TI Reference Design
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SN74LVC125A TINA-TI Transient Spice Model

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回路図: PDF
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SOP (NS) 14 オプションの表示
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TSSOP (PW) 14 オプションの表示
VQFN (RGY) 14 オプションの表示
WQFN (BQA) 14 オプションの表示

購入と品質

記載されている情報:
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL 定格 / ピーク リフロー
  • MTBF/FIT 推定値
  • 材質成分
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果
記載されている情報:
  • ファブの拠点
  • 組み立てを実施した拠点

サポートとトレーニング

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