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TPS51100

アクティブ

3A ソース/シンク DDR 終端レギュレータ

製品詳細

Vin (min) (V) 1.2 Vin (max) (V) 3.6 Vout (min) (V) 0.75 Vout (max) (V) 1.25 Features S3/S5 Support Iq (typ) (mA) 0.5 Rating Catalog Operating temperature range (°C) -40 to 85 Product type DDR DDR memory type DDR, DDR2, DDR3, DDR3L, LPDDR3
Vin (min) (V) 1.2 Vin (max) (V) 3.6 Vout (min) (V) 0.75 Vout (max) (V) 1.25 Features S3/S5 Support Iq (typ) (mA) 0.5 Rating Catalog Operating temperature range (°C) -40 to 85 Product type DDR DDR memory type DDR, DDR2, DDR3, DDR3L, LPDDR3
HVSSOP (DGQ) 10 14.7 mm² 3 x 4.9
  • 入力電圧範囲 : 4.75V~5.25V
  • VLDOIN電圧範囲 : 1.2V~3.6V
  • ドループ補償付3Aシンク/ソース・レギュレータ
  • 最小出力容量20μF(セラミックコンデンサ)
  • サスペンド時ハイ・インピーダンス(S3)およびソフ ト・オフ(S5)に対応
  • 1.2V入力(VLODIN)による消費電力低減可能
  • 1/2分圧抵抗内蔵(VT TREF)
  • リモート・センシング端子(VT TSNS)
  • 精度±20mV(VTT/ VTTREF)
  • 10mAバッファ付基準電圧(VT TREF)
  • ソフトスタート、UVLO、OCL機能内蔵
  • サーマル・シャットダウン機能
  • JEDEC規格準拠
  • APPLICATIONS
    • DDR /DDR2 メモリのターミネーション電源
    • SSTL-2、SSTL-18、HSTLのターミネーション電源

SWIFT、PowerPAD、SpActおよびBurr-Brownは、テキサス・インスツルメンツの商標です。

  • 入力電圧範囲 : 4.75V~5.25V
  • VLDOIN電圧範囲 : 1.2V~3.6V
  • ドループ補償付3Aシンク/ソース・レギュレータ
  • 最小出力容量20μF(セラミックコンデンサ)
  • サスペンド時ハイ・インピーダンス(S3)およびソフ ト・オフ(S5)に対応
  • 1.2V入力(VLODIN)による消費電力低減可能
  • 1/2分圧抵抗内蔵(VT TREF)
  • リモート・センシング端子(VT TSNS)
  • 精度±20mV(VTT/ VTTREF)
  • 10mAバッファ付基準電圧(VT TREF)
  • ソフトスタート、UVLO、OCL機能内蔵
  • サーマル・シャットダウン機能
  • JEDEC規格準拠
  • APPLICATIONS
    • DDR /DDR2 メモリのターミネーション電源
    • SSTL-2、SSTL-18、HSTLのターミネーション電源

SWIFT、PowerPAD、SpActおよびBurr-Brownは、テキサス・インスツルメンツの商標です。

TPS51100は、3Aのシンク/ソース・トラッッキング・ターミネー ション・レギュレータです。本製品は外付け部品点数が少なく、 小型、低コストが要求されるシステムに最適です。

TPS51100は出力容量としてわずか20µF(2 × 10µF)のセラミッ クコンデンサを用いるだけで高速な過渡応答を実現します。 TPS51100はリモート・センシング機能およびJEDEC規格による DDR/DDR2メモリのVTTバス・ターミネーション電源に必要とさ れる全ての機能に対応しています。さらに、S3状態(RAMへのサ スペンド)ではVTT出力をハイ・インピーダンスに、S5状態(ディ スクへのサスペンド)ではVTTとVTTREFを放電してオフ(ソフ ト・オフ)するスリープ・ステート・コントロール機能を内蔵してい ます。パッケージは熱効率の良い10ピンMSOP PowerPAD™を使 用し、動作温度範囲–40°C~85°Cで電気的特性を規定しています。

TPS51100は、3Aのシンク/ソース・トラッッキング・ターミネー ション・レギュレータです。本製品は外付け部品点数が少なく、 小型、低コストが要求されるシステムに最適です。

TPS51100は出力容量としてわずか20µF(2 × 10µF)のセラミッ クコンデンサを用いるだけで高速な過渡応答を実現します。 TPS51100はリモート・センシング機能およびJEDEC規格による DDR/DDR2メモリのVTTバス・ターミネーション電源に必要とさ れる全ての機能に対応しています。さらに、S3状態(RAMへのサ スペンド)ではVTT出力をハイ・インピーダンスに、S5状態(ディ スクへのサスペンド)ではVTTとVTTREFを放電してオフ(ソフ ト・オフ)するスリープ・ステート・コントロール機能を内蔵してい ます。パッケージは熱効率の良い10ピンMSOP PowerPAD™を使 用し、動作温度範囲–40°C~85°Cで電気的特性を規定しています。

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技術資料

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6 をすべて表示
種類 タイトル 最新の英語版をダウンロード 日付
* データシート 3Aシンク/ソース DDR ターミネーション・レギュレータ データシート 最新英語版 (Rev.E) PDF | HTML 2006年 11月 6日
アプリケーション・ノート LDO Noise Demystified (Rev. B) PDF | HTML 2020年 8月 18日
アプリケーション・ノート DDR VTT Power Solutions: A Competitive Analysis (Rev. A) 2020年 7月 9日
セレクション・ガイド 電源 IC セレクション・ガイド 2018 (Rev. R 翻訳版) 英語版 (Rev.R) 2018年 9月 13日
アプリケーション・ノート LDO PSRR Measurement Simplified (Rev. A) PDF | HTML 2017年 8月 9日
ユーザー・ガイド Using the TPS51100 2004年 7月 13日

設計と開発

その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページをご覧ください。

評価ボード

TPS51116EVM-001 — TPS51116EVM-001 評価モジュール

The TPS51116EVM evaluation module (EVM) is a dual-output converter for DDR and DDRII memory modules. It uses a 10 A synchronous buck converter to provide the core voltage (VDDQ) for DDR memory modules. The EVM is designed to use a 4.5 V to 28 V supply voltage and a 4.75 V to (...)

ユーザー ガイド: PDF
シミュレーション・モデル

TPS51100 PSpice Model

SLVC176.ZIP (473 KB) - PSpice Model
シミュレーション・モデル

TPS51100 TINA-TI Average Reference Design

SLVC203.ZIP (217 KB) - TINA-TI Reference Design
シミュレーション・モデル

TPS51100 TINA-TI Average Sink Reference Design (Rev. A)

SLVC177A.ZIP (217 KB) - TINA-TI Reference Design
シミュレーション・モデル

TPS51100 TINA-TI Average Spice Model

SLVC204.ZIP (7 KB) - TINA-TI Spice Model
シミュレーション・モデル

TPS51100 TINA-TI Transient Reference Design

SLVC206.ZIP (216 KB) - TINA-TI Reference Design
シミュレーション・モデル

TPS51100 TINA-TI Transient Spice Model

SLVC205.ZIP (7 KB) - TINA-TI Spice Model
パッケージ ピン数 ダウンロード
HVSSOP (DGQ) 10 オプションの表示

購入と品質

記載されている情報:
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL 定格 / ピーク リフロー
  • MTBF/FIT 推定値
  • 材質成分
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果
記載されている情報:
  • ファブの拠点
  • 組み立てを実施した拠点

推奨製品には、この TI 製品に関連するパラメータ、評価基板、またはリファレンス デザインが存在する可能性があります。

サポートとトレーニング

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