評価基板 (EVM) 向けの GUI
データシート
ADC32RF42
- 14ビット、デュアル・チャネル、1.5GSPS ADC
- ノイズ・フロア: -151.8dBFS/Hz
- 最高4GHzをサポートするRF入力
- アパーチャ・ジッタ: 90fS
- チャネル分離: fIN = 1.8GHzにおいて95dB
- スペクトラム性能(fIN = 950MHz、-2dBFS時)
- SNR: 61.1dBFS
- SFDR: 67dBc HD2、HD3
- スペクトラム性能(fIN = 1.85GHz、-2dBFS時)
- SNR: 58.9dBFS
- SFDR: 64dBc HD2、HD3
- オンチップのデジタル・ダウン・コンバータ
- 最大4つのDDC (デュアル・バンド・モード)
- DDCごとに最大3つの独立NCO
- 過電圧保護用のオンチップの入力クランプ
- プログラム可能なオンチップの電力検出器、AGCサポート用アラーム・ピン付き
- オンチップ・ディザリング
- オンチップの入力終端
- 入力フル・スケール: 1.35VPP
- マルチチップの同期をサポート
- JESD204Bインターフェイス
- サブクラス1ベースの確定的レイテンシ
- チャネルごとに4レーン、最高12.5Gbps
- 消費電力: 1.5GSPSのとき2W/Ch
- 72ピンのVQFNパッケージ(10mm×10mm)
ADC32RF42デバイスは、14ビット、1.5GSPS、デュアル・チャネルのA/Dコンバータ(ADC)で、最高4GHz、さらにそれ以上の入力周波数でのRFサンプリングをサポートします。ADC32RF42は高い信号対雑音比(SNR)を実現するよう設計されており、-151.8dBFS/Hzのノイズ・スペクトル密度と、広い入力周波数範囲にわたるダイナミック・レンジとチャネル分離を実現します。バッファ付きアナログ入力とオンチップの終端により、広い周波数帯域にわたって入力インピーダンスが均一で、サンプルとホールドのグリッチ・エネルギーが最小化されます。
各ADCチャネルは、デュアル・バンドのデジタル・ダウン・コンバータ(DDC)に接続でき、DDCごとに3つまでの独立した16ビット数値制御発振器(NCO)により、位相コヒーレントな周波数ホッピングが可能です。さらに、ADCにはフロントエンドのピークおよびRMS電力検出器とアラーム機能が装備されており、外部の自動ゲイン制御(AGC)アルゴリズムをサポートします。
ADC32RF42は、サブクラス1ベースの確定的レイテンシを持つJESD204Bシリアル・インターフェイスをサポートし、12.5Gbpsまでのデータ速度で、ADCごとに最大4レーンを使用できます。このデバイスは72ピンのVQFNパッケージ(10mm×10mm)で供給され、工業用温度範囲(-40℃～+85℃)に対応します。
技術資料
結果が見つかりませんでした。検索条件をクリアしてから、再度検索を試してください。
3 をすべて表示 | 種類 | タイトル | 最新の英語版をダウンロード | 日付 | |||
|---|---|---|---|---|---|---|
| * | データシート | ADC32RF42 デュアル・チャネル、14ビット、1.5GSPS、アナログ/デジタル・コンバータ データシート | PDF | HTML | 英語版 | PDF | HTML | 2017年 6月 8日 |
| EVM ユーザー ガイド (英語) | ADC32RFxxEVM User's Guide (Rev. E) | 2020年 1月 31日 | ||||
| アプリケーション・ノート | Configuration Files for ADC32RF45, ADC32RF83, and ADC32RF80 (Rev. B) | 2017年 9月 5日 |
設計と開発
その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページをご覧ください。
評価ボード
ADC32RF42EVM — ADC32RF42 デュアルチャネル 14 ビット 1.5GSPS、RF サンプリング ADC の評価基板
ADC32RF42 評価基板 (EVM) は、JESD204B インターフェイスを搭載したデュアル 1.5GSPS 14 ビット A/D コンバータ (ADC) の性能を提示します。この評価基板 (EVM) は ADC32RF42 デバイスを搭載しており、LMK04828 が JESD204B クロックを供給するほか、TI の各種電圧レギュレータが必要な電圧を供給します。
ADC の各チャネルの入力はデフォルトで 1 個のトランス入力回路に接続されており、この回路は 50Ω のシングルエンド信号源に接続可能クロック・リファレンス入力はトランス入力から供給されており、この入力は 50Ω (...)
ユーザー ガイド: PDF
ファームウェア
TI-JESD204-IP — 高速データ・コンバータへの FPGA 接続に役立つ、JESD204 Rapid Design IP (JESD204 採用の迅速設計知的財産)
JESD204 rapid design IP (迅速設計知的財産) は、良好に動作する JESD204 システムを FPGA エンジニアが開発する際に、迅速な経路をたどれる設計を採用しています。この IP は、ダウンストリーム (下流) のデジタル処理と他のアプリケーション・ロジックを、性能とタイミングに関する JESD204 プロトコルの重要な制約の大半から分離できるアーキテクチャを採用しています。この IP は、ファームウェア開発に費やす期間を短縮し、FPGA の統合を平易化できるように設計者を支援します。
JESD204 rapid design IP (迅速設計知的財産) は、TI (...)
計算ツール
FREQ-DDC-FILTER-CALC — RF-Sampling Frequency Planner, Analog Filter, and DDC Excel Calculator
This Excel calculator provides system designers a way to simplify the design and debugging of direct RF-sampling receivers. It offers three functions: frequency planning, analog filtering, and decimation filter spur location.
In the concept phase, a frequency-planning tool enables fine tuning of (...)
サポート対象の製品とハードウェア
製品
レシーバ
高速 ADC（≧10 MSPS）
RF サンプリング・トランシーバ
シミュレーション・ツール
PSPICE-FOR-TI — TI Design / シミュレーション・ツール向け PSpice®
PSpice® for TI は、各種アナログ回路の機能評価に役立つ、設計とシミュレーション向けの環境です。設計とシミュレーションに適したこのフル機能スイートは、Cadence® のアナログ分析エンジンを使用しています。PSpice for TI は無償で使用でき、アナログや電源に関する TI の製品ラインアップを対象とする、業界でも有数の大規模なモデル・ライブラリが付属しているほか、選択された一部のアナログ動作モデルも利用できます。
設計とシミュレーション向けの環境である PSpice for TI (...)
設計とシミュレーション向けの環境である PSpice for TI (...)
| パッケージ | ピン数 | ダウンロード |
|---|---|---|
| VQFNP (RMP) | 72 | オプションの表示 |
購入と品質
記載されている情報：
- RoHS
- REACH
- デバイスのマーキング
- リード端子の仕上げ / ボールの原材料
- MSL 定格 / ピーク リフロー
- MTBF/FIT 推定値
- 材質成分
- 認定試験結果
- 継続的な信頼性モニタ試験結果
記載されている情報：
- ファブの拠点
- 組み立てを実施した拠点
推奨製品には、この TI 製品に関連するパラメータ、評価基板、またはリファレンス デザインが存在する可能性があります。