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TPD4E110

アクティブ

高速インターフェイス向け、クワッド、0.45pF、5.5V、±12kV ESD 保護ダイオード

製品詳細

Package name DFN-0603 (X2SON) Peak pulse power (8/20 μs) (max) (W) 35 Vrwm (V) 5.5 Bi-/uni-directional Uni-Directional Number of channels 4 IO capacitance (typ) (pF) 0.45 Clamping voltage (V) 10 Breakdown voltage (min) (V) 6.5
Package name DFN-0603 (X2SON) Peak pulse power (8/20 μs) (max) (W) 35 Vrwm (V) 5.5 Bi-/uni-directional Uni-Directional Number of channels 4 IO capacitance (typ) (pF) 0.45 Clamping voltage (V) 10 Breakdown voltage (min) (V) 6.5
X2SON (DPW) 4 0.64 mm² 0.8 x 0.8
  • Provides System Level ESD Protection for Low-Voltage IO Interface
  • IO Capacitance 0.45pF (Typ)
  • IEC 61000-4-2 Level 4
    • ±12kV (Contact Discharge)
    • ±15kV (Air Gap Discharge)
  • IEC61000-4-5 (Surge): 2.5A (8/20 µs)
  • DC Breakdown Voltage 6.5V (Min)
  • Ultra Low Leakage Current 1nA (Max)
  • Low ESD Clamping Voltage
  • Industrial Temperature Range: –40°C to 125°C
  • Space Minimizing 0.8mm x 0.8mm DPW Package
  • Provides System Level ESD Protection for Low-Voltage IO Interface
  • IO Capacitance 0.45pF (Typ)
  • IEC 61000-4-2 Level 4
    • ±12kV (Contact Discharge)
    • ±15kV (Air Gap Discharge)
  • IEC61000-4-5 (Surge): 2.5A (8/20 µs)
  • DC Breakdown Voltage 6.5V (Min)
  • Ultra Low Leakage Current 1nA (Max)
  • Low ESD Clamping Voltage
  • Industrial Temperature Range: –40°C to 125°C
  • Space Minimizing 0.8mm x 0.8mm DPW Package

The TPD4E110 is a uni-directional Electrostatic Discharge (ESD) protection device with ultra-low capacitance. The device is constructed with a central ESD clamp and features two hiding diodes per channel to reduce the capacitive loading. Each channel is rated to dissipate ESD strikes above the maximum level specified in the IEC61000-4-2 level 4 international standard. The TPD4E110's ultra-low loading capacitance makes the device ideal for protecting high-speed signal pins.

The TPD4E110 is a uni-directional Electrostatic Discharge (ESD) protection device with ultra-low capacitance. The device is constructed with a central ESD clamp and features two hiding diodes per channel to reduce the capacitive loading. Each channel is rated to dissipate ESD strikes above the maximum level specified in the IEC61000-4-2 level 4 international standard. The TPD4E110's ultra-low loading capacitance makes the device ideal for protecting high-speed signal pins.

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技術資料

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種類 タイトル 最新の英語版をダウンロード 日付
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アプリケーション概要 ESD Protection for HDMI Applications (Rev. A) PDF | HTML 2023年 11月 1日
セレクション・ガイド System-Level ESD Protection Guide (Rev. D) 2022年 9月 7日
アプリケーション・ノート ESD Packaging and Layout Guide (Rev. B) PDF | HTML 2022年 8月 18日
ホワイト・ペーパー Designing USB for short-to-battery tolerance in automotive environments 2016年 2月 10日
Analog Design Journal Design Considerations for System-Level ESD Circuit Protection 2012年 9月 25日

設計と開発

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評価ボード

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SLVMA71.ZIP (2 KB) - IBIS Model
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TINA は DesignSoft (...)

ユーザー ガイド: PDF
英語版 (Rev.A): PDF
パッケージ ピン数 ダウンロード
X2SON (DPW) 4 オプションの表示

購入と品質

記載されている情報:
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL 定格 / ピーク リフロー
  • MTBF/FIT 推定値
  • 材質成分
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果
記載されている情報:
  • ファブの拠点
  • 組み立てを実施した拠点

推奨製品には、この TI 製品に関連するパラメータ、評価基板、またはリファレンス デザインが存在する可能性があります。

サポートとトレーニング

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