PMP20489

高密度 12Vin、0.8V 200A / 3.3V 75A POL のリファレンス・デザイン

概要

TPS53679 をベースとするこのリファレンス・デザインが採用した単一の IC は、2 つの多相出力を制御します。メイン出力で最大 6 相に対応し、チャネル 2 で最大 2 相に対応する形で、合計で最大 7 相に対応します。  また多相を活用して、各相の出力リップルを互いに打ち消し合うことや、特定のスイッチング周波数で帯域幅制御を実質的に向上させることもできます。PMP20489 リファレンス・デザインは、大電流の 5 相と 2 相を使用するアプリケーション、および 2 個のオンボード動的負荷を示します。テスト・レポートは、放熱特性、ダイナミック応答、効率に注目しています。

特長
  • 包括的で大電流の 5 + 2 相 DC/DC コンバータは、高速制御に対応し、POL アプリケーションに最適
  • GUI で設定するループ補償
  • グランドに接続した冷却パッドを取り付けた大電流の出力段
  • 自己完結型の高速ダイナミック・テスト負荷や、信号ジェネレータが生成する動的テスト負荷を含め、情報が豊富なテキスト・インターフェイス
  • 効率、温度上昇、ダイナミック負荷性能に注目した回路図、BOM(部品表)、レイアウト、テスト・レポート
出力電圧オプション PMP20489.1 PMP20489.2
Vin (Min) (V) 4.5 10.8
Vin (Max) (V) 13.2 13.2
Vout (Nom) (V) .8 3.3
Iout (Max) (A) 200 75
Output Power (W) 160 247.5
Isolated/Non-Isolated Non-Isolated Non-Isolated
Input Type DC DC
Topology Buck- Multiphase Buck- Multiphase
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組み立てられたボードは、テストと性能検証のみの目的で開発されたものであり、販売していません。

設計ファイルと製品

設計ファイル

すぐに使用できるシステム・ファイルをダウンロードすると、設計プロセスを迅速化できます。

TIDUDS7.PDF (3028 K)

効率グラフや試験の前提条件などを含める、このリファレンス・デザインに関する試験結果

TIDRTC0.PDF (522 K)

設計レイアウトとコンポーネントを示した詳細な回路図

TIDRTC1.PDF (41 K)

設計に使用したコンポーネント、参照指定子、メーカー名や型番などを記入した詳細なリスト

TIDRTC2.PDF (491 K)

コンポーネントの配置を明示する詳細な設計レイアウト

TIDRTC4.ZIP (2797 K)

IC コンポーネントの 3D モデルまたは 2D 図面に使用するファイル

TIDCDY8.ZIP (1704 K)

PCB 設計の基板層に関する情報を記載した設計ファイル

TIDRTC3.PDF (5670 K)

PCB 設計レイアウトを生成するための PCB 基板層のプロット・ファイル

製品

設計や代替製品候補に TI 製品を含めます。

AC/DC & DC/DC controllers (external FET)

TPS53679NVM (不揮発性メモリ) と PMBus 搭載、デュアルチャネル、6+1/5+2 構成、VR13 向け、D-CAP+™、降圧マルチフェーズ コントローラ

データシート: PDF | HTML
AC/DC & DC/DC converters (integrated FET)

TPS62163DCS-Control™ 搭載、3V ~ 17V、1A 降圧コンバータ

データシート: PDF | HTML
Si power stages

CSD95490Q5MCDualCool パッケージ封止、75A、同期整流降圧 NexFET™ スマート電力段

データシート: PDF | HTML
リニア・レギュレータと低ドロップアウト (LDO) レギュレータ

TPS732逆電流保護機能とイネーブル搭載、250mA、高精度、超低ドロップアウト電圧レギュレータ

データシート: PDF

技術資料

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* 試験報告書 PMP20489 Test Results 2017年 11月 3日

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