TIDA-00467

同期整流マルチ JESD204B ADC、エミッタ・ポジション・ロケーション、リファレンス・デザイン

TIDA-00467

設計ファイル

概要

A common technique to estimate the position of emitters uses the amplitude and phase shift data of a signal derived from an array of spatially distributed sensors. For such systems, it is important to guarantee a deterministic phase relationship between the sensors to minimize errors in the actual measured data. This application design will discuss how multiple Analog to Digital Converters (ADCs) with a JESD204B interface can be synchronized so that the
sampled data from the ADCs are phase aligned.

特長
  • Synchronized 2 giga sample ADCs sampling at 3.072GHz
  • System expandable to more than 2 ADCs
  • Phase variation less than 1 ADC clock period
  • Easy to use software interface for control and data acquisition
  • Excellent spur and noise perfromance of ADC at 3.072GHz
  • This design is tested and includes software, demo hardware and a design guide.
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組み立てられたボードは、テストと性能検証のみの目的で開発されたものであり、販売していません。

設計ファイルと製品

設計ファイル

すぐに使用できるシステム・ファイルをダウンロードすると、設計プロセスを迅速化できます。

TIDU851.PDF (603 K)

リファレンス・デザインの概要と検証済みの性能テスト・データ

TIDRE83.PDF (1278 K)

設計レイアウトとコンポーネントを示した詳細な回路図

TIDRE84.PDF (250 K)

設計レイアウトとコンポーネントを示した詳細な回路図

TIDRE85.PDF (318 K)

設計に使用したコンポーネント、参照指定子、メーカー名や型番などを記入した詳細なリスト

TIDRE86.PDF (216 K)

設計に使用したコンポーネント、参照指定子、メーカー名や型番などを記入した詳細なリスト

TIDRE87.PDF (1261 K)

コンポーネントの配置を明示する詳細な設計レイアウト

TIDRE88.PDF (117 K)

コンポーネントの配置を明示する詳細な設計レイアウト

TIDRE90.ZIP (9933 K)

IC コンポーネントの 3D モデルまたは 2D 図面に使用するファイル

TIDCA48.ZIP (712 K)

PCB 設計の基板層に関する情報を記載した設計ファイル

TIDCA49.ZIP (1436 K)

PCB 設計の基板層に関する情報を記載した設計ファイル

TIDRE89.PDF (2955 K)

PCB 設計レイアウトを生成するための PCB 基板層のプロット・ファイル

製品

設計や代替製品候補に TI 製品を含めます。

高速 ADC(≧10 MSPS)

ADC12J400012 ビット、4.0GSPS、RF サンプリング A/D コンバータ (ADC)

データシート: PDF | HTML
クロック・ジッタ・クリーナとシンクロナイザ

LMK048282370 ~ 2630MHz の VCO0 内蔵、超低ノイズ、JESD204B 準拠クロック・ジッタ・クリーナ。

データシート: PDF | HTML

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ソフトウェア

技術資料

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種類 タイトル 英語版のダウンロード 日付
設計ガイド Synchronizing Multiple JESD204B ADCs for Emitter Position Location Design Guide 2015年 3月 24日

サポートとトレーニング

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