TPS51200 シンク/ソース DDR ターミネーション・レギュレータ
TPS51200EVM
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概要/特長

技術資料

サポートとトレーニング

注文情報



概要

The TPS51200EVM evaluation board, HPA322A is designed to evaluate the performance and characteristics of TI's cost optimized DDR/DDR2/DDR3/LP DDR3 VTT termination regulator, the TPS51200. The TPS51200 is designed to provide proper termination voltage and a 10-mA buffered reference voltage for DDR memory which covered DDR (2.5 V/1.25 V), DDR2 (1.8 V/0.9 V), DDR3 (1.5 V/0.75 V), LP DDR3 (1.2 V/0.6 V) specifications with minimal external components.

特長
  • Input Voltage: Support 2.5V Rail and 3.3V Rail
  • VLDOIN, VDDQ Voltage Range: 1.2V-2.5V
  • Build-in transient load switches (with both sinking and sourcing capability) to emulate the sink/source transient behavior which helps to evaluate the dynamic performance. For ease of use, both load step and timing of transient can be modified by on board resistors, and current information can also be monitored on board.
    • DDR: +/-1.67 A Sink/Source Transient Load
    • DDR2: +/-1.2 A Sink/Source Transient Load
    • DDR3: +/-1.0 A Sink/Source Transient Load
    • LP DDR3: +/-0.8 A Sink/Source Transient Load
  • Switcher S1 for enable function
  • Convenient test points for probing PGOOD, CLK_IN and loop response testing
  • 2-layer PCB with all the components on the bottom side

注文
型番 TI またはサードパーティからご購入 オーダー・オプション 供給状況

TPS51200EVM:
TPS51200 シンク/ソース DDR ターミネーション・レギュレータ

$49.00(USD)


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ACTIVE

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技術資料
データシート (1)
タイトル 種類 サイズ (KB) 日付 英語版
PDF 7889 2017年 11月 8日 英語版をダウンロード (Rev.C)
ユーザー・ガイド (1)
タイトル 種類 サイズ (KB) 日付 英語版
PDF 383 2008年 5月 28日
その他の技術資料 (1)
タイトル 種類 サイズ (KB) 日付 英語版
PDF 38 2019年 1月 2日
関連製品

TI デバイス (6)

型番 名前 製品ファミリ
CSD17305Q5A  30V、N チャネル NexFET™ パワー MOSFET  MOSFET 
TPS51100  3 A ソース/シンク DDR ターミネータ・レギュレータ  電源 IC 
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