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RF PLL / シンセサイザ – 技術資料

RF フェーズ・ロック・ループ(PLL)とシンセサイザのセレクション・ガイド、アプリケーション・ノート、ホワイト・ペーパーなど。

主なアプリケーション・ノート

プログラム可能な入力マルチプライヤによる整数境界スプリアスの最小化

プログラム可能な入力マルチプライヤを使用すると、特にワースト条件下の VCO 周波数で、PLLのスプリアスを劇的に改善できます。この機能は、LMX2571、LMX2582、LMX2592 など TI の複数の PLL に搭載されています。

Clocking Optimization for RF Sampling Analog-to-Digital Converters (Rev. A)

ADC を使用するシステムを設計する場合、クロックのジッタが原因で ADC の信号対雑音比(SNR)が低下しないことを確認してください。高性能シンセサイザと RF サンプリング ADC を組み合わせて使用すると、最適なシステム性能を実現できます。

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アプリケーション・ノート

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タイトル
種類
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日付
Streamline RF Synthesizer VCO Calibration and Optimize PLL Lock Time (Rev. A) PDF 1585 27 Aug 2021
Clocking Optimization for RF Sampling Analog-to-Digital Converters (Rev. A) PDF 668 07 Apr 2021
Gsps ADC's Clocking PDF 2763 11 Nov 2020

セレクション・ガイド

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タイトル
種類
サイズ(KB)
日付
TI Space Products (Rev. H) PDF 1412 27 Jan 2021
TI Components for Aerospace and Defense Guide (Rev. E) PDF 9699 22 Mar 2017
ポータブル計測ソリューション 高精度アナログ製品リファレンス・ガイド (Rev. A 翻訳版) PDF 1402 01 Dec 2009