ADC09SJ1300-Q1

アクティブ

車載対応、JESD204C インターフェイス搭載、シングルチャネル、9 ビット、1.3GSPS A/D コンバータ (ADC)

製品詳細

Sample rate (max) (Msps) 1300 Resolution (Bits) 9 Number of input channels 1 Interface type JESD204B, JESD204C Analog input BW (MHz) 6000 Features Ultra High Speed Rating Automotive Peak-to-peak input voltage range (V) 0.8 Power consumption (typ) (mW) 940 Architecture Folding Interpolating SNR (dB) 53.5 ENOB (bit) 8.5 SFDR (dB) 64 Operating temperature range (°C) -40 to 125 Input buffer Yes
Sample rate (max) (Msps) 1300 Resolution (Bits) 9 Number of input channels 1 Interface type JESD204B, JESD204C Analog input BW (MHz) 6000 Features Ultra High Speed Rating Automotive Peak-to-peak input voltage range (V) 0.8 Power consumption (typ) (mW) 940 Architecture Folding Interpolating SNR (dB) 53.5 ENOB (bit) 8.5 SFDR (dB) 64 Operating temperature range (°C) -40 to 125 Input buffer Yes
FCCSP (AAV) 144 100 mm² 10 x 10
  • 車載アプリケーション用に AEC-Q100 認定取得済み
    • 温度グレード 1:–40℃~+125℃、TA
  • ADC コア
    • 分解能:9 ビット
    • 最大サンプリング・レート:1.3GSPS
    • インターリーブなしのアーキテクチャ
    • 内部ディザリングにより高次高調波を低減
  • パフォーマンス仕様 (–1dBFS)
    • SNR (100MHz):53.5dBFS
    • ENOB (100MHz):8.5 ビット
    • SFDR (100MHz):64dBc
    • ノイズ・フロア (–20dBFS):–143dBFS
  • フルスケール入力電圧:800mVPP-DIFF
  • 全出力入力帯域幅:6GHz
  • JESD204C シリアル・データ・インターフェイス
    • 合計 2~8 (クワッド / デュアル・チャネル) または 1~4 (シングル・チャネル) の SerDes レーン数に対応
    • 最大ボー・レート:17.16Gbps
    • 64B/66B と 8B/10B のエンコード・モード
    • Subclass-1 サポートによる決定論的レイテンシ
    • JESD204B レシーバと互換
  • 内部サンプリング・クロック生成のオプション
    • PLL および VCO (7.2~8.2GHz) 内蔵
  • SYSREF ウィンドウ処理により同期が簡単
  • 4 つのクロック出力によりシステム・クロック供給を簡素化
    • FPGA または隣接 ADC 用のリファレンス・クロック
    • SerDes トランシーバ用のリファレンス・クロック
  • パルス式システム用のタイムスタンプ入力および出力
  • 消費電力 (1GSPS)
    • クワッド・チャネル:450mW/チャネル
    • デュアル・チャネル:625mW/チャネル
    • シングル・チャネル:940mW
  • 電源:1.1V、1.9V
  • 車載アプリケーション用に AEC-Q100 認定取得済み
    • 温度グレード 1:–40℃~+125℃、TA
  • ADC コア
    • 分解能:9 ビット
    • 最大サンプリング・レート:1.3GSPS
    • インターリーブなしのアーキテクチャ
    • 内部ディザリングにより高次高調波を低減
  • パフォーマンス仕様 (–1dBFS)
    • SNR (100MHz):53.5dBFS
    • ENOB (100MHz):8.5 ビット
    • SFDR (100MHz):64dBc
    • ノイズ・フロア (–20dBFS):–143dBFS
  • フルスケール入力電圧:800mVPP-DIFF
  • 全出力入力帯域幅:6GHz
  • JESD204C シリアル・データ・インターフェイス
    • 合計 2~8 (クワッド / デュアル・チャネル) または 1~4 (シングル・チャネル) の SerDes レーン数に対応
    • 最大ボー・レート:17.16Gbps
    • 64B/66B と 8B/10B のエンコード・モード
    • Subclass-1 サポートによる決定論的レイテンシ
    • JESD204B レシーバと互換
  • 内部サンプリング・クロック生成のオプション
    • PLL および VCO (7.2~8.2GHz) 内蔵
  • SYSREF ウィンドウ処理により同期が簡単
  • 4 つのクロック出力によりシステム・クロック供給を簡素化
    • FPGA または隣接 ADC 用のリファレンス・クロック
    • SerDes トランシーバ用のリファレンス・クロック
  • パルス式システム用のタイムスタンプ入力および出力
  • 消費電力 (1GSPS)
    • クワッド・チャネル:450mW/チャネル
    • デュアル・チャネル:625mW/チャネル
    • シングル・チャネル:940mW
  • 電源:1.1V、1.9V

ADC09xJ1300-Q1 は、クワッド、デュアル、シングル・チャネル、9 ビット、1.3GSPS の A/D コンバータ (ADC) ファミリです。ADC09xJ1300-Q1 は、低消費電力、高いサンプリング・レート、9 ビットの分解能から、光学検出および距離測定 (LiDAR) システムに理想的です。ADC09xJ1300-Q1 は 車載アプリケーション用に認定済みです。

6GHz の全出力入力帯域幅 (-3dB) により、周波数変調連続波 (FMCW) LiDAR システムに適した平坦な周波数応答と、パルス・ベースのシステムに適した狭いインパルス応答が得られます。この全出力入力帯域幅により、最高 4GHz の直接 RF サンプリングも可能です。

ADC09xJ1300-Q1 は、クワッド、デュアル、シングル・チャネル、9 ビット、1.3GSPS の A/D コンバータ (ADC) ファミリです。ADC09xJ1300-Q1 は、低消費電力、高いサンプリング・レート、9 ビットの分解能から、光学検出および距離測定 (LiDAR) システムに理想的です。ADC09xJ1300-Q1 は 車載アプリケーション用に認定済みです。

6GHz の全出力入力帯域幅 (-3dB) により、周波数変調連続波 (FMCW) LiDAR システムに適した平坦な周波数応答と、パルス・ベースのシステムに適した狭いインパルス応答が得られます。この全出力入力帯域幅により、最高 4GHz の直接 RF サンプリングも可能です。

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技術資料

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* データシート ADC09xJ1300-Q1 クワッド / デュアル / シングル・チャネル、1.3GSPS、9 ビット、 JESD204C インターフェイス搭載のアナログ / データシート (Rev. A 翻訳版) 英語版 (Rev.A) PDF | HTML 2021年 8月 3日

設計と開発

その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページをご覧ください。

評価ボード

ADC09QJ1300EVM — ADC09QJ1300 JESD204C インターフェイス搭載、クワッドチャネル、9 ビット、1.3GSPS ADC の評価基板

ADC09QJ1300 評価基板 (EVM) を使用すると、ADC09QJ1300-Q1 デバイスを評価できます。ADC09QJ1300-Q1 は、低消費電力、9 ビット、クワッドチャネル、1.3GSPS の A/D コンバータ (ADC) であり、バッファ付きアナログ入力と統合型ダウン・コンバータに加えて、JESD204B/C インターフェイスを実装したオンチップ PLL も搭載しています。この評価基板 (EVM) は、トランス結合型のアナログ入力を複数採用しており、多様な信号源と広い周波数範囲に対応できます。

この評価基板 (EVM) は、JESD204B/C クロック・ジェネレータである (...)

ユーザー ガイド: PDF
評価ボード

TSW12QJ1600EVM — ADC12QJ1600-Q1 8 チャネル (同期 4 チャネル x 2 組)、12 ビット、1.6GSPS、JESD204C インターフェイス搭載 ADC の評価基板

TSW12QJ1600 評価基板 (EVM) を使用すると、さまざまなフロント・エンド・オプションが利用できる A/D コンバータ (ADC) である ADC12QJ1600-Q1 を評価できます。ADC12QJ1600-Q1 は、4 個のアナログ入力チャネルを実装し、最大 1.6GSPS (ギガサンプル/秒) のサンプリング・レートで動作できる 12 ビット ADC です。

このデザインは、2 個の ADC12QJ1600-Q1 デバイスを同じプリント基板 (PCB) に搭載しています。このデザインを活用して、複数の ADC (...)

ユーザー ガイド: PDF
ファームウェア

TI-JESD204-IP — 高速データ・コンバータへの FPGA 接続に役立つ、JESD204 Rapid Design IP (JESD204 採用の迅速設計知的財産)

JESD204 rapid design IP (迅速設計知的財産) は、良好に動作する JESD204 システムを FPGA エンジニアが開発する際に、迅速な経路をたどれる設計を採用しています。この IP は、ダウンストリーム (下流) のデジタル処理と他のアプリケーション・ロジックを、性能とタイミングに関する JESD204 プロトコルの重要な制約の大半から分離できるアーキテクチャを採用しています。この IP は、ファームウェア開発に費やす期間を短縮し、FPGA の統合を平易化できるように設計者を支援します。

JESD204 rapid design IP (迅速設計知的財産) は、TI (...)

シミュレーション・モデル

ADC12QJ1600 IBIS-AMI Model

SBAM512.ZIP (68 KB) - IBIS-AMI Model
シミュレーション・ツール

PSPICE-FOR-TI — TI Design / シミュレーション・ツール向け PSpice®

PSpice® for TI は、各種アナログ回路の機能評価に役立つ、設計とシミュレーション向けの環境です。設計とシミュレーションに適したこのフル機能スイートは、Cadence® のアナログ分析エンジンを使用しています。PSpice for TI は無償で使用でき、アナログや電源に関する TI の製品ラインアップを対象とする、業界でも有数の大規模なモデル・ライブラリが付属しているほか、選択された一部のアナログ動作モデルも利用できます。

設計とシミュレーション向けの環境である PSpice for TI (...)
パッケージ ピン数 ダウンロード
FCCSP (AAV) 144 オプションの表示

購入と品質

記載されている情報:
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL 定格 / ピーク リフロー
  • MTBF/FIT 推定値
  • 材質成分
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果
記載されている情報:
  • ファブの拠点
  • 組み立てを実施した拠点

サポートとトレーニング

TI E2E™ フォーラムでは、TI のエンジニアからの技術サポートを提供

コンテンツは、TI 投稿者やコミュニティ投稿者によって「現状のまま」提供されるもので、TI による仕様の追加を意図するものではありません。使用条件をご確認ください。

TI 製品の品質、パッケージ、ご注文に関するお問い合わせは、TI サポートをご覧ください。​​​​​​​​​​​​​​

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