デュアルチャネル 5.2GSPS またはシングルチャネル 10.4GSPS、RF サンプリング 12 ビット ADC
製品の詳細
パラメータ
パッケージ|ピン|サイズ
特長
- ADC コア
- 12 ビット分解能
- シングル・チャネル・モードで最大 10.4GSPS
- デュアル・チャネル・モードで最大 5.2 GSPS
- 性能仕様
- ノイズ・フロア (-20dBFS、VFS = 1.0VPP-DIFF)
- デュアル・チャネル・モード:-151.8dBFS/Hz
- シングル・チャネル・モード:-154.4dBFS/Hz
- ENOB (デュアル・チャネル、FIN = 2.4GHz):8.6 ビット
- ノイズ・フロア (-20dBFS、VFS = 1.0VPP-DIFF)
- バッファ付きアナログ入力、VCMI = 0V
- アナログ入力帯域幅 (-3dB):8.0GHz
- 使用可能な入力周波数範囲: > 10GHz
- フルスケール入力電圧 (VFS、デフォルト):0.8VPP
- ノイズなしのアパーチャ遅延 (TAD) 調整
- 高精度のサンプリング制御:19fs ステップ
- 同期およびインターリーブ動作を簡素化
- 遅延は温度および電圧に対して不変
- 使いやすい同期機能
- SYSREFタイミングの自動較正
- サンプル・マーキング用のタイムスタンプ
- JESD204C シリアル・データ・インターフェイス
- 最大レーン速度:17.16Gbps
- 64B/66B および 8B/10B エンコードのサポート
- 8B/10B モードは JESD204B 互換
- オプションのデジタル降圧コンバータ (DDC)
- 4x および 8x の復号間引き
- DDC ごとに 4 つの独立した 32 ビット NCO
- 消費電力:4.0W
- 電源:1.1V、1.9V
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概要
ADC12DJ5200RF デバイスは、DC から 10GHz 超の入力周波数を直接サンプリングできる RF サンプリング、ギガ・サンプルの A/D コンバータ (ADC) です。ADC12DJ5200RF はデュアル・チャネル 5.2GSPS の ADC、またはシングル・チャネル 10.4GSPS の ADC として構成できます。これらの動作モードでは、チャネル数とナイキスト帯域幅のトレードオフをプログラムで制御できるため、多様なアプリケーションの要求を満たす柔軟なハードウェアを設計できます。使用可能な入力周波数帯域が最高 10GHz であるため、L バンド、S バンド、C バンド、X バンドを直接 RF サンプリングでき、多様な周波数に対応したシステムを実現できます。
ADC12DJ5200RF は、最大 17.16Gbps のライン速度をサポートする最大 16 のシリアル化されたレーンを備えた、高速な JESD204C 出力インターフェイスを使っています。JESD204C subclass-1 により、決定論的レイテンシおよびマルチデバイス同期がサポートされています。JESD204C インターフェイスは、ライン速度とレーン数との間でトレードオフのバランスを取るように構成できます。8B/10B と 64B/66B の両方のデータ・エンコードをサポートしています。64B/66B エンコードでは、前方エラー訂正 (FEC) によるビット・エラー率の改善をサポートしています。8B/10B エンコード・モードを使用する場合、インターフェイスは JESD204B レシーバと下位互換です。
ノイズなしのアパーチャ遅延 (TAD) 調整や、SYSREF ウィンドウ処理などの革新的な同期機能により、マルチ・チャネル・アプリケーションのシステム設計を簡素化できます。オプションのデジタル・ダウン・コンバータ (DDC) を使用すると、ベースバンドへのデジタル変換を実行でき、またインターフェイス速度を低減できます。
技術資料
種類 | タイトル | 英語版のダウンロード | 日付 | |
---|---|---|---|---|
* | データシート | ADC12DJ5200RF 10.4GSPS シングル・チャネル、または 5.2GSPS デュアル・チャネル、12 ビット、RF サンプリング A/D コンバータ (ADC) データシート | 最新の英語版をダウンロード (Rev.B) | 2018年 3月 8日 |
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アプリケーション・ノート | Powering Noise Sensitive ADC Supplies with the TPS6291x Micro Noise Buck Convert | 2020年 9月 30日 | ||
技術記事 | Step-by-step considerations for designing wide-bandwidth multichannel systems | 2019年 6月 4日 | ||
技術記事 | So, what are S-parameters anyway? | 2019年 5月 23日 | ||
ユーザー・ガイド | Generic Wrist Watch Programmer's Guide | 2019年 4月 5日 | ||
技術記事 | How to achieve fast frequency hopping | 2019年 3月 3日 |
設計と開発
追加の事項や他のリソースを参照するには、以下のタイトルをクリックすると、詳細ページを表示できます。ハードウェア開発
概要
The ADC12DJ5200RF evaluation module (EVM) allows for the evaluation of device ADC12DJ5200RF. The ADC12DJ5200RF is a low-power, 12-bit, dual 5.2-GSPS/single 10.4-GSPS, RF-sampling analog-to-digital converter (ADC) with a buffered analog input, integrated digital down converter with programmable NCO (...)
特長
- Flexible transformer-coupled analog input to allow for a variety of sources and frequencies
- Easy-to-use software GUI to configure ADC12DJ5200RF, LMX2582, and LMK04828 devices for a variety of configurations through a USB interface
- Quickly evaluate ADC performance through high-speed data converter pro (...)
概要
ソフトウェア開発
JESD204 rapid design IP は、TI の高速データ・コンバータと組み合わせて使用する目的で、ロイヤルティ・フリーの提供を実施しています。 TI は、初期リンクの構成に関して、開発ユーザーの皆様を支援する予定です。特定の FPGA プラットフォームと TI のデータ・コンバータの JMODE の間での使用を想定したカスタマイズに対応します。TI は、この IP のテストを終えて展開する準備ができた段階で、セキュア・ダウンロード・リンクを経由してこの IP を提供します。
JESD204 rapid design IP は、以下の各 FPGA ファミリをサポートします。
- Xilinx® Virtex™ UltraScale™ と UltraScale+™
- Xilinx Kintex™ UltraScale と UltraScale+
- Xilinx Zynq™ UltraScale+ と Zynq UltraScale+ (Auto (...)
特長
- JEDEC の JESD204a/b/c の各プロトコルとの互換性あり
- サブクラス 1 の確定的待ち時間とマルチデバイス同期機能をサポート
- サポート対象のレーン・レート
- 8b/10b モードで最大 16.375Gbps
- 64b/66b モードで最大 20Gbps
- プロトコル関連のすべてのエラーに関する検出機能と報告機能をサポート
- 内蔵のトランスポート層は、レーンのデータをサンプリング・データに変換 (HD モードではサポートしない)
- FPGA 内部でロジックとメモリのフットプリントを最適化済みであり、アプリケーション・ロジック向けのリソースを解放 (また、該当する場合は、FPGA の小型化や低コスト化に貢献)
- ラインのレートに対して非同期であるクロック・レートでデータをエクスポートするなど、斬新な設計機能を搭載
設計ツールとシミュレーション
設計とシミュレーション向けの環境である PSpice for TI を使用すると、内蔵のライブラリを活用して、複雑なミックスド・シグナル設計のシミュレーションを実施することができます。完成度の高い最終機器を設計し、レイアウトの確定や製造開始より前に、ソリューションのプロトタイプを製作することができます。この結果、市場投入期間の短縮と開発コストの削減を実現できます。
設計とシミュレーション向けのツールである PSpice for TI の環境内で、各種 TI デバイスの検索、製品ラインアップの参照、テスト・ベンチの起動、設計のシミュレーションを実施し、選定したデバイスをさらに分析することができます。また、複数の TI デバイスを組み合わせてシミュレーションを実行することもできます。
事前ロード済みの複数のモデルで構成されたライブラリ全体に加えて、PSpice for TI ツール内で各種 TI デバイスの最新の技術関連資料に簡単にアクセスすることもできます。開発中のアプリケーションに適したデバイスを選定できたことを確認した後、TI 製品の購入ページにアクセスして、その製品を購入することができます。
PSpice for TI を使用すると、回路の検討から設計の開発や検証まで、作業の進展に合わせて設計サイクルの各段階で、シミュレーションのニーズに適した各種ツールにアクセスできます。コスト不要で入手でき、開発を容易に開始できます。設計とシミュレーションに適した PSpice スイートをダウンロードして、今すぐ設計を開始してください。
開発の開始
- PSpice for TI シミュレータへのアクセスの申請
- ダウンロードとインストール
- シミュレーション方法説明ビデオのご視聴
特長
- Cadence の PSpice テクノロジーを活用
- デジタル・モデル・スイートが付属する事前インストール済みのライブラリを活用して、ワーストケース・タイミング分析を実現可能
- 動的更新により、最新のデバイス・モデルに確実にアクセス可能
- 精度の低下を招かずに、シミュレーション速度を重視して最適化済み
- 複数製品の同時分析をサポート
- OrCAD Capture フレームワークを土台とし、業界で最も幅広く使用されている回路図のキャプチャとシミュレーションの環境へのアクセスを実現
- オフライン作業が可能
- 以下の点を含め、多様な動作条件とデバイス公差にまたがって設計を検証
- 自動的な測定と後処理
- モンテカルロ分析法
- ワーストケース分析
- 熱解析
In the concept phase, a frequency-planning tool enables fine tuning of both (...)
特長
- Frequency planning
- Analog filtering
- Decimation filter spur location
リファレンス・デザイン
設計ファイル
-
download TIDA-010128 Assembly Drawing.pdf (2981KB) -
download TIDA-010128 PCB.pdf (28701KB) -
download TIDA-010128 CAD Files.zip (37212KB) -
download TIDA-010128 Gerber.zip (13521KB) -
download TIDA-01028 & TIDA-010128 BOM (Rev. A).pdf (240KB)
設計ファイル
-
download TIDA-01028 Assembly Drawing.pdf (2940KB) -
download TIDA-01028 PCB.pdf (28699KB) -
download TIDA-01028 CAD Files.zip (41928KB) -
download TIDA-01028 Gerber.zip (13521KB) -
download TIDA-01028 & TIDA-010128 BOM (Rev. A).pdf (240KB)
設計ファイル
-
download TIDA-01027 BOM.pdf (209KB) -
download TIDA-01027 Assembly Drawing.pdf (878KB) -
download TIDA-01027 PCB.pdf (2971KB) -
download TIDA-01027 CAD Files.zip (2870KB) -
download TIDA-01027 Gerber.zip (765KB)
CAD/CAE シンボル
パッケージ | ピン数 | ダウンロード |
---|---|---|
FCBGA (AAV) | 144 | オプションの表示 |
購入と品質
- RoHS
- REACH
- デバイスのマーキング
- リード端子の仕上げ / ボールの原材料
- MSL rating/ リフローピーク温度
- MTBF/FIT の推定値
- 原材料組成
- 認定試験結果
- 継続的な信頼性モニタ試験結果
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