CD74HC4017-Q1

アクティブ

オートモーティブ・デバイス・カタログ、10 進カウンタ/分周、10 デコード出力

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製品の詳細

パラメータ

Technology Family HC VCC (Min) (V) 2 VCC (Max) (V) 6 Bits (#) 10 Voltage (Nom) (V) 3.3, 5 F @ nom voltage (Max) (MHz) 28 ICC @ nom voltage (Max) (mA) 0.08 tpd @ nom Voltage (Max) (ns) 54 IOL (Max) (mA) 5.2 IOH (Max) (mA) -5.2 Function Counter Type Decade Rating Automotive Operating temperature range (C) -40 to 125 open-in-new その他の カウンタ/算術/パリティ機能 IC

パッケージ|ピン|サイズ

TSSOP (PW) 16 22 mm² 4.4 x 5 open-in-new その他の カウンタ/算術/パリティ機能 IC

特長

  • Qualified for Automotive Applications
  • Fully Static Operation
  • Buffered Inputs
  • Common Reset
  • Positive Edge Clocking
  • Typical fMAX = 60 MHz at VCC = 5 V,
    CL = 15 pF, TA = 25°C
  • Fanout (Over Temperature Range)
    • Standard Outputs . . . 10 LSTTL Loads
    • Bus Driver Outputs . . . 15 LSTTL Loads
  • Balanced Propagation Delay and Transition Times
  • Significant Power Reduction Compared to LSTTL Logic ICs
  • VCC Voltage = 2 V to 6 V
  • High Noise Immunity NIL or NIH = 30% of VCC, VCC = 5 V

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概要

The CD74HC4017 is a high-speed silicon-gate CMOS 5-stage Johnson counter with ten decoded outputs. Each of the decoded outputs normally is low and sequentially goes high on the low-to-high transition clock period of the ten-clock-period cycle. The carry (TC) output transitions low to high after output 9 goes from high to low, and can be used in conjunction with the clock enable (CE) input to cascade several stages. CE disables counting when in the high state. A master reset (MR) input also is provided that, when taken high, sets all the decoded outputs, except output 0, to low.

The device can drive up to ten low-power Schottky equivalent loads.

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ダウンロード

技術資料

= 主要な資料
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種類 タイトル 英語版のダウンロード 日付
* データシート High-Speed CMOS Logic Decade Counter/Divider With 10 Decoded Outputs データシート 2008年 4月 15日
アプリケーション・ノート Implications of Slow or Floating CMOS Inputs 2016年 6月 23日
アプリケーション・ノート Understanding and Interpreting Standard-Logic Data Sheets 2015年 12月 2日
その他の技術資料 車載用ロジック・デバイス 英語版をダウンロード 2015年 2月 4日
セレクション・ガイド ロジック・ガイド (Rev. AA 翻訳版) 最新の英語版をダウンロード (Rev.AB) 2014年 11月 6日
ソリューション・ガイド LOGIC Pocket Data Book 2007年 1月 16日
アプリケーション・ノート Semiconductor Packing Material Electrostatic Discharge (ESD) Protection 2004年 7月 8日
ユーザー・ガイド Signal Switch Data Book 2003年 11月 14日
その他の技術資料 Logic Cross-Reference 2003年 10月 7日
アプリケーション・ノート TI IBIS File Creation, Validation, and Distribution Processes 2002年 8月 29日
アプリケーション・ノート CMOS Power Consumption and CPD Calculation 1997年 6月 1日
アプリケーション・ノート Designing With Logic 1997年 6月 1日
アプリケーション・ノート Input and Output Characteristics of Digital Integrated Circuits 1996年 10月 1日
アプリケーション・ノート Live Insertion 1996年 10月 1日
アプリケーション・ノート SN54/74HCT CMOS Logic Family Applications and Restrictions 1996年 5月 1日
アプリケーション・ノート Using High Speed CMOS and Advanced CMOS in Systems With Multiple Vcc 1996年 4月 1日

設計と開発

追加の事項や他のリソースを参照するには、以下のタイトルをクリックすると、詳細ページを表示できます。

ハードウェア開発

評価基板 ダウンロード
document-generic ユーザー・ガイド
$10.00
概要
This EVM is designed to support any logic device that has a D, DW, DB, NS, PW, P, N, or DGV package in a 14 to 24 pin count.
特長
  • Board design allows for versatility in evaluation
  • Supports a wide-range of logic devices

CAD/CAE シンボル

パッケージ ピン数 ダウンロード
TSSOP (PW) 16 オプションの表示

購入と品質

サポートとトレーニング

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トレーニング・シリーズ

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