Resolution (Bits) 16 DAC channels 1 Interface Parallel LVDS Sample/update rate (MSPS) 1000 Features Ultra High Speed Rating Catalog Interpolation 1x, 2x, 4x Power consumption (Typ) (mW) 800 SFDR (dB) 81 Architecture Current Sink Operating temperature range (C) -40 to 85 Reference: type Int open-in-new その他の 高速 DACs (>10MSPS)


VQFN (RGC) 64 81 mm² 9 x 9 open-in-new その他の 高速 DACs (>10MSPS)


  • 16-Bit Digital-to-Analog Converter (DAC)
  • 1.0 GSPS Update Rate
  • 16-Bit Wideband Input LVDS Data Bus
    • 8 Sample Input FIFO
  • High Performance
    • 73-dBc ACLR WCDMA TM1 at 180 MHz
  • 2x to 32x Clock Multiplying PLL/VCO
  • 2x or 4x Interpolation Filters
    • Stopband Transition 0.4–0.6 Fdata
    • Filters Configurable in Either Low-Pass or
      High-Pass Mode
      • Allows Selection of Higher Order Image
  • On-Chip 1.2-V Reference
  • 2 to 20-mA Differential Scalable Output
  • 64-Pin 9-mm × 9-mm VQFN Package
    • Cellular Base Stations
    • Broadband Wireless Access (BWA)
    • WiMAX 802.16
    • Fixed Wireless Backhaul
    • Cable Modem Termination System (CMTS)

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The DAC5681Z is a 16-bit 1.0 GSPS digital-to-analog converter (DAC) with wideband LVDS data input, integrated 2x to 4x interpolation filters, on-board clock multiplier, and internal voltage reference. The DAC5681Z offers superior linearity, noise, crosstalk, and PLL phase noise performance.

The DAC5681Z integrates a wideband LVDS port with on-chip termination. Full-rate input data can be transferred to a single DAC channel, or half-rate and 1/4-rate input data can be interpolated by on-board 2x or 4x FIR filters. Each interpolation FIR is configurable in either low-pass or high-pass mode, allowing selection of a higher order output spectral image. An on-chip delay lock loop (DLL) simplifies LVDS interfacing by providing skew control for the LVDS input data clock.

The DAC5681Z is characterized for operation over the industrial temperature range of –40°C to 85°C and is available in a 64-pin VQFN package. Other members of the family include the dual-channel, interpolating DAC5682Z and the single-channel, non-interpolating DAC5681.

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種類 タイトル 英語版のダウンロード 日付
* データシート 16-BIT, 1.0 GSPS 2x-4x INTERPOLATING DAC. データシート 2015年 12月 3日
技術記事 Digital signal processing in RF sampling DACs – part 2 2017年 4月 4日
技術記事 Digital signal processing in RF sampling DACs - part 1 2017年 2月 13日
技術記事 Why phase noise matters in RF sampling converters 2016年 11月 28日
技術記事 RF sampling: frequency planning yields a clean spectrum 2015年 11月 18日
アプリケーション・ノート High Speed, Digital-to-Analog Converters Basics 2012年 10月 23日
ユーザー・ガイド TSW1400 Pattern Generators 2012年 5月 3日
その他の技術資料 TI and Altera Ease Design Process with Compatible Evaluation Tools 2011年 4月 25日
その他の技術資料 TI and Xilinx Ease Design Process with Compatible Evaluation Tools 2011年 4月 25日
アプリケーション・ノート 高速データ変換 英語版をダウンロード 2009年 12月 11日
アプリケーション・ノート データ・コンバータのドリフトに関する設計者の必須知識: 最悪劣化度の構成要素を理解して仕様の条件を減らす 英語版をダウンロード 2009年 4月 22日
アプリケーション・ノート Passive Interface for Current Output DACs 2008年 11月 10日
アプリケーション・ノート CDCE72010 as clocking solution for High Speed Analog-to-Digital Converters 2008年 6月 8日
アプリケーション・ノート Phase Noise Performance and Jitter Cleaning Ability of CDCE72010 2008年 6月 2日




評価基板 ダウンロード
document-generic ユーザー・ガイド

The DAC5681ZEVM is a circuit board that allows designers to evaluate the performance of Texas Instruments' single-channel 16-bit 1.0 GSPS digital-to-analog converter (DAC) featuring a fll 1GSPS DDR LVDS interface, integrated 2x/4x interpolation filters, on-board clock multiplier and internal voltage (...)

  • Comprehensive test capability for DAC5681Z
  • Direct connection to TSW3100 signal generator EVM
  • Has a programmable Low Jitter Clock Synthesizer capable of working with a VCXO or an external clock source
  • Clock synchronization with TSW3100 for signal integrity
  • Software support with a fully featured GUI for (...)
評価基板 ダウンロード
Abaco Systems® FMC204 FPGA mezzanine card
Abaco Systems からの提供
FMC204 は、クワッド・チャネル A/D およびデュアル・チャネル D/A FMC ドーター・カードです。このカードは、TI の DAC5681Z デュアル・チャネル 16 ビット 1Gsps デバイスをベースにしています。FMC204 ドーター・カードは、FMC (ANSI/VITA 57.1) 規格に機械的および電気的に準拠しています。FMC204 は、高ピン数コネクタとフロント・パネル I/O を備えており、伝導冷却環境で使用できます。
評価モジュール(EVM)用 GUI ダウンロード
SLAC497A.ZIP (59041 KB)
評価モジュール(EVM)用 GUI ダウンロード
Abaco Systems® FMC110 FPGA mezzanine card
Abaco Systems からの提供
FMC110 は、デュアル・チャネル A/D およびデュアル・チャネル D/A FMC ドーター・カードです。このカードは、TI の ADS5400 デュアル・チャネル 12 ビット 1Gsps ADC および TI の DAC5681Z デュアル・チャネル 16 ビット 1Gsps デバイスをベースにしています。FMC150 ドーター・カードは、FMC (ANSI/VITA 57.1) 規格に機械的および電気的に準拠しています。FMC150 は、高ピン数コネクタとフロント・パネル I/O を備えており、伝導冷却環境で使用できます。
インターフェイス・アダプタ ダウンロード
The FMC-DAC-Adapter passive interconnect board enables the output of TI’s LVDS input high speed DACs to be directly connected to a standard FMC interconnect header, a typical input on the latest Xilinx FPGA EVMs. This enables users of TI’s high speed DAC EVMs to directly interface to Xilinx (...)
  • Enables direct connection to TI high speed DAC EVM LVDS inputs from the FMC standard header


サポート・ソフトウェア ダウンロード
DATACONVERTERPRO-SW This high-speed data converter pro GUI is a PC (Windows® XP/7 compatible) program designed to aid in evaluation of most TI high-speed data converter and analog front-end (AFE) platforms. Designed to support the entire TSW14xxx series of data-capture and pattern-generation cards (...)
  • Compatible with TSW1400, TSW1405, TSW1406 and TSW14J10, TSW14J50, TSW14J56, and TSW14J57 pattern-generation and data-capture platforms
  • Works with all TI high-speed DAC, ADC, and AFE products
  • Provides time-domain and frequency-domain analysis
  • Supports single-tone, multi-tone, and modulated (...)


シミュレーション・モデル ダウンロード
SLLC320A.ZIP (7 KB) - IBIS Model
シミュレーション・ツール ダウンロード
PSpice® for TI design and simulation tool
PSPICE-FOR-TI — PSpice® for TI は、各種アナログ回路の機能評価に役立つ、設計とシミュレーション向けの環境です。設計とシミュレーションに適したこのフル機能スイートは、Cadence® のアナログ分析エンジンを使用しています。PSpice for TI は無償で使用でき、アナログや電源に関する TI の製品ラインアップを対象とする、業界でも有数の大規模なモデル・ライブラリが付属しているほか、選択された一部のアナログ動作モデルも利用できます。

設計とシミュレーション向けの環境である PSpice for TI を使用すると、内蔵のライブラリを活用して、複雑なミックスド・シグナル設計のシミュレーションを実施することができます。完成度の高い最終機器を設計し、レイアウトの確定や製造開始より前に、ソリューションのプロトタイプを製作することができます。この結果、市場投入期間の短縮と開発コストの削減を実現できます。 

設計とシミュレーション向けのツールである PSpice for TI の環境内で、各種 TI デバイスの検索、製品ラインアップの参照、テスト・ベンチの起動、設計のシミュレーションを実施し、選定したデバイスをさらに分析することができます。また、複数の TI デバイスを組み合わせてシミュレーションを実行することもできます。

事前ロード済みの複数のモデルで構成されたライブラリ全体に加えて、PSpice for TI ツール内で各種 TI デバイスの最新の技術関連資料に簡単にアクセスすることもできます。開発中のアプリケーションに適したデバイスを選定できたことを確認した後、TI 製品の購入ページにアクセスして、その製品を購入することができます。 

PSpice for TI を使用すると、回路の検討から設計の開発や検証まで、作業の進展に合わせて設計サイクルの各段階で、シミュレーションのニーズに適した各種ツールにアクセスできます。コスト不要で入手でき、開発を容易に開始できます。設計とシミュレーションに適した PSpice スイートをダウンロードして、今すぐ設計を開始してください。


  1. PSpice for TI シミュレータへのアクセスの申請
  2. ダウンロードとインストール
  3. シミュレーション方法説明ビデオのご視聴
  • Cadence の PSpice テクノロジーを活用
  • デジタル・モデル・スイートが付属する事前インストール済みのライブラリを活用して、ワーストケース・タイミング分析を実現可能
  • 動的更新により、最新のデバイス・モデルに確実にアクセス可能
  • 精度の低下を招かずに、シミュレーション速度を重視して最適化済み
  • 複数製品の同時分析をサポート
  • OrCAD Capture フレームワークを土台とし、業界で最も幅広く使用されている回路図のキャプチャとシミュレーションの環境へのアクセスを実現
  • オフライン作業が可能
  • 以下の点を含め、多様な動作条件とデバイス公差にまたがって設計を検証
    • 自動的な測定と後処理
    • モンテカルロ分析法
    • ワーストケース分析
    • 熱解析
計算ツール ダウンロード
SLAC169.ZIP (33 KB)

CAD/CAE シンボル

パッケージ ピン数 ダウンロード
VQFN (RGC) 64 オプションの表示


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