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製品の詳細

パラメータ

Function Cascaded PLLs Number of outputs 14 Number of Inputs 2 RMS jitter 0.111 Output frequency (Min) (MHz) 0.22 Output frequency (Max) (MHz) 2370 Input type LVCMOS, LVDS, LVPECL Output type LVCMOS, LVDS, LVPECL Supply voltage (Min) (V) 3.15 Supply voltage (Max) (V) 3.45 Features 0 Delay Operating temperature range (C) -40 to 85 open-in-new その他の クロック・ジッタ・クリーナとシンクロナイザ

パッケージ|ピン|サイズ

WQFN (NKD) 64 81 mm² 9 x 9 open-in-new その他の クロック・ジッタ・クリーナとシンクロナイザ

特長

  • Ultra-Low RMS Jitter Performance
    • 111 fs RMS Jitter (12 kHz to 20 MHz)
    • 123 fs RMS Jitter (100 Hz to 20 MHz)
  • Dual Loop PLLatinum™ PLL Architecture
  • PLL1
    • Integrated Low-Noise Crystal Oscillator
      Circuit
    • Holdover Mode when Input Clocks are Lost
    • Automatic or Manual Triggering/Recovery
  • PLL2
    • Normalized PLL Noise Floor of –227 dBc/Hz
    • Phase Detector Rate up to 155 MHz
    • OSCin Frequency-Doubler
    • Integrated Low-Noise VCO
  • 2 Redundant Input Clocks with LOS
    • Automatic and Manual Switch-Over Modes
  • 50 % Duty Cycle Output Divides, 1 to 1045 (Even
    and Odd)
  • 12 LVPECL, LVDS, or LVCMOS Programmable
    Outputs
  • Digital Delay: Fixed or Dynamically Adjustable
  • 25 ps Step Analog Delay Control.
  • 14 Differential Outputs. Up to 26 Single Ended.
    • Up to 6 VCXO/Crystal Buffered Outputs
  • Clock Rates of up to 1536 MHz
  • 0-Delay Mode
  • Three Default Clock Outputs at Power Up
  • Multi-Mode: Dual PLL, Single PLL, and Clock
    Distribution
  • Industrial Temperature Range: –40 to 85°C
  • 3.15-V to 3.45-V Operation
  • 2 Dedicated Buffered/Divided OSCin Clocks
  • Package: 64-Pin WQFN (9.0 × 9.0 × 0.8 mm)
open-in-new その他の クロック・ジッタ・クリーナとシンクロナイザ

概要

The LMK0480x family is the industry’s highest performance clock conditioner with superior clock jitter cleaning, generation, and distribution with advanced features to meet next generation system requirements. The dual loop PLLatinum architecture is capable of 111 fs rms jitter (12 kHz to 20 MHz) using a low noise VCXO module or sub-200 fs rms jitter (12 kHz to 20 MHz) using a low cost external crystal and varactor diode.

The dual loop architecture consists of two high-performance phase-locked loops (PLL), a low-noise crystal oscillator circuit, and a high-performance voltage controlled oscillator (VCO). The first PLL (PLL1) provides low-noise jitter cleaner functionality while the second PLL (PLL2) performs the clock generation. PLL1 can be configured to either work with an external VCXO module or the integrated crystal oscillator with an external tunable crystal and varactor diode. When paired with a very narrow loop bandwidth, PLL1 uses the superior close-in phase noise (offsets below 50 kHz) of the VCXO module or the tunable crystal to clean the input clock. The output of PLL1 is used as the clean input reference to PLL2 where it locks the integrated VCO. The loop bandwidth of PLL2 can be optimized to clean the far-out phase noise (offsets above 50 kHz) where the integrated VCO outperforms the VCXO module or tunable crystal used in PLL1.

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技術資料

= 主要な資料
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種類 タイトル 英語版のダウンロード 日付
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ユーザー・ガイド TSW1265EVM Evaluation Module 2013年 9月 3日
アプリケーション・ノート Using the LMK0480x/LMK04906 for Hitless Switching and Holdover 2013年 7月 12日
ユーザー・ガイド TSW3085 ACPR and EVM Measurements 2011年 12月 29日
ユーザー・ガイド Clock Conditioner Owner's Manual 2006年 11月 10日

設計と開発

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ハードウェア開発

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概要

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  • Direct connection to TSW1400/TSW1406/TSW3100 TSW1406 signal generator
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    The TSW30SH84EVM Evaluation Module is a circuit board that allows system designers to evaluate the combined performance of Texas Instruments' transmit signal chain with the LMK04800 low noise clock generator/jitter cleaner. For ease of use as a complete RF transmit solution the TSW30SH84EVM includes (...)

    特長
  • Includes LMK04800 for clock generation and jitter cleaning
  • Direct connection to TSW1400/TSW1406/TSW3100 pattern generator
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  • 評価モジュール(EVM)用 GUI ダウンロード
    SLAC507B.ZIP (123888 KB)
    評価モジュール(EVM)用 GUI ダウンロード
    SLAC532.ZIP (126690 KB)

    設計ツールとシミュレーション

    シミュレーション・モデル ダウンロード
    SNAM098C.ZIP (111 KB) - IBIS Model

    CAD/CAE シンボル

    パッケージ ピン数 ダウンロード
    WQFN (NKD) 64 オプションの表示

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