データシート
LMK04832
- 最大クロック出力周波数: 3255MHz
- マルチモード: デュアルPLL、シングルPLL、クロック分配
- 超低ノイズ(2500MHz時):
- 54fs RMSジッタ(12kHz～20MHz)
- 64fs RMSジッタ(100Hz～20MHz)
- -157.6dBc/Hzのノイズ・フロア
- 超低ノイズ(3200MHz時):
- 61fs RMSジッタ(12kHz～20MHz)
- 67fs RMSジッタ(100Hz～100MHz)
- －156.5dBc/Hzのノイズ・フロア
- PLL2
- PLL FOM: －230dBc/Hz
- PLL 1/f: －128dBc/Hz
- 位相検出速度: 最高320MHz
- 2つの内蔵VCO: 2440～2580MHz
および2945～3255MHz
- 最大14個の差動デバイス・クロック
- CML、LVPECL、LCPECL、HSDS、LVDS、2xLVCMOSプログラマブル出力
- 最大1個のバッファ付きVCXO/XO出力
- LVPECL、LVDS、2xLVCMOSプログラマブル
- 1-1023のCLKout分周器
- 1-8191のSYSREF分周器
- SYSREFクロックの25psステップ・アナログ遅延
- デバイス・クロックおよびSYSREFのデジタル遅延および動的デジタル遅延
- PLL1によるホールドオーバー・モード
- PLL1またはPLL2による0遅延
- 105℃のPCB温度に対応(サーマル・パッドで測定)
LMK04832は、超高性能でJEDEC JESD204Bに準拠したクロック・コンディショナーで、LMK0482xファミリの製品とピン互換性があります。
PLL2からの14のクロック出力を構成して、7つのJESD204Bコンバータ、あるいはデバイス・クロックおよびSYSREFクロックを使用するその他のロジック・デバイスを駆動できます。DCおよびAC結合によりSYSREFを生成することが可能です。JESD204Bアプリケーションに限らず、従来のクロッキング・システム向けに14の出力をそれぞれ高性能出力として個別に構成できます。
LMK04832は、SYSREFの生成またはリクロッキングの有無にかかわらず、デュアルPLL、シングルPLL、またはクロック分配モードで動作するように構成できます。PLL2は内蔵VCOでも外付けVCOでも動作します。
高性能である上に、電力と性能のトレードオフ、デュアルVCO、動的デジタル遅延、ホールドオーバーといった機能を備えたLMK04832は、柔軟性の高い高性能クロック・ツリー・ソリューションとして最適です。
おすすめの類似製品
比較対象デバイスと同等の機能で、ピン互換製品。
技術資料
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10 資料すべて表示 | 種類 | タイトル | 英語版のダウンロード | 日付 | |
|---|---|---|---|---|
| * | データシート | LMK04832 超低ノイズ、JESD204B準拠クロック・ジッタ・クリーナ、デュアル・ループPLL内蔵 データシート (Rev. C 翻訳版) | 英語版をダウンロード (Rev.C) | 2018年 10月 5日 |
| 技術記事 | Clock tree fundamentals: finding the right clocking devices for your design | 2021年 3月 24日 | ||
| アプリケーション・ノート | Clocking for Medical Ultrasound Systems (Rev. A) | 2020年 9月 30日 | ||
| 証明書 | LMK04832EVM-CVAL EU Declaration of Conformity (DoC) | 2020年 5月 29日 | ||
| アプリケーション・ノート | Synchronization of Multiple LMK0482x Devices | 2019年 12月 30日 | ||
| 技術記事 | Step-by-step considerations for designing wide-bandwidth multichannel systems | 2019年 6月 4日 | ||
| ユーザー・ガイド | LMK04832 User's Guide (Rev. A) | 2017年 12月 21日 | ||
| Analog design journal | Analog Applications Journal 2Q 2015 | 2015年 4月 28日 | ||
| Analog design journal | JESD204B multi-device synchronization: Breaking down the requirements | 2015年 4月 28日 | ||
| Analog design journal | When is the JESD204B interface the right choice? | 2014年 1月 22日 |
設計と開発
追加の事項や他のリソースを参照するには、以下のタイトルをクリックすると、詳細ページを表示できます。
評価ボード
ADC12DJ3200EVMCVAL — ADC12DJ3200QML-SP 宇宙向け、12 ビット、デュアル 3.2GSPS / シングル 6.4GSPS、RF サンプリング ADC の評価基板
The ADC12DJ3200EVMCVAL is an evaluation module (EVM) that evaluates the ADC12DJ3200QML-SP device. ADC12DJ3200QML-SP is a space-grade, low-power, 12-bit, dual 3.2-GSPS/single 6.4-GSPS, RF-sampling analog-to-digital converter (ADC) with a buffered analog input, integrated digital down converter (...)
在庫あり
制限: 5
評価ボード
LMK04832EVM — LMK04832 JESD204B クロック・ジッタ・クリーナ/クロック・ジェネレータ/ディストリビューションの評価モジュール
The LMK04832EVM allows evaluation of the LMK04832 with test equipment or other evaluation boards to verify block or system requirements for use in a specific application. The LMK04832 EVM is pre-populated with a 122.88 MHz VCXO for dual loop operation. The VCXO can be substituted if a (...)
在庫あり
制限: 2
アプリケーション・ソフトウェアとフレームワーク
PLLATINUMSIM-SW — テキサス・インスツルメンツ PLLatinum シミュレータ・ツール
The PLLatinum Simulator Tool allows detailed design and simulation of the Texas Instruments LMX series of PLLs and Synthesizers.
アプリケーション・ソフトウェアとフレームワーク
TICSPRO-SW — テキサス・インスツルメンツのクロックおよびシンセサイザ（TICS）プロ・ソフトウェア
The TICS Pro software is used to program the evaluation modules (EVMs) for device numbers with these prefixes: CDC, LMK and LMX. These devices include PLLs and voltage-controlled oscillators (PLL+VCO), synthesizers and clocking devices.
シミュレーション・ツール
PSPICE-FOR-TI — PSpice® for TI design and simulation tool
PSpice® for TI は、各種アナログ回路の機能評価に役立つ、設計とシミュレーション向けの環境です。設計とシミュレーションに適したこのフル機能スイートは、Cadence® のアナログ分析エンジンを使用しています。PSpice for TI は無償で使用でき、アナログや電源に関する TI の製品ラインアップを対象とする、業界でも有数の大規模なモデル・ライブラリが付属しているほか、選択された一部のアナログ動作モデルも利用できます。
設計とシミュレーション向けの環境である PSpice for TI を使用すると、内蔵のライブラリを活用して、複雑なミックスド・シグナル設計のシミュレーションを実施することができます。完成度の高い最終機器を設計し、レイアウトの確定や製造開始より前に、ソリューションのプロトタイプを製作することができます。この結果、市場投入期間の短縮と開発コストの削減を実現できます。
設計とシミュレーション向けのツールである PSpice for TI の環境内で、各種 TI デバイスの検索、製品ラインアップの参照、テスト・ベンチの起動、設計のシミュレーションを実施し、選定したデバイスをさらに分析することができます。また、複数の TI デバイスを組み合わせてシミュレーションを実行することもできます。
事前ロード済みの複数のモデルで構成されたライブラリ全体に加えて、PSpice for TI ツール内で各種 TI デバイスの最新の技術関連資料に簡単にアクセスすることもできます。開発中のアプリケーションに適したデバイスを選定できたことを確認した後、TI 製品の購入ページにアクセスして、その製品を購入することができます。
PSpice for TI を使用すると、回路の検討から設計の開発や検証まで、作業の進展に合わせて設計サイクルの各段階で、シミュレーションのニーズに適した各種ツールにアクセスできます。コスト不要で入手でき、開発を容易に開始できます。設計とシミュレーションに適した PSpice スイートをダウンロードして、今すぐ設計を開始してください。
設計とシミュレーション向けの環境である PSpice for TI を使用すると、内蔵のライブラリを活用して、複雑なミックスド・シグナル設計のシミュレーションを実施することができます。完成度の高い最終機器を設計し、レイアウトの確定や製造開始より前に、ソリューションのプロトタイプを製作することができます。この結果、市場投入期間の短縮と開発コストの削減を実現できます。
設計とシミュレーション向けのツールである PSpice for TI の環境内で、各種 TI デバイスの検索、製品ラインアップの参照、テスト・ベンチの起動、設計のシミュレーションを実施し、選定したデバイスをさらに分析することができます。また、複数の TI デバイスを組み合わせてシミュレーションを実行することもできます。
事前ロード済みの複数のモデルで構成されたライブラリ全体に加えて、PSpice for TI ツール内で各種 TI デバイスの最新の技術関連資料に簡単にアクセスすることもできます。開発中のアプリケーションに適したデバイスを選定できたことを確認した後、TI 製品の購入ページにアクセスして、その製品を購入することができます。
PSpice for TI を使用すると、回路の検討から設計の開発や検証まで、作業の進展に合わせて設計サイクルの各段階で、シミュレーションのニーズに適した各種ツールにアクセスできます。コスト不要で入手でき、開発を容易に開始できます。設計とシミュレーションに適した PSpice スイートをダウンロードして、今すぐ設計を開始してください。
開発の開始
- PSpice for TI シミュレータへのアクセスの申請
- ダウンロードとインストール
- シミュレーション方法説明ビデオのご視聴
設計ツール
CLOCK-TREE-ARCHITECT — Clock tree architect プログラミング・ソフトウェア
Clock tree architect はクロック・ツリーの合成ツールであり、開発中システムの要件に基づいてクロック・ツリー・ソリューションを生成する方法で、お客様の設計プロセスの効率化に貢献します。このツールは、多様なクロック供給製品を収録した包括的なデータベースからデータを抽出し、システム・レベルのマルチチップ・クロック供給ソリューションを生成します。
リファレンス・デザイン
TIDA-010132 — レーダーと電子戦の各アプリケーション向け、マルチチャネル RF トランシーバのリファレンス・デザイン
This reference design, an 8-channel analog front end (AFE), is demonstrated using two AFE7444 4-channel RF transceivers and a LMK04828-LMX2594 based clocking subsystem which can enable designs to scale to 16 or more channels. Each AFE channel consists of a 14-bit, 9-GSPS DAC and a 3-GSPS ADC that is (...)
リファレンス・デザイン
TIDA-01027 — 12.8GSPS データ・アクイジション・システムで性能を最大化する低ノイズ電源のリファレンス・デザイン
This reference design demonstrates an efficient, low noise 5-rail power-supply design for very high-speed DAQ systems capable of > 12.8 GSPS. The power supply DC/DC converters are frequency synchronized and phase-shifted in order to minimize input current ripple and control frequency content (...)
| パッケージ | ピン数 | ダウンロード |
|---|---|---|
| WQFN (NKD) | 64 | オプションの表示 |
購入と品質
含まれる情報：
- RoHS
- REACH
- デバイスのマーキング
- リード端子の仕上げ / ボールの原材料
- MSL rating/ リフローピーク温度
- MTBF/FIT の推定値
- 原材料組成
- 認定試験結果
- 継続的な信頼性モニタ試験結果
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