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DDR 終端レギュレータ

製品詳細

Vin (min) (V) 2.2 Vin (max) (V) 5.5 Vout (min) (V) 1.21 Vout (max) (V) 1.26 Features No external resistors Iq (typ) (mA) 0.25 Rating Catalog Operating temperature range (°C) 0 to 125 Product type DDR DDR memory type DDR
Vin (min) (V) 2.2 Vin (max) (V) 5.5 Vout (min) (V) 1.21 Vout (max) (V) 1.26 Features No external resistors Iq (typ) (mA) 0.25 Rating Catalog Operating temperature range (°C) 0 to 125 Product type DDR DDR memory type DDR
HSOIC (DDA) 8 29.4 mm² 4.9 x 6 SOIC (D) 8 29.4 mm² 4.9 x 6 WQFN (NHP) 16 16 mm² 4 x 4

  • Low output voltage offset
  • Works with +5v, +3.3v and 2.5v rails
  • Source and sink current
  • Low external component count
  • No external resistors required
  • Linear topology
  • Available in SO-8, PSOP-8 or LLP-16 packages
  • Low cost and easy to use

  • Low output voltage offset
  • Works with +5v, +3.3v and 2.5v rails
  • Source and sink current
  • Low external component count
  • No external resistors required
  • Linear topology
  • Available in SO-8, PSOP-8 or LLP-16 packages
  • Low cost and easy to use

  • The LP2995 linear regulator is designed to meet the JEDEC SSTL-2 and SSTL-3 specifications for termination of DDR-SDRAM. The device contains a high-speed operational amplifier to provide excellent response to load transients. The output stage prevents shoot through while delivering 1.5A continuous current and transient peaks up to 3A in the application as required for DDR-SDRAM termination. The LP2995 also incorporates a VSENSE pin to provide superior load regulation and a VREF output as a reference for the chipset and DDR DIMMS.

    Patents Pending


    The LP2995 linear regulator is designed to meet the JEDEC SSTL-2 and SSTL-3 specifications for termination of DDR-SDRAM. The device contains a high-speed operational amplifier to provide excellent response to load transients. The output stage prevents shoot through while delivering 1.5A continuous current and transient peaks up to 3A in the application as required for DDR-SDRAM termination. The LP2995 also incorporates a VSENSE pin to provide superior load regulation and a VREF output as a reference for the chipset and DDR DIMMS.

    Patents Pending


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    技術資料

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    種類 タイトル 最新の英語版をダウンロード 日付
    * データシート LP2995 DDR Termination Regulator (jp) データシート (Rev. K 翻訳版) 最新英語版 (Rev.M) PDF | HTML 2011年 3月 28日
    アプリケーション・ノート Limiting DDR Termination Regulators’ Inrush Current 2016年 8月 23日
    EVM ユーザー ガイド (英語) AN-1241 LP2995 Evaluation Board (Rev. B) 2013年 5月 7日
    アプリケーション・ノート AN-1254 DDR-SDRAM Termination Simplified Using a Linear Regulator (Rev. A) 2013年 5月 6日
    アプリケーション・ノート DDR-SDRAM Termination Simplified Using A Linear Regulator 2002年 7月 23日

    設計と開発

    その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページをご覧ください。

    シミュレーション・モデル

    LP2995 PSpice Transient Model

    SNVMAH6.ZIP (71 KB) - PSpice Model
    シミュレーション・モデル

    LP2995 Unencrypted PSpice Transient Model

    SNVMAH5.ZIP (4 KB) - PSpice Model
    リファレンス・デザイン

    TIDA-010011 — 保護リレー・プロセッサ・モジュール向け高効率電源アーキテクチャのリファレンス・デザイン

    This reference design showcases various power architectures for generating multiple voltage rails for an application processor module, requiring >1A load current and high efficiency . The required power supply is generated using 5-, 12- or 24-V DC input from the backplane. Power supplies are (...)
    回路図: PDF
    パッケージ ピン数 ダウンロード
    HSOIC (DDA) 8 オプションの表示
    SOIC (D) 8 オプションの表示
    WQFN (NHP) 16 オプションの表示

    購入と品質

    記載されている情報:
    • RoHS
    • REACH
    • デバイスのマーキング
    • リード端子の仕上げ / ボールの原材料
    • MSL 定格 / ピーク リフロー
    • MTBF/FIT 推定値
    • 材質成分
    • 認定試験結果
    • 継続的な信頼性モニタ試験結果
    記載されている情報:
    • ファブの拠点
    • 組み立てを実施した拠点

    推奨製品には、この TI 製品に関連するパラメータ、評価基板、またはリファレンス デザインが存在する可能性があります。

    サポートとトレーニング

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