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製品の詳細

パラメータ

Technology Family AUC VCC (Min) (V) 0.8 VCC (Max) (V) 2.7 Channels (#) 1 IOL (Max) (mA) 9 IOH (Max) (mA) -9 ICC (Max) (uA) 10 Input type Standard CMOS Output type 3-State Features Balanced outputs, Ultra high speed (tpd <5ns), Partial power down (Ioff), Over-voltage tolerant inputs Data rate (Mbps) 500 Rating Catalog open-in-new その他の 反転バッファ/ドライバ

パッケージ|ピン|サイズ

DSBGA (YZP) 5 2 mm² .928 x 1.428 SOT-23 (DBV) 5 5 mm² 2.9 x 1.6 SOT-SC70 (DCK) 5 4 mm² 2 x 2.1 open-in-new その他の 反転バッファ/ドライバ

特長

  • Available in the Texas Instruments NanoFree™ Package
  • Optimized for 1.8-V Operation and Is 3.6-V I/O Tolerant to Support Mixed-Mode Signal Operation
  • Ioff Supports Partial-Power-Down Mode Operation
  • Sub-1-V Operable
  • Max tpd of 2.5 ns at 1.8 V
  • Low Power Consumption, 10-µA Max ICC
  • ±8-mA Output Drive at 1.8 V
  • Latch-Up Performance Exceeds 100 mA Per JESD 78, Class II
  • ESD Protection Exceeds JESD 22
    • 2000-V Human-Body Model (A114-A)
    • 200-V Machine Model (A115-A)
    • 1000-V Charged-Device Model (C101)

NanoFree is a trademark of Texas Instruments

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概要

This bus buffer gate is operational at 0.8-V to 2.7-V VCC, but is designed specifically for 1.65-V to 1.95-V VCC operation.

The SN74AUC1G240 is a single line driver with a 3-state output. The output is disabled when the output-enable (OE) input is high.

To ensure the high-impedance state during power up or power down, OE should be tied to VCC through a pullup resistor; the minimum value of the resistor is determined by the current-sinking capability of the driver.

NanoFree™ package technology is a major breakthrough in IC packaging concepts, using the die as the package.

This device is fully specified for partial-power-down applications using Ioff. The Ioff circuitry disables the outputs, preventing damaging current backflow through the device when it is powered down.

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ダウンロード

技術資料

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種類 タイトル 英語版のダウンロード 日付
* データシート Single Buffer/Driver With 3-State Output データシート 2007年 2月 5日
セレクション・ガイド Little Logic Guide 2014 2018年 7月 6日
アプリケーション・ノート How to Select Little Logic 2016年 7月 26日
アプリケーション・ノート Understanding and Interpreting Standard-Logic Data Sheets 2015年 12月 2日
セレクション・ガイド ロジック・ガイド (Rev. AA 翻訳版) 最新の英語版をダウンロード (Rev.AB) 2014年 11月 6日
ソリューション・ガイド LOGIC Pocket Data Book 2007年 1月 16日
その他の技術資料 Design Summary for WCSP Little Logic 2004年 11月 4日
アプリケーション・ノート Semiconductor Packing Material Electrostatic Discharge (ESD) Protection 2004年 7月 8日
アプリケーション・ノート Selecting the Right Level Translation Solution 2004年 6月 22日
ユーザー・ガイド Signal Switch Data Book 2003年 11月 14日
その他の技術資料 Logic Cross-Reference 2003年 10月 7日
アプリケーション・ノート Designing With TI Ultra-Low-Voltage CMOS (AUC) Octals and Widebus Devices 2003年 3月 21日
ユーザー・ガイド AUC Data Book, January 2003 2003年 1月 1日
アプリケーション・ノート Texas Instruments Little Logic Application Report 2002年 11月 1日
アプリケーション・ノート Application of the Texas Instruments AUC Sub-1-V Little Logic Devices 2002年 9月 19日
アプリケーション・ノート TI IBIS File Creation, Validation, and Distribution Processes 2002年 8月 29日
その他の技術資料 Standard Linear & Logic for PCs, Servers & Motherboards 2002年 6月 13日
その他の技術資料 STANDARD LINEAR AND LOGIC FOR DVD/VCD PLAYERS 2002年 3月 27日
その他の技術資料 AUC Product Brochure 2002年 3月 18日

設計と開発

追加の事項や他のリソースを参照するには、以下のタイトルをクリックすると、詳細ページを表示できます。

ハードウェア開発

評価基板 ダウンロード
document-generic ユーザー・ガイド
$10.00
概要
Flexible EVM designed to support any device that has a DCK, DCT, DCU, DRL, or DBV package in a 5 to 8 pin count.
特長
  • Board design allows for versatility in evaluation
  • Supports a wide-range of logic devices

設計ツールとシミュレーション

シミュレーション・モデル ダウンロード
SCEJ138.ZIP (42 KB) - HSpice Model
シミュレーション・モデル ダウンロード
SCEM721.ZIP (7 KB) - PSpice Model

CAD/CAE シンボル

パッケージ ピン数 ダウンロード
DSBGA (YZP) 5 オプションの表示
SC70 (DCK) 5 オプションの表示
SOT-23 (DBV) 5 オプションの表示

購入と品質

サポートとトレーニング

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トレーニング・シリーズ

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