SN74AUP1T17

アクティブ

低消費電力、1.8/2.5/3.3V 入力、3.3V CMOS 出力、シングル・シュミット・トリガ・バッファ・ゲート

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製品の詳細

パラメータ

Technology Family AUP1T Bits (#) 1 IOH (Max) (mA) -4 IOL (Max) (mA) 4 Rating Catalog open-in-new その他の 単方向電圧レベルシフタ

パッケージ|ピン|サイズ

SOT-SC70 (DCK) 5 4 mm² 2 x 2.1 open-in-new その他の 単方向電圧レベルシフタ

特長

  • Single-Supply Voltage Translator
  • Output Level Up to Supply VCC CMOS Level
    • 1.8 V to 3.3 V (at VCC = 3.3 V)
    • 2.5 V to 3.3 V (at VCC = 3.3 V)
    • 1.8 V to 2.5 V (at VCC = 2.5 V)
    • 3.3 V to 2.5 V (at VCC = 2.5 V
  • Schmitt-Trigger Inputs Reject Input Noise and
    Provide Better Output Signal Integrity
  • Ioff Supports Partial Power Down (VCC = 0 V)
  • Very Low Static Power Consumption:
    0.1 µA
  • Very Low Dynamic Power Consumption:
    0.9 µA
  • Latch-Up Performance Exceeds 100 mA Per
    JESD 78, Class II
  • Pb-Free Packages Available: SC-70 (DCK)

    2 × 2.1 × 0.65 mm (Height 1.1 mm)
  • More Gate Options Available at
    www.ti.com/littlelogic
  • ESD Performance Tested Per JESD 22
    • 2000-V Human Body Model
      (A114-B, Class II)
    • 1000-V Charged-Device Model (C101)
  • APPLICATIONS
    • AV Receivers
    • Audio Dock: Portable
    • Blu-ray Players and Home Theaters
    • MP3 Players and Recorders
    • Personal Digital Assistant (PDA)
    • Power: Telecom/Server AC/DC Supply: Single
      Controller: Analog and Digital
    • Solid State Drive (SSD): Client and Enterprise
    • TV: LCD/Digital and High-Definition (HDTV)
    • Tablet: Enterprise
    • Video Analytics: Servers
    • Wireless Headsets, Keyboards, and Mice

All other trademarks are the property of their respective owners

open-in-new その他の 単方向電圧レベルシフタ

概要

The SN74AUP1T17 performs the Boolean function Y = A with designation for logic-level translation applications with output referenced to supply VCC.

AUP technology is the industry–s lowest-power logic technology designed for use in extending battery-life in operating. All input levels that accept 1.8-V LVCMOS signals, while operating from either a single 3.3-V or 2.5-V VCC supply. This product also maintains excellent signal integrity.

The wide VCC range of 2.3 V to 3.6 V allows the possibility of switching output level to connect to external controllers or processors.

Schmitt-trigger inputs (ΔVT = 210 mV between positive and negative input transitions) offer improved noise immunity during switching transitions, which is especially useful on analog mixed-mode designs. Schmitt-trigger inputs reject input noise, ensure integrity of output signals, and allow for slow input signal transition.

Ioff is a feature that allows for powered-down conditions (VCC = 0 V) and is important in portable and mobile applications. When VCC = 0 V, signals in the range from 0 V to 3.6 V can be applied to the inputs and outputs of the device. No damage occurs to the device under these conditions.

The SN74AUP1T17 is designed with optimized current-drive capability of 4 mA to reduce line reflections, overshoot, and undershoot caused by high-drive outputs.

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ダウンロード

技術資料

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種類 タイトル 英語版のダウンロード 日付
* データシート SN74AUP1T17 Low Power, 1.8/2.5/3.3-V Input, 3.3-V CMOS Output, Single Schmitt-Trigger Buffer Gate データシート 2015年 6月 30日
ソリューション・ガイド Voltage translation buying guide 2019年 6月 13日
セレクション・ガイド ロジック・ガイド (Rev. AA 翻訳版) 最新の英語版をダウンロード (Rev.AB) 2014年 11月 6日
アプリケーション・ノート Understanding Schmitt Triggers 2011年 9月 21日

設計と開発

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ハードウェア開発

評価基板 ダウンロード
document-generic ユーザー・ガイド
$10.00
概要
Flexible EVM designed to support any device that has a DCK, DCT, DCU, DRL, or DBV package in a 5 to 8 pin count.
特長
  • Board design allows for versatility in evaluation
  • Supports a wide-range of logic devices

リファレンス・デザイン

リファレンス・デザイン ダウンロード
Thunderbolt™ シングル・ポート周辺機器のリファレンス・デザイン
TIDA-00268 TI 製の Thunderbolt™ シングル・ポート・ペリフェラルのリファレンス・デザインであり、20Gbps の帯域幅を達成する Thunderbolt 2 システム用に最適化されています。このデザインでは TPS65980 (...)
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パッケージ ピン数 ダウンロード
SC70 (DCK) 5 オプションの表示

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ビデオ

Solving Voltage Translation Solutions With One Power Rail

This video discusses applications needing voltage translation solutions with one power rail, providing examples of how to solve challenges within the design.

投稿日: 10-Jan-2015
時間: 04:23

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