製品詳細

Configuration 1:1 SPST Number of channels 4 Power supply voltage - single (V) 2.5, 3.3 Protocols Analog, I2C, I2S, JTAG, RGMII, SPI, TDM, UART Ron (typ) (Ω) 5 CON (typ) (pF) 2.5 ON-state leakage current (max) (µA) 1 Bandwidth (MHz) 200 Operating temperature range (°C) -40 to 85 Features Powered-off protection Input/output continuous current (max) (mA) 128 Rating Catalog Drain supply voltage (max) (V) 3.6 Supply voltage (max) (V) 3.6
Configuration 1:1 SPST Number of channels 4 Power supply voltage - single (V) 2.5, 3.3 Protocols Analog, I2C, I2S, JTAG, RGMII, SPI, TDM, UART Ron (typ) (Ω) 5 CON (typ) (pF) 2.5 ON-state leakage current (max) (µA) 1 Bandwidth (MHz) 200 Operating temperature range (°C) -40 to 85 Features Powered-off protection Input/output continuous current (max) (mA) 128 Rating Catalog Drain supply voltage (max) (V) 3.6 Supply voltage (max) (V) 3.6
SOIC (D) 14 51.9 mm² 8.65 x 6 SSOP (DBQ) 16 29.4 mm² 4.9 x 6 TSSOP (PW) 14 32 mm² 5 x 6.4 TVSOP (DGV) 14 23.04 mm² 3.6 x 6.4 VQFN (RGY) 14 12.25 mm² 3.5 x 3.5
  • 標準の 126 タイプのピン配置
  • 2 つのポート間を 5Ω スイッチで接続
  • データ I/O ポートのレール・ツー・レール・スイッチング
  • Ioff により部分的パワーダウン・モードでの動作をサポート
  • JESD 78、Class II 準拠で 100mA 超のラッチアップ性能
  • 標準の 126 タイプのピン配置
  • 2 つのポート間を 5Ω スイッチで接続
  • データ I/O ポートのレール・ツー・レール・スイッチング
  • Ioff により部分的パワーダウン・モードでの動作をサポート
  • JESD 78、Class II 準拠で 100mA 超のラッチアップ性能

SN74CBTLV3126 クワッド FET バス・スイッチには、独立のライン・スイッチが搭載されています。各スイッチは、対応する出力イネーブル (OE) 入力が LOW のときディセーブルになります。

このデバイスは、Ioff を使用する部分的パワーダウン・アプリケーション用に完全に動作が規定されています。Ioff 機能により、電源オフ時に損傷を引き起こすような電流がデバイスに逆流しないことが保証されます。SN74CBTLV3126 デバイスは、電源オフ時には絶縁されます。

電源オンまたは電源オフ時に高インピーダンス状態を保証するため、OE はプルダウン抵抗経由で GND に接続します。この抵抗の最小値は、ドライバの電流シンク能力によって決定されます。

SN74CBTLV3126 クワッド FET バス・スイッチには、独立のライン・スイッチが搭載されています。各スイッチは、対応する出力イネーブル (OE) 入力が LOW のときディセーブルになります。

このデバイスは、Ioff を使用する部分的パワーダウン・アプリケーション用に完全に動作が規定されています。Ioff 機能により、電源オフ時に損傷を引き起こすような電流がデバイスに逆流しないことが保証されます。SN74CBTLV3126 デバイスは、電源オフ時には絶縁されます。

電源オンまたは電源オフ時に高インピーダンス状態を保証するため、OE はプルダウン抵抗経由で GND に接続します。この抵抗の最小値は、ドライバの電流シンク能力によって決定されます。

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技術資料

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種類 タイトル 最新の英語版をダウンロード 日付
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アプリケーション・ノート Bus FET Switch Solutions for Live Insertion Applications 2003年 2月 7日
アプリケーション・ノート Texas Instruments Little Logic Application Report 2002年 11月 1日
アプリケーション・ノート TI IBIS File Creation, Validation, and Distribution Processes 2002年 8月 29日
その他の技術資料 Standard Linear & Logic for PCs, Servers & Motherboards 2002年 6月 13日
ユーザー・ガイド CBT (5-V) And CBTLV (3.3-V) Bus Switches Data Book (Rev. B) 1998年 12月 1日

設計と開発

その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページをご覧ください。

インターフェイス・アダプタ

LEADED-ADAPTER1 — TI の 5、8、10、16、24 ピン・リード付きパッケージの迅速なテスト向けの表面実装から DIP ヘッダーへのアダプタ

EVM-LEADED1 ボードは、TI の一般的なリード付きパッケージによる迅速なテストとブレッド・ボードへの対応を可能にします。 TI の D、DBQ、DCT、DCU、DDF、DGS、DGV、PW 表面実装パッケージを 100mil DIP ヘッダに変換するフットプリントを用意しています。     

ユーザー ガイド: PDF
シミュレーション・モデル

HSPICE Model for SN74CBTLV3126

SCDJ029.ZIP (96 KB) - HSpice Model
シミュレーション・モデル

SN74CBTLV3126 IBIS Model

SCDM079.ZIP (25 KB) - IBIS Model
パッケージ ピン数 ダウンロード
SOIC (D) 14 オプションの表示
SSOP (DBQ) 16 オプションの表示
TSSOP (PW) 14 オプションの表示
TVSOP (DGV) 14 オプションの表示
VQFN (RGY) 14 オプションの表示

購入と品質

記載されている情報:
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL 定格 / ピーク リフロー
  • MTBF/FIT 推定値
  • 材質成分
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果
記載されている情報:
  • ファブの拠点
  • 組み立てを実施した拠点

推奨製品には、この TI 製品に関連するパラメータ、評価基板、またはリファレンス デザインが存在する可能性があります。

サポートとトレーニング

TI E2E™ フォーラムでは、TI のエンジニアからの技術サポートを提供

コンテンツは、TI 投稿者やコミュニティ投稿者によって「現状のまま」提供されるもので、TI による仕様の追加を意図するものではありません。使用条件をご確認ください。

TI 製品の品質、パッケージ、ご注文に関するお問い合わせは、TI サポートをご覧ください。​​​​​​​​​​​​​​

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