SN74LVC4245A

アクティブ

3 ステート出力、オクタル・バス・トランシーバと 3.3V ~ 5V のシフタ

製品詳細

Technology family LVC Bits (#) 8 High input voltage (min) (V) 2 High input voltage (max) (V) 5.5 Vout (min) (V) 2.7 Vout (max) (V) 5.5 Data rate (max) (Mbps) 200 IOH (max) (mA) -24 IOL (max) (mA) 24 Supply current (max) (µA) 130 Features Output enable Input type Standard CMOS Output type 3-State, Balanced CMOS, Push-Pull Rating Catalog Operating temperature range (°C) -40 to 85
Technology family LVC Bits (#) 8 High input voltage (min) (V) 2 High input voltage (max) (V) 5.5 Vout (min) (V) 2.7 Vout (max) (V) 5.5 Data rate (max) (Mbps) 200 IOH (max) (mA) -24 IOL (max) (mA) 24 Supply current (max) (µA) 130 Features Output enable Input type Standard CMOS Output type 3-State, Balanced CMOS, Push-Pull Rating Catalog Operating temperature range (°C) -40 to 85
SOIC (DW) 24 159.65 mm² 15.5 x 10.3 SSOP (DB) 24 63.96 mm² 8.2 x 7.8 TSSOP (PW) 24 49.92 mm² 7.8 x 6.4
  • 双方向電圧変換
  • 5.5V (A ポート)、2.7V~3.6V (B ポート)
  • VCCA 電圧基準の制御入力 VIH/VIL レベル
  • JESD 17 準拠で 250mA 超のラッチアップ性能
  • JESD 22 を超える ESD 保護
    • 人体モデルで 2000V
    • 荷電デバイス・モデルで 1000V
  • 双方向電圧変換
  • 5.5V (A ポート)、2.7V~3.6V (B ポート)
  • VCCA 電圧基準の制御入力 VIH/VIL レベル
  • JESD 17 準拠で 250mA 超のラッチアップ性能
  • JESD 22 を超える ESD 保護
    • 人体モデルで 2000V
    • 荷電デバイス・モデルで 1000V

この 8 ビット (オクタル) 非反転バス・トランシーバは、2 つの独立した電源レールを搭載しています。B ポートには 3.3V に設定された VCCB、A ポートには 5V に設定された VCCA があります。これにより、3.3V 環境から 5V 環境への変換、およびその逆変換が可能になります。

SN74LVC4245A デバイスは、データ・バス間の非同期通信用に設計されています。このデバイスは、方向制御 (DIR) 入力の論理レベルに応じて、A バスから B バス、または B バスから A バスへデータを転送します。出力イネーブル (OE) 入力を使うと、このデバイスを無効化してバスを実質的に絶縁できます。制御回路 (DIR、OE) には、VCCA から電源が供給されます。

SN74LVC4245A デバイスの端子出力により、基板を再レイアウトすることなく、通常のすべて 3.3V またはすべて 5V の 20 端子 SN74LVC4245 デバイスに切り替えることができます。SN74LVC4245A デバイスのピン 2~11 および 14~23 のデータ・パスを使用して、従来の ’245 端子出力と整合させます。

この 8 ビット (オクタル) 非反転バス・トランシーバは、2 つの独立した電源レールを搭載しています。B ポートには 3.3V に設定された VCCB、A ポートには 5V に設定された VCCA があります。これにより、3.3V 環境から 5V 環境への変換、およびその逆変換が可能になります。

SN74LVC4245A デバイスは、データ・バス間の非同期通信用に設計されています。このデバイスは、方向制御 (DIR) 入力の論理レベルに応じて、A バスから B バス、または B バスから A バスへデータを転送します。出力イネーブル (OE) 入力を使うと、このデバイスを無効化してバスを実質的に絶縁できます。制御回路 (DIR、OE) には、VCCA から電源が供給されます。

SN74LVC4245A デバイスの端子出力により、基板を再レイアウトすることなく、通常のすべて 3.3V またはすべて 5V の 20 端子 SN74LVC4245 デバイスに切り替えることができます。SN74LVC4245A デバイスのピン 2~11 および 14~23 のデータ・パスを使用して、従来の ’245 端子出力と整合させます。

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技術資料

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* データシート SN74LVC4245A 3 ステート出力、オクタル・バス・トランシーバと3.3V~5V の電圧レベル・シフタ データシート (Rev. J 翻訳版) PDF | HTML 英語版 (Rev.J) PDF | HTML 2023年 2月 2日
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アプリケーション・ノート Migration From 3.3-V To 2.5-V Power Supplies For Logic Devices 1997年 12月 1日
アプリケーション・ノート Bus-Interface Devices With Output-Damping Resistors Or Reduced-Drive Outputs (Rev. A) 1997年 8月 1日
アプリケーション・ノート CMOS Power Consumption and CPD Calculation (Rev. B) 1997年 6月 1日
アプリケーション・ノート LVC Characterization Information 1996年 12月 1日
アプリケーション・ノート Input and Output Characteristics of Digital Integrated Circuits 1996年 10月 1日
アプリケーション・ノート Live Insertion 1996年 10月 1日
設計ガイド Low-Voltage Logic (LVC) Designer's Guide 1996年 9月 1日
アプリケーション・ノート Understanding Advanced Bus-Interface Products Design Guide 1996年 5月 1日

設計と開発

その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページをご覧ください。

評価ボード

14-24-LOGIC-EVM — 14 ピンから 24 ピンの D、DB、DGV、DW、DYY、NS、PW の各パッケージに封止した各種ロジック製品向けの汎用評価基板

14-24-logic-EVM 評価基板は、14 ピンから 24 ピンの D、DW、DB、NS、PW、DYY、DGV の各パッケージに封止した各種ロジック デバイスをサポートする設計を採用しています。

ユーザー ガイド: PDF | HTML
シミュレーション・モデル

SN74LVC4245A IBIS Model

SCAM009.ZIP (30 KB) - IBIS Model
パッケージ ピン数 ダウンロード
SOIC (DW) 24 オプションの表示
SSOP (DB) 24 オプションの表示
TSSOP (PW) 24 オプションの表示

購入と品質

記載されている情報:
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL 定格 / ピーク リフロー
  • MTBF/FIT 推定値
  • 材質成分
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果
記載されている情報:
  • ファブの拠点
  • 組み立てを実施した拠点

サポートとトレーニング

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