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  • Low Power Consumption:
    • Single Supply: <205mW PHY, 275mW with
      Center Tap (Typical)
    • Dual Supplies: <126mW PHY, 200mW with
      Center Tap (Typical)
  • Programmable Power Back Off to reduce PHY power up
    to 20% in systems with shorter cables
  • Low deterministic latency supports IEEE1588
  • Cable Diagnostics
  • Programmable Fast Link Down Modes,
    <10µs reaction time
  • Variable I/O voltage range: 1.8V to 3.3V
  • 3.3V MAC Interface
  • Fixed TX Clock to XI, with programmable
    phase shift
  • Auto-MDIX for 10/100Mbs
  • Energy Detection Mode
  • 25 MHz Clock Out
  • MII and RMII Capabilities
  • Serial Management Interface
  • IEEE 802.3u MII
  • IEEE 802.3u Auto-Negotiation and Parallel
  • Error-Free 100Base-T Operation up to
    150 Meters Under Typical Conditions
  • Error-Free 10Base-T Operation up to
    300 Meters Under Typical Conditions
  • IEEE 802.3u ENDEC, 10Base-T Transceivers and Filters
  • IEEE 802.3u PCS, 100Base-TX Transceivers
  • IEEE 1149.1 JTAG
  • Integrated ANSI X3.263 Compliant TP-PMD Physical
    Sublayer with Adaptive Equalization and Baseline
    Wander Compensation
  • Programmable LED Support Link, 10/100Mbs Mode,
    Activity, and Collision Detect
  • 10/100Mbs Packet BIST (Built in Self Test)
  • HBM ESD protection on RD± and TD± of 16kV
  • 48-pin LQFP Package (7mm) × (7mm)
open-in-new その他の イーサネット PHYs


The TLK110 is a single-port Ethernet PHY for 10Base-T and 100Base TX signaling. This device integrates all the physical-layer functions needed to transmit and receive data on standard twisted-pair cables. The TLK110 supports the standard Media Independent Interface (MII) and Reduced Media Independent Interface (RMII) for direct connection to a Media Access Controller (MAC).

The TLK110 is designed for power-supply flexibility, and can operate with a single 3.3V power supply or with combinations of 3.3V and 1.55V power supplies for reduced power operation.

The TLK110 uses mixed-signal processing to perform equalization, data recovery, and error correction to achieve robust operation over CAT 5 twisted-pair wiring. This device not only meets the requirements of IEEE 802.3, but maintains high margins in terms of cross-talk and alien noise.

The TLK110 Ethernet PHY has a special Power Back Off mode to conserve power in systems with relatively short cables. This mode provides the flexibility to reduce system power when the system is not required to drive the standard IEEE 802.3 100m cable length, or the extended 150m, error-free cable reach of the TLK110. For more detail, see application note SLLA328.

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種類 タイトル 英語版のダウンロード 日付
* データシート Industrial Temp, Single Port 10/100Mbs Ethernet PHY Transceiver, TLK110 データシート 2013年 12月 22日
アプリケーション・ノート Selection and Specification of Crystals for Texas Instruments Ethernet Devices 2019年 2月 6日
ホワイト・ペーパー Sitara™ プロセッサ上のEtherCAT® (Rev. E 翻訳版) 最新の英語版をダウンロード (Rev.I) 2017年 3月 9日
技術記事 New simple open real-time Ethernet (SORTE) protocol supports 4µs cycle time 2016年 11月 20日
ユーザー・ガイド Parallel Redundancy Protocol Ethernet Substation Automation Design Guide 2016年 3月 29日
技術記事 Designing for industrial environments 2014年 1月 15日
ユーザー・ガイド TLK110_Software_GUI_user_manual_rev_1.1.docx 2013年 8月 15日
アプリケーション・ノート TI chip, model TLK110 48p QFP placed on Evaluation board, Model Pc405 2013年 1月 10日
アプリケーション・ノート TLK110 Ethernet PHY Transformerless Operation 2012年 9月 17日
アプリケーション・ノート TLK1XX Design & Layout Guide 2012年 8月 15日
アプリケーション・ノート TLK110 Power Back Off for Short Cables 2012年 7月 17日
ユーザー・ガイド TLK100CUSEVM User Guide 2011年 12月 7日




評価基板 ダウンロード
document-generic ユーザー・ガイド

The TLK110CUSEVM provides a platform that lets you easily evaluate, design and market systems that include the TLK110 device.

  • Industrial temperatures (–40°C to +85°C)
  • Industrial temperature external magnetics
  • Control and status:
    • Configurable 8 PHY addresses—01h (default) or any other address between 00h and 07h using jumpers
    • 8 LEDs—2 power LEDs, 6 status LEDs (speed, link and active data)
  • Strap options:
    • MII/RMII jumper (MII (...)


サンプル・コードとデモ ダウンロード
SLLC430.ZIP (7276 KB)
ドライバとライブラリ ダウンロード
イーサネット PHY の Linux ドライバとツール
ETHERNET-SW The Linux drivers for Texas Instruments' Ethernet physical layer (PHY) transceivers support communication through the serial management interface (MDC/MDIO) to configure and read PHY registers.

The USB-2-MDIO software lets you directly access the registers during debug and prototyping.  (...)


シミュレーション・モデル ダウンロード
SLLM167A.ZIP (107 KB) - IBIS Model
シミュレーション・モデル ダウンロード
SLLM196.ZIP (1 KB) - BSDL Model
シミュレーション・ツール ダウンロード
PSpice® for TI design and simulation tool
PSPICE-FOR-TI PSpice® for TI は、各種アナログの機能評価に役立つ、設計とシミュレーション向けのツールです。  さまざまな機能を持ち、設計とシミュレーションに適したこのツールは、Cadence® のアナログ分析エンジンを使用しています。PSpice for TI は無償でご使用いただけます。アナログや電源に関する TI の製品ラインアップを対象に、業界でも有数の大規模な PSpice モデル・ライブラリが付属しているほか、選択された一部のアナログ動作モデルも利用できます。 


  • PSpice for TI ツールへのアクセスの申請
  • ツールのダウンロードとインストール
  • シミュレーション方法説明ビデオのご視聴

PSpice for TI ツールを使用すると、内蔵のモデル・ライブラリを使用して、複雑な設計のシミュレーションを実施することができます。完成度の高い最終機器を設計し、レイアウトの確定や製造開始より前に、ソリューションのプロトタイプを製作することができます。この結果、市場投入期間の短縮と開発コストの削減を実現できます。 

設計とシミュレーション向けのツールである PSpice for TI の環境内で、各種 TI デバイスの検索、製品ラインアップの参照、テスト・ベンチの起動、設計のシミュレーションを実施し、選定したデバイスをさらに分析することができます。また、複数の TI デバイスを組み合わせてシミュレーションを実行することもできます。

事前ロード済みの PSpice モデルで構成されたライブラリ全体に加えて、ツール内で各種 TI 製品情報に簡単にアクセスすることもできます。開発中のアプリケーションに適したデバイスを選定できたことを確認した後、TI 製品の購入ページにアクセスして、その製品を購入することができます。

PSpice for TI を使用すると、回路の検討から設計の開発や検証まで、作業の進展に合わせて設計サイクルの各段階で、シミュレーションのニーズに適した各種ツールにアクセスできます。  コスト不要で入手でき、開発を容易に開始できます。設計とシミュレーションに適した PSpice スイートをダウンロードして、今すぐ設計を開始してください。
  • 電源とシグナル・チェーンに関する TI の製品ラインアップを網羅する、各種 PSpice モデルで構成された事前インストール済みライブラリ
  • 動的更新により、最新のデバイス・モデルに確実にアクセス可能
  • 精度の低下を招かずに、シミュレーション速度を重視して最適化済み
  • 複数製品の同時分析をサポート
  • Cadence の PSpice テクノロジーを活用
  • OrCAD Capture フレームワークを土台とし、業界で最も幅広く使用されている回路図のキャプチャとシミュレーションの環境へのアクセスを実現
  • オフライン作業に対応し、柔軟性のあるスタンドアロン・ツール
シミュレーション・ツール ダウンロード


多くのTIリファレンス・デザインには、 TLK110 が含まれています。 TIのリファレンス・デザイン・セレクション・ツールを使用して、お客様のアプリケーションとパラメータに最適な設計を確認し、特定してください。

CAD/CAE シンボル

パッケージ ピン数 ダウンロード
LQFP (PT) 48 オプションの表示



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