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製品の詳細

パラメータ

Arm CPU 0 Arm MHz (Max.) 0 DSP 1 C64x Operating system DSP/BIOS, VLX Video acceleration 0 Video port (configurable) 1 Dedicated Input On-chip L2 cache/RAM 64 KB (DSP) DRAM DDR2 PCI/PCIe 0 Ethernet MAC 10/100 USB 0 SPI 0 I2C 1 UART (SCI) 1 Operating temperature range (C) -40 to 125 Rating Catalog open-in-new その他の メディア・プロセッサとオーディオ・プロセッサ

パッケージ|ピン|サイズ

NFBGA (ZWT) 361 256 mm² 16 x 16 open-in-new その他の メディア・プロセッサとオーディオ・プロセッサ

特長

  • Get started today with production-ready, easy-to-use audio and video codecs for digital media processors based on DaVinci™ technology. Also available are various O/S Board Support Packages and software updates. All codecs are available for FREE evaluation. REQUEST FREE SOFTWARE!
  • High-Performance Digital Media Processor (DM6431)
    • 3.33-ns Instruction Cycle Time
    • 300-MHz C64x+™ Clock Rate
    • Eight 32-Bit C64x+ Instructions/Cycle
    • 2400 MIPS
    • Fully Software-Compatible With C64x
    • Commercial and Automotive (Q or S suffix) Grades
  • VelociTI.2™ Extensions to VelociTI™ Advanced Very-Long-Instruction-Word (VLIW) TMS320C64x+™ DSP Core
    • Eight Highly Independent Functional Units With VelociTI.2 Extensions:
      • Six ALUs (32-/40-Bit), Each Supports Single 32-Bit, Dual 16-Bit, or Quad 8-Bit Arithmetic per Clock Cycle
      • Two Multipliers Support Four 16 × 16-Bit Multiplies (32-Bit Results) per Clock Cycle or Eight 8 × 8-Bit Multiplies (16-Bit Results) per Clock Cycle
    • Load-Store Architecture With Non-Aligned Support
    • 64 32-Bit General-Purpose Registers
    • Instruction Packing Reduces Code Size
    • All Instructions Conditional
    • Additional C64x+™ Enhancements
      • Protected Mode Operation
      • Exceptions Support for Error Detection and Program Redirection
      • Hardware Support for Modulo Loop Auto-Focus Module Operation
      • C64x+ Instruction Set Features
        • Byte-Addressable (8-/16-/32-/64-Bit Data)
        • 8-Bit Overflow Protection
        • Bit-Field Extract, Set, Clear
        • Normalization, Saturation, Bit-Counting
        • VelociTI.2 Increased Orthogonality
        • C64x+ Extensions
          • Compact 16-bit Instructions
          • Additional Instructions to Support Complex Multiplies
  • C64x+ L1/L2 Memory Architecture
    • 256K-Bit (32K-Byte) L1P Program RAM/Cache [Flexible Allocation]
    • 512K-Bit (64K-Byte) L1D Data RAM/Cache [Flexible Allocation]
    • 512K-Bit (64K-Byte) L2 Unified Mapped RAM/Cache [Flexible Allocation]
  • Supports Little Endian Mode Only
  • Video Processing Subsystem (VPSS), VPFE Only
    • Front End Provides:
      • CCD and CMOS Imager Interface
      • BT.601/BT.656 Digital YCbCr 4:2:2 (10-Bit) Interface
      • Glueless Interface to Common Video Decoders
  • External Memory Interfaces (EMIFs)
    • 16-Bit DDR2 SDRAM Memory Controller With 128M-Byte Address Space (1.8-V I/O)
      • Supports up to 266-MHz (data rate) bus and interfaces to DDR2-400 SDRAM
    • Asynchronous 8-Bit Wide EMIF (EMIFA) With up to 64M-Byte Address Reach
      • Flash Memory Interfaces
        • NOR (8-Bit-Wide Data)
        • NAND (8-Bit-Wide Data)
  • Enhanced Direct-Memory-Access (EDMA) Controller (64 Independent Channels)
  • Two 64-Bit General-Purpose Timers (Each Configurable as Two 32-Bit Timers)
  • One 64-Bit Watch Dog Timer
  • One UART With RTS and CTS Flow Control
  • Master/Slave Inter-Integrated Circuit (I2C Bus™)
  • One Multichannel Buffered Serial Port (McBSP0)
    • I2S and TDM
    • AC97 Audio Codec Interface
    • SPI
    • Standard Voice Codec Interface (AIC12)
    • Telecom Interfaces - ST-Bus, H-100
    • 128 Channel Mode
  • Multichannel Audio Serial Port (McASP0)
    • Four Serializers and SPDIF (DIT) Mode
  • High-End CAN Controller (HECC)
  • 10/100 Mb/s Ethernet MAC (EMAC)
    • IEEE 802.3 Compliant
    • Supports Media Independent Interface (MII)
    • Management Data I/O (MDIO) Module
  • Three Pulse Width Modulator (PWM) Outputs
  • On-Chip ROM Bootloader
  • Individual Power-Savings Modes
  • Flexible PLL Clock Generators
  • IEEE-1149.1 (JTAG™) Boundary-Scan-Compatible
  • Up to 111 General-Purpose I/O (GPIO) Pins (Multiplexed With Other Device Functions)
  • Packages:
    • 361-Pin Pb-Free PBGA Package (ZWT Suffix), 0.8-mm Ball Pitch
    • 376-Pin Plastic BGA Package (ZDU Suffix), 1.0-mm Ball Pitch
  • 0.09-µm/6-Level Cu Metal Process (CMOS)
  • 3.3-V and 1.8-V I/O, 1.2-V Internal (-3/-3Q/-3S)
  • Applications:
    • Digital Media
    • Networked Media Encode
    • Video Imaging

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概要

The TMS320C64x+™ DSPs (including the TMS320DM6431 device) are the highest-performance fixed-point DSP generation in the TMS320C6000™ DSP platform. The DM6431 device is based on the third-generation high-performance, advanced VelociTI™ very-long-instruction-word (VLIW) architecture developed by Texas Instruments (TI), making these DSPs an excellent choice for digital media applications. The C64x+™ devices are upward code-compatible from previous devices that are part of the C6000™ DSP platform. The C64x™ DSPs support added functionality and have an expanded instruction set from previous devices.

Any reference to the C64x DSP or C64x CPU also applies, unless otherwise noted, to the C64x+ DSP and C64x+ CPU, respectively.

With performance of up to 2400 million instructions per second (MIPS) at a clock rate of 300 MHz, the C64x+ core offers solutions to high-performance DSP programming challenges. The DSP core possesses the operational flexibility of high-speed controllers and the numerical capability of array processors. The C64x+ DSP core processor has 64 general-purpose registers of 32-bit word length and eight highly independent functional units–two multipliers for a 32-bit result and six arithmetic logic units (ALUs). The eight functional units include instructions to accelerate the performance in video and imaging applications. The DSP core can produce four 16-bit multiply-accumulates (MACs) per cycle for a total of 1200 million MACs per second (MMACS), or eight 8-bit MACs per cycle for a total of 2400 MMACS. For more details on the C64x+ DSP, see the TMS320C64x/C64x+ DSP CPU and Instruction Set Reference Guide (literature number SPRU732).

The DM6431 also has application-specific hardware logic, on-chip memory, and additional on-chip peripherals similar to the other C6000 DSP platform devices. The DM6431 core uses a two-level cache-based architecture. The Level 1 program memory/cache (L1P) consists of 32K-byte (KB) memory space that can be configured as mapped memory or direct mapped cache. The Level 1 data/memory memory/cache (L1D) consists of a 64KB memory space that can be configured as mapped memory or 2-way set-associative cache. The Level 2 memory/cache (L2) consists of a 64KB memory space that is shared between program and data space. L2 memory can be configured as mapped memory, cache, or a combination of both.

The peripheral set includes: 1 configurable video port; a 10/100 Mb/s Ethernet MAC (EMAC) with a management data input/output (MDIO) module; an inter-integrated circuit (I2C) Bus interface; a multichannel buffered serial port (McBSP0); a multichannel audio serial port (McASP0) with 4 serializers; 2 64-bit general-purpose timers each configurable as 2 independent 32-bit timers; 1 64-bit watchdog timer; up to 111-pins of general-purpose input/output (GPIO) with programmable interrupt/event generation modes, multiplexed with other peripherals; 1 UART with hardware handshaking support; 3 pulse width modulator (PWM) peripherals; 1 high-end controller area network (CAN) controller [HECC]; and 2 glueless external memory interfaces: an asynchronous external memory interface (EMIFA) for slower memories/peripherals, and a higher speed synchronous memory interface for DDR2.

The DM6431 device includes a Video Processing Subsystem (VPSS) with a Video Processing Front-End (VPFE) input used for video capture.

The Video Processing Front-End (VPFE) is comprised of a CCD Controller (CCDC). The CCDC is capable of interfacing to common video decoders, CMOS sensors, and Charge Coupled Devices (CCDs).

The Ethernet Media Access Controller (EMAC) provides an efficient interface between the DM6431 and the network. The DM6431 EMAC support both 10Base-T and 100Base-TX, or 10 Mbits/second (Mbps) and 100 Mbps in either half- or full-duplex mode, with hardware flow control and quality of service (QOS) support.

The Management Data Input/Output (MDIO) module continuously polls all 32 MDIO addresses in order to enumerate all PHY devices in the system.

The I2C port allows DM6431 to easily control peripheral devices and/or communicate with host processors.

The high-end controller area network (CAN) controller [HECC] module provides a network protocol in a harsh environment to communicate serially with other controllers, typically in automotive applications.

The rich peripheral set provides the ability to control external peripheral devices and communicate with external processors. For details on each of the peripherals, see the related sections later in this document and the associated peripheral reference guides.

The DM6431 has a complete set of development tools. These include C compilers, a DSP assembly optimizer to simplify programming and scheduling, and a Windows™ debugger interface for visibility into source code execution.

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技術資料

= TI が選択したこの製品の主要ドキュメント
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種類 タイトル 英語版のダウンロード 日付
* データシート TMS320DM6431 Digital Media Processor データシート 2008年 6月 6日
* エラッタ TMS320DM6437/35/33/31 DMP Silicon Errata (Revs. 1.3 1.2 1.1 & 1.0) 2011年 8月 12日
アプリケーション・ノート Plastic Ball Grid Array [PBGA] Application Note 2015年 8月 13日
ユーザー・ガイド TMS320C6000 Assembly Language Tools v 7.3 User's Guide 2012年 8月 21日
ユーザー・ガイド TMS320C6000 Optimizing Compiler v 7.3 User's Guide 2012年 8月 21日
アプリケーション・ノート Using the TMS320DM643x Bootloader 2012年 3月 23日
ユーザー・ガイド TMS320C6000 Programmer's Guide 2011年 7月 11日
ユーザー・ガイド TMS320DM643x DMP Inter-Integrated Circuit (I2C) Module User's Guide 2011年 3月 25日
ユーザー・ガイド TMS320DM643x DMP DDR2 Memory Controller User's Guide 2011年 1月 12日
ユーザー・ガイド TMS320DM643x DMP EMAC/MDIO User's Guide 2010年 12月 23日
ユーザー・ガイド TMS320DM643x DMP Video Processing Front End (VPFE) User's Guide 2010年 8月 25日
ユーザー・ガイド TMS320DM643x DMP Pulse-Width Modulator (PWM) User's Guide 2010年 8月 5日
ユーザー・ガイド TMS320C64x+ DSP Megamodule Reference Guide 2010年 8月 3日
ユーザー・ガイド TMS320C64x/C64x+ DSP CPU and Instruction Set Reference Guide 2010年 7月 30日
アプリケーション・ノート TMS320DM643x Power Consumption Summary 2010年 5月 10日
ユーザー・ガイド TMS320C6000 Assembly Language Tools v 7.0 User's Guide 2010年 3月 18日
ユーザー・ガイド TMS320C6000 Optimizing Compiler v 7.0 User's Guide 2010年 3月 18日
ユーザー・ガイド TMS320DM643x DMP Universal Asynchronous Receiver/Transmitter (UART) UG 2009年 12月 16日
アプリケーション・ノート DM643x DMPを用いたシステム開発ナビゲータ (Rev. A 翻訳版) 2009年 6月 3日
アプリケーション・ノート Common Object File Format (COFF) 2009年 4月 15日
ユーザー・ガイド TMS320DM643x DMP Asynchronous External Memory Interface User's Guide 2009年 2月 24日
ユーザー・ガイド TMS320C64x+ DSP Cache User's Guide 2009年 2月 11日
ユーザー・ガイド TMS320DM643x DMP DSP サブシステム リファレンス・ガイド (Rev. E 翻訳版) 英語版をダウンロード (Rev.E) 2008年 12月 2日
その他の技術資料 TMS320C6000 高性能 DSP シリーズ プロダクト・ブリテン (Rev. B 翻訳版) 2008年 11月 17日
アプリケーション・ノート 12Vin DM643x Power using Integrated-FET DCDC Converters and LDO 2008年 10月 9日
アプリケーション・ノート 5Vin DM643x Power using DCDC Controllers and LDO 2008年 10月 9日
アプリケーション・ノート 5Vin DM643x Power using Integrated-FET DCDC Converters and LDO 2008年 10月 9日
アプリケーション・ノート 5Vin DM643x Power using a PMIC (Multi-output DCDC Converter) 2008年 10月 9日
ユーザー・ガイド TMS320DM643x DMP ビデオ・プロセッシング・フロント・エンド(VPFE)ユーザーズ・ガイド (Rev. A 翻訳版) 最新の英語版をダウンロード (Rev.D) 2008年 8月 25日
アプリケーション・ノート EDMA v2.0 to EDMA v3.0 (EDMA3) Migration Guide 2008年 8月 21日
アプリケーション・ノート Understanding the Davinci Preview Engine 2008年 7月 23日
アプリケーション・ノート Understanding TI’s PCB Routing Rule-Based DDR Timing Specification 2008年 7月 17日
アプリケーション・ノート TMS320DM643x デバイスにおけるVPFE及びVPBEドライバの使い方 (Rev. A 翻訳版) 英語版をダウンロード (Rev.A) 2008年 7月 15日
アプリケーション・ノート TMS320DM643x DSP PCB レイアウトの実装 2008年 6月 26日
アプリケーション・ノート TMS320DM643x 消費電力の概略 (Rev. B 翻訳版) 最新の英語版をダウンロード (Rev.C) 2008年 6月 17日
アプリケーション・ノート How to Use the EDMA3 Driver on a TMS320DM643x Device 2008年 6月 16日
ユーザー・ガイド TMS320C6000 Assembly Language Tools v 6.1 User's Guide 2008年 5月 15日
ユーザー・ガイド TMS320C6000 Optimizing Compiler v 6.1 User's Guide 2008年 5月 15日
ユーザー・ガイド TMS320C64x+ DSP Image/Video Processing Library (v2.0) Programmer's Reference 2008年 5月 5日
アプリケーション・ノート TMS320DM64xx、TMS320DM64x、および TMS320C6000 デバイスにおける熱考察 英語版をダウンロード 2008年 5月 5日
ユーザー・ガイド TMS320DM643x DMP General-Purpose Input/Output (GPIO) User's Guide 2008年 3月 18日
ユーザー・ガイド TMS320DM643x DMP I2C(Inter-Integrated Circuit)ペリフェラル ユーザーズ・ガイド (Rev. A 翻訳版) 最新の英語版をダウンロード (Rev.E) 2008年 3月 18日
ユーザー・ガイド TMS320DM643x DMP 非同期外部メモリ・インターフェイス(EMIF)ユーザーズ・ガイド (Rev. A 翻訳版) 最新の英語版をダウンロード (Rev.B) 2008年 3月 18日
ユーザー・ガイド TMS320DM643x DMP Multichannel Audio Serial Port (McASP) User's Guide 2008年 3月 13日
ユーザー・ガイド TMS320C64x+ DSP Little-Endian Library Programmer's Reference 2008年 3月 6日
ユーザー・ガイド TMS320DM643x DMP Enhanced DMA (EDMA) Controller User's Guide 2008年 3月 3日
アプリケーション・ノート TMS320DM643x ブートローダの使い方 (Rev. C 翻訳版) 最新の英語版をダウンロード (Rev.E) 2008年 2月 26日
ユーザー・ガイド TMS320C64x+ DSP メガモジュール リファレンス・ガイド (Rev. H 翻訳版) 最新の英語版をダウンロード (Rev.K) 2007年 10月 1日
ユーザー・ガイド TMS320DM643x DMP Multichannel Buffered Serial Port (McBSP) User's Guide 2007年 9月 17日
アプリケーション・ノート TMS320DM643x Pin Multiplexing Utility 2007年 7月 6日
ユーザー・ガイド TMS320DM643x DMP Peripherals Overview Reference Guide 2007年 6月 25日
ユーザー・ガイド TMS320DM643x DMP High-End CAN Controller (HECC) User's Guide 2007年 5月 15日
その他の技術資料 TMS320C6000 DSP TCP/IP Stack Software 2007年 4月 4日
その他の技術資料 DaVinci Technology - Digital Video Innovation Product Bulletin 2007年 2月 13日
その他の技術資料 Overview of DaVinci™ TMS320DM643x Digital Media Portfolio 2007年 2月 13日
アプリケーション・ノート DaVinci Technology Background and Specifications 2007年 1月 4日
ユーザー・ガイド TMS320DM643x DMP 64-Bit Timer User's Guide 2006年 12月 18日
ユーザー・ガイド TMS320C64x+ DSP Big-Endian Library Programmer's Reference 2006年 3月 10日
ユーザー・ガイド TMS320C64x+ Image/Video Processing Library Programmer's Reference 2006年 3月 10日
アプリケーション・ノート TMS320C64x to TMS320C64x+ CPU Migration Guide 2005年 10月 20日

設計と開発

追加の事項や他のリソースを参照するには、以下のタイトルをクリックすると、詳細ページを表示できます。

ソフトウェア開発

アプリケーション・ソフトウェアとフレームワーク ダウンロード
マルチメディア・フレームワーク製品(MFP)- コーデック・エンジン、フレームワーク・コンポーネントおよび XDAIS
TMDMFP Multimedia Framework Products (MFP)

A major advantage of programmable DSPs over fixed-function devices is their ability to accelerate multiple multimedia functions in a single device. TI multimedia framework products are designed to enable users to easily share a DSP between algorithms by handling (...)

特長
Multimedia Framework Products (MFP) - Codec Engine and xDAIS Framework Components

Codec Engine - Codec Engine is a codec execution framework that automates the invocation and instantiation of eXpressDSP-compliant codecs and algorithms. Codec Engine can execute in ARM-only, ARM-DSP, or DSP-only (...)

デバッグ・プローブ ダウンロード
Spectrum Digital XDS200 USB エミュレータ
TMDSEMU200-U Spectrum Digital XDS200 は、TI のプロセッサを対象とする最新の XDS200 デバッグ・プローブ(エミュレータ)ファミリの最初のモデルです。XDS200 ファミリは、超低コストの XDS100 と高性能の XDS560v2 の間で、低コストと高性能の最適バランスを実現します。また、すべての XDS デバッグ・プローブは、ETB(Embedded Trace Buffer、組込みトレース・バッファ)を搭載したすべての ARM と DSP プロセッサに対し、コア・トレースとシステム・トレースをサポートしています。

Spectrum Digital XDS200 は、TI 20 ピン・コネクタ(TI 14 ピン、ARM 10 ピン、ARM 20 ピンを接続するための複数のアダプタ付属)とホスト側の USB 2.0 (...)

295
特長

XDS200 は、TI のプロセッサを対象とする最新の JTAG デバッグ・プローブ(エミュレータ)ファミリです。高い性能と一般的な機能を搭載した低コスト XDS100 と高性能 XDS560v2 の中間に位置する XDS200 は、TI のマイコン、プロセッサ、ワイヤレス・デバイスのデバッグのためのバランス重視のソリューションを提供します。

XDS200 は、販売開始から長い年月が経過している「XDS510」JTAG デバッガ・ファミリに比べ、データ・スループットが高いほか、ARM シリアル・ワイヤ・デバッグ・モードのサポート機能も追加しており、コスト低減を可能にします。

TI では開発ボードのスペース低減を推進しており、すべての XDS200 派生製品は、ターゲット接続用のプライマリ JTAG コネクティビティとして標準的な TI 20 ピン・コネクタを実装しています。この製品に加えて、すべての派生製品は、TI と ARM の標準的な JTAG ヘッダーに接続するためにモジュラー形式のターゲット構成アダプタも採用しています(付属するアダプタは、モデルによって異なります)。

XDS200 は、従来型の IEEE1149.1(JTAG)、IEEE1149.7(cJTAG)、ARM のシリアル・ワイヤ・デバッグ(SWD)とシリアル・ワイヤ出力(SWO)をサポートしており、+1.5V ~ 4.1V のインターフェイス・レベルで動作します。

IEEE1149.7 つまり Compact JTAG(cJTAG)は、従来型の JTAG を大幅に改良しており、2 本のピンだけで従来型のすべての機能をサポートします。また、TI のワイヤレス・コネクティビティ・マイコンでの利用も可能です。

シリアル・ワイヤ・デバッグ(SWD)とは、同じく 2 本のピンを使用して、JTAG より高速なクロック・レートでデータを転送するデバッグ・モードです。シリアル・ワイヤ出力(SWO)を使用する場合は、もう 1 本のピンを追加して、Cortex M4 マイコンで簡潔なトレース動作を実行することができます。

すべての XDS200 モデルは、ホストへの接続のために、USB2.0 ハイスピード(480Mbps)をサポートしており、一部のモデルではイーサネット 10/100Mbps もサポートしています。また、一部のモデルではターゲット・ボードでの消費電力監視をサポートしています。

XDS200 ファミリには、TI の (...)

デバッグ・プローブ ダウンロード
Blackhawk XDS560v2 システム・トレース USB エミュレータ
TMDSEMU560V2STM-U The XDS560v2 System Trace is the first model of the XDS560v2 family of high-performance debug probes (emulators) for TI processors. The XDS560v2 is the highest performance of the XDS family of debug probes and supports both the traditional JTAG standard (IEEE1149.1) and cJTAG (IEEE1149.7).

The (...)

995
特長

XDS560v2 is the latest variant of the XDS560 family of high-performance debug probes (emulators) for TI processors. With the fastest speeds and most features of the entire XDS family, XDS560v2 is the most comprehensive solution to debug TI microcontrollers, processors and wireless connectivity (...)

デバッグ・プローブ ダウンロード
Spectrum Digital XDS560v2 システム・トレース USB およびイーサネット
TMDSEMU560V2STM-UE The XDS560v2 System Trace is the first model of the XDS560v2 family of high-performance debug probes (emulators) for TI processors. The XDS560v2 is the highest performance of the XDS family of debug probes and supports both the traditional JTAG standard (IEEE1149.1) and cJTAG (IEEE1149.7).

The (...)

1495
特長
  • XDS560v2 is the latest variant of the XDS560 family of high-performance debug probes (emulators) for TI processors. With the fastest speeds and most features of the entire XDS family, XDS560v2 is the most comprehensive solution to debug TI microcontrollers, processors and wireless connectivity (...)

ドライバとライブラリ ダウンロード
TMS320C62x/TMS320C64x FastRTS ライブラリ
SPRC122 C62x/64x FastRTS ライブラリは、最適化済みの浮動小数点関数ライブラリであり、TMS320C62x または TMS320C64x どちらかのデバイスを使用する C プログラマ向けです。これらのルーチンは通常、最適な実行速度を重視する演算集中型のリアルタイム・アプリケーションで使用します。現行の浮動小数点ライブラリ (RTS) の関数を FastRTS ライブラリで置き換えると、既存のコードを書き換えずに実行速度を大幅に高速化することができます。

また、このリリースは、FastRTS ライブラリで使用できる一部の関数に対応する C の実装も収録しています。これらの C コードを使用すると、ユーザーの皆様はこれらの関数をインライン化し、さらに性能を改善できます。

特長

単精度と倍精度の算術関数 単精度と倍精度の変換関数
浮動小数点の加算 浮動小数点から 32 ビット符号付き整数への変換
32 ビット符号付き整数から浮動小数点への変換
浮動小数点の除算 浮動小数点から 40 ビット符号付き長整数への変換
40 ビット符号付き長整数から浮動小数点への変換
浮動小数点の乗算 浮動小数点から 32 ビット符号なし整数への変換
32 ビット符号なし整数から浮動小数点への変換
浮動小数点の逆数 浮動小数点から 40 ビット符号なし長整数への変換
40 ビット符号なし長整数から浮動小数点への変換
浮動小数点の減算 倍精度浮動小数点から単精度浮動小数点への変換
単精度浮動小数点から倍精度浮動小数点への変換
ドライバとライブラリ ダウンロード
ソフトウェア・コーデック ダウンロード
eXpressDSP アルゴリズム・スタンダード – xDAIS デベロッパーズ・キットと xDM
TMDXDAISXDM xDAIS and xDM

The eXpressDSP™ Algorithm Interoperability Standard (xDAIS) and the eXpressDSP Digital Media (xDM) standard fully leverage the ability of DSPs to perform a wide range of multimedia functions on a single device. eXpressDSP compliance is achieved by adhering to these standards. To (...)

特長
xDAIS and xDM Technical Overview eXpressDSP Digital Media (xDM) standard - The xDM standard defines APIs through which an application invokes a particular class of codec, such as video decode or audio encode. xDM APIs are defined for the following codecs classes:
  • Video decode
  • Video encode
  • Image decode
  • (...)

設計ツールとシミュレーション

シミュレーション・モデル ダウンロード
SPRM224.ZIP (9 KB) - BSDL Model
シミュレーション・モデル ダウンロード
SPRM225.ZIP (10 KB) - BSDL Model
シミュレーション・モデル ダウンロード
SPRM236B.ZIP (267 KB) - IBIS Model
シミュレーション・モデル ダウンロード
SPRM237B.ZIP (267 KB) - IBIS Model

CAD/CAE シンボル

パッケージ ピン数 ダウンロード
NFBGA (ZWT) 361 オプションの表示

購入と品質

サポートとトレーニング

TI E2E™ Forums (英語) では、TI のエンジニアからの技術サポートが活用できます

コンテンツは、TI 投稿者やコミュニティ投稿者によって「現状のまま」提供されるもので、TI による仕様の追加を意図するものではありません。使用条件をご確認ください

TI 製品の品質、パッケージ、ご注文に関する質問は、TI サポートのページをご覧ください。

トレーニング・シリーズ

TI のトレーニングとビデオをすべて表示

ビデオ

関連ビデオ