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TPD4E002

アクティブ

クワッド、11pF、±5.5V、±15kV ESD 保護ダイオード

製品詳細

Package name SOT-5X3 Peak pulse power (8/20 μs) (max) (W) 25 Vrwm (V) 5 Bi-/uni-directional Uni-Directional Number of channels 4 IO capacitance (typ) (pF) 11 Clamping voltage (V) 30 Breakdown voltage (min) (V) 6.1
Package name SOT-5X3 Peak pulse power (8/20 μs) (max) (W) 25 Vrwm (V) 5 Bi-/uni-directional Uni-Directional Number of channels 4 IO capacitance (typ) (pF) 11 Clamping voltage (V) 30 Breakdown voltage (min) (V) 6.1
SOT-5X3 (DRL) 5 2.56 mm² 1.6 x 1.6
  • IEC 61000-4-2 ESD Protection
    • ±15-kV IEC 61000-4-2 Contact Discharge
  • IEC 61000-4-5 Surge Protection
    • 2.5-A Peak Pulse Current (8/20-µs Pulse)
  • ANSI/ESDA/JEDEC JS-001
    • ±15-kV Human Body Model (HBM)
  • Four Unidirectional Voltage Suppression Diodes for use in ESD Protection
  • I/O Breakdown Voltage, VBR = 6.1 V (Minimum)
  • I/O Capacitance 11 pF (Typical)
  • Low Leakage Current < 100 nA
  • Very Small Printed-Circuit Board (PCB) Area < 2.6 mm2
  • High Integration
  • Suitable for High-Density Boards
  • IEC 61000-4-2 ESD Protection
    • ±15-kV IEC 61000-4-2 Contact Discharge
  • IEC 61000-4-5 Surge Protection
    • 2.5-A Peak Pulse Current (8/20-µs Pulse)
  • ANSI/ESDA/JEDEC JS-001
    • ±15-kV Human Body Model (HBM)
  • Four Unidirectional Voltage Suppression Diodes for use in ESD Protection
  • I/O Breakdown Voltage, VBR = 6.1 V (Minimum)
  • I/O Capacitance 11 pF (Typical)
  • Low Leakage Current < 100 nA
  • Very Small Printed-Circuit Board (PCB) Area < 2.6 mm2
  • High Integration
  • Suitable for High-Density Boards

The TPD4E002 device is a transient voltage suppressor (TVS) designed to protect up to four lines against electrostatic discharge (ESD) transients. The monolithic circuit design allows superior capacitance matching between the channels and reduced crosstalk. This device is ideal for applications where both reduced line capacitance and board space-saving are required.

The TPD4E002 device is a transient voltage suppressor (TVS) designed to protect up to four lines against electrostatic discharge (ESD) transients. The monolithic circuit design allows superior capacitance matching between the channels and reduced crosstalk. This device is ideal for applications where both reduced line capacitance and board space-saving are required.

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設計と開発

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回路図: PDF
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購入と品質

記載されている情報:
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL 定格 / ピーク リフロー
  • MTBF/FIT 推定値
  • 材質成分
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果
記載されている情報:
  • ファブの拠点
  • 組み立てを実施した拠点

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