ADC32J24EVM

ADC32J24 評価モジュール

ADC32J24EVM

概要

The ADC32J24 EVM demonstrates the performance of a low power dual 125Msps 12 bit ADC.  It includes the ADC32J24 device, an optional DC-coupled THS4541 active interface signal path, JESD204B clocking is provided by the LMK04828 and TI voltage regulators to provide the necessary voltages.  The input for the ADC is by default connected to the transformer input which can be connected to a 50 ohm single ended signal source.  If a DC coupled path is desired an optional path is provided using the THS4541.  This can be selected by moving some solder jumpers.  The clock reference input is provided via a transformer input and can be connected to a 50 ohm single ended clock source.  An onboard LMK04828 can be used to generate the necessary JESD204B clocks. Register access is provided through the on board USB connection and a GUI.

特長

 

  • Single 1.8V supply to simplify power requirements
  • Flexible input clock buffer with 1/2/4 divider to simplify clocking
  • On chip dither to improve SFDR
  • JESD204B data interface to simplify digital interface, compliant up to 3.2Gbps lane rates
  • Supports subclasses 0, 1, 2 for synchronization and compatibility
  • Pin compatibility with 12/14b and dual/quad devices

 

高速 ADC (10MSPS 超過)
ADC32J24 2 チャネル、12 ビット、125MSPS AD コンバータ(ADC)

購入と開発の開始

評価基板 (EVM) 向けの GUI

ADC3xxx GUI Installer (Rev. C) – SLAC667C.ZIP (196003KB)

TI の評価品に関する標準契約約款が適用されます。

設計ファイル

ADC3xJxxEVM Design Package (Rev. A) SLAR094A.ZIP (11316 KB)

技術資料

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種類 タイトル 英語版のダウンロード 日付
証明書 ADC32J24EVM EU Declaration of Conformity (DoC) 2019年 1月 2日
ユーザー・ガイド ADC3xxx, ADC3xJxx EVM User's Guide (Rev. D) 2018年 8月 24日

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