PMP9365

Altera® Stratix® V FPGA 電源ソリューション

概要

PMP9365 リファレンス・デザインでは、Altera 製の Stratix V ファミリの FPGA に電力を供給するために必要とされるすべての電源レールを実装できます。  このデザインでは、複数の LMZ3 シリーズ・モジュール、複数の LDO、1 つの DDR 終端レギュレータを採用しており、FPGA に電力を供給するために必要とされるすべてのレールを実装できます。  また、フレキシブルなパワーアップ/ダウン・シーケンシングを実行する 2 個の LM3880 を採用しています。  このリファレンス・デザインでは、12V 入力を使用します。

特長
  • Altera® Stratix® V FPGA で必要とされるすべての電源レールを実装
  • 12V 入力対応のために最適化した設計
  • オンボードのパワーアップ/ダウン・シーケンシング
  • DDR3 メモリ・デバイスをサポート
  • 使いやすさを考慮したモジュール設計
出力電圧オプション PMP9365.10
Vin (Min) (V) 10.8
Vin (Max) (V) 13.2
Vout (Nom) (V) .85
Iout (Max) (A) 20
Output Power (W) 17
Isolated/Non-Isolated Non-Isolated
Input Type DC
Topology Buck- Integrated Switch

組み立てられたボードは、テストと性能検証のみの目的で開発されたものであり、販売していません。

設計ファイルと製品

設計ファイル

すぐに使用できるシステム・ファイルをダウンロードすると、設計プロセスを迅速化できます。

TIDU645.PDF (300 K)

効率グラフや試験の前提条件などを含める、このリファレンス・デザインに関する試験結果

TIDU601.PDF (2529 K)

効率グラフや試験の前提条件などを含める、このリファレンス・デザインに関する試験結果

TIDRBC0.PDF (1747 K)

設計レイアウトとコンポーネントを示した詳細な回路図

TIDRBC1.PDF (85 K)

設計に使用したコンポーネント、参照指定子、メーカー名や型番などを記入した詳細なリスト

TIDC703.ZIP (1103 K)

PCB 設計の基板層に関する情報を記載した設計ファイル

製品

設計や代替製品候補に TI 製品を含めます。

DDR メモリ向け電源 IC

TPS51200DDR2、DDR3、DDR3L、DDR4 向けの VTTREF バッファード・リファレンス内蔵の 3A シンク/ソース DDR 終端レギュレータ

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シーケンサ

LM3880遅延時間固定、3 レール、シンプルな電源シーケンサ

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リニア・レギュレータと低ドロップアウト (LDO) レギュレータ

TPS735イネーブル搭載、500mA、低静止電流 (IQ)、低ドロップアウト電圧レギュレータ

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降圧モジュール (インダクタ内蔵)

LMZ315039 x 15 x 2.8mm QFN パッケージ封止、4.5V ~ 15V、3A、降圧パワー・モジュール

データシート document-pdfAcrobat PDF
降圧モジュール (インダクタ内蔵)

LMZ3152015 x 16 x 5.8mm QFN パッケージ封止、3V ~ 14.5V、20A、降圧パワー・モジュール

データシート document-pdfAcrobat PDF
降圧モジュール (インダクタ内蔵)

LMZ31704電流共有機能搭載、10 x 10 x 4.3mm QFN パッケージ封止、2.95V ~ 17V、4A、降圧パワー・モジュール

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技術資料

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種類 タイトル 英語版のダウンロード 日付
試験報告書 PMP9365 Overview 2014年 11月 18日
試験報告書 PMP9365 Test Results 2014年 10月 15日

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