TIDA-010122

マルチチャネル AFE システム向け、データ・コンバータの DDC と NCO の同期機能のリファレンス・デザイン

TIDA-010122

設計ファイル

概要

このリファレンス・デザインは、mMIMO (massive multiple input multiple output、マッシブ MIMO)、フェーズド・アレイ・レーダー、通信ペイロードなど、新登場の 5G 採用アプリケーションに関係する同期設計の課題解決に役立ちます。一般的な RF フロント・エンドの場合、アンテナ、低ノイズ・アンプ (LNA)、ミキサ、局部発振器 (LO) はアナログ領域に、また、A/D コンバータ、数値制御発振器 (NCO)、デジタル・ダウン・コンバータ (DDC) はデジタル領域にあります。システム全体の同期を実現するには、これらのデジタル・ブロックをシステム・クロックと同期させる必要があります。このリファレンス・デザインは ADC12DJ3200 データ・コンバータを使用し、オンチップ NCO を SYNC~ (SYNC の反転信号、データシートでは「SYNC」 4 文字の上に線) に対して同期させる方法で、確定的な待ち時間と複数のレシーバ間での 5ps 未満のチャネル間スキューを実現します。また、ノイズレスのアパーチャ遅延時間調整 (tAD Adjust) 機能を使用してスキューをさらに低減します。また、このデザインは、LMX2594 広帯域 PLL と LMK04828 シンセサイザおよびジッタ・クリーナーをベースとし、位相ノイズが非常に小さいクロック関連ソリューションも実現しています。

特長
  • 4 チャネル、3.2GSPS、6GHz の高速アナログ・フロント・エンド
  • オンチップ NCO 同期機能により、SYNC~ を使用して複数 ADC 間の同期を実現
  • JESD204B 準拠マルチチャネル・クロック
  • JESD204B はレーン数 8/16/32 の JESD レーンをサポートし、レーンごとに最大 12.8Gbps のデータ速度に対応
  • 12V 入力で効率が 85% を上回るコンパニオン電源のリファレンス・デザイン
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組み立てられたボードは、テストと性能検証のみの目的で開発されたものであり、販売していません。

設計ファイルと製品

設計ファイル

すぐに使用できるシステム・ファイルをダウンロードすると、設計プロセスを迅速化できます。

JAJU730.PDF (11854 K)

リファレンス・デザインの概要と検証済みの性能テスト・データ

TIDRZV5.PDF (3461 K)

設計レイアウトとコンポーネントを示した詳細な回路図

TIDRZV6.PDF (240 K)

設計に使用したコンポーネント、参照指定子、メーカー名や型番などを記入した詳細なリスト

TIDRZV7.PDF (2983 K)

コンポーネントの配置を明示する詳細な設計レイアウト

TIDRZV9.ZIP (74323 K)

IC コンポーネントの 3D モデルまたは 2D 図面に使用するファイル

TIDCFI4.ZIP (13521 K)

PCB 設計の基板層に関する情報を記載した設計ファイル

TIDRZV8.PDF (28658 K)

PCB 設計レイアウトを生成するための PCB 基板層のプロット・ファイル

製品

設計や代替製品候補に TI 製品を含めます。

高速 ADC(≧10 MSPS)

ADC12DJ320012 ビット、デュアル 3.2GSPS またはシングル 6.4GSPS、RF サンプリング A/D コンバータ(ADC)

データシート: PDF | HTML
AND ゲート

SN74LVC1G081 チャネル、2 入力、1.65V ~ 5.5V、32mA のドライブ能力、AND ゲート

データシート: PDF
I2C 汎用 I/O (GPIO)

TCA9534A割り込み、構成レジスタ搭載、8 ビット 1.65V ~ 5.5V I2C/SMBus I/O エクスパンダ

データシート: PDF | HTML
LVDS、M-LVDS、PECL の各 IC

DS90LT012AQ-Q1車載対応、LVDS 差動ライン・レシーバ

データシート: PDF
LVDS、M-LVDS、PECL の各 IC

DS90LV028AQ-Q1車載対応、LVDS デュアル差動ライン・レシーバ

データシート: PDF | HTML
N チャネル MOSFET

CSD15571Q22mm x 2mm の SON 封止、19.2mΩ、シングル、20V、N チャネル NexFET™ パワー MOSFET

データシート: PDF
RF FDA

LMH54018GHz、超広帯域、完全差動アンプ

データシート: PDF | HTML
RF PLL / シンセサイザ

LMX2594位相同期機能搭載、JESD204B サポート、15GHz 広帯域、PLLatinum™ RF シンセサイザ

データシート: PDF | HTML
RF VGA

LMH64014.5GHz、超広帯域デジタル可変ゲイン・アンプ

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eFuse とホット・スワップ・コントローラ

TPS259264.5V ~ 13.8V、30mΩ、2 ~ 5A eFuse

データシート: PDF | HTML
アナログ・スイッチ / マルチプレクサ

SN74LVC2G535V、2:1 (SPDT)、1 チャネル汎用アナログ・スイッチ (NanoFree™ パッケージが入手可能)

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クロック・ジッタ・クリーナとシンクロナイザ

LMK048282370 ~ 2630MHz の VCO0 内蔵、超低ノイズ、JESD204B 準拠クロック・ジッタ・クリーナ。

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クロック・バッファ

LMK003044 個の構成可能出力採用、3.1GHz、差動クロック・バッファ / レベル・シフタ

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コンパレータ

LMC6762プッシュプル出力、デュアル、マイクロパワー、レール・ツー・レール入力 CMOS コンパレータ

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デジタル温度センサ

LM95233TruTherm テクノロジー採用、SMBus インターフェイス搭載、±2℃、デュアル、リモート / ローカル温度センサ

データシート: PDF
リニア・レギュレータと低ドロップアウト (LDO) レギュレータ

TLV702イネーブル搭載、300mA、高 PSRR、低静止電流 (IQ)、低ドロップアウト電圧レギュレータ

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リニア・レギュレータと低ドロップアウト (LDO) レギュレータ

TPS7A33イネーブル搭載、1A、高 PSRR、負電圧、調整可能な低ドロップアウト電圧レギュレータ

データシート: PDF | HTML
リニア・レギュレータと低ドロップアウト (LDO) レギュレータ

TPS7A8300パワー・グッド搭載、高精度、低い入力電圧 (VIN)、低ノイズ、2A の超低ドロップアウト電圧レギュレータ

データシート: PDF | HTML
リニア・レギュレータと低ドロップアウト (LDO) レギュレータ

TPS7A84パワー・グッド搭載、高精度、3A、低い VIN、低ノイズ、超低ドロップアウト電圧レギュレータ

データシート: PDF
方向制御型電圧レベル・シフタ

SN74AVC4T774構成可能な電圧レベル シフト機能搭載、3 ステート出力、4 ビット、デュアル電源電圧バス トランシーバ

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発振器

LMK61E2156.250MHz、±50ppm、超低ジッタ、EEPROM 内蔵、フル・プログラマブル発振器

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降圧モジュール (インダクタ内蔵)

TPS8213017V 入力、インダクタ結合型、3A 降圧コンバータ・モジュール

データシート: PDF | HTML
非反転バッファとドライバ

SN74LVC1G1253 ステート出力、シングル、1.65V ~ 5.5V バッファ

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技術資料

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種類 タイトル 英語版のダウンロード 日付
設計ガイド マルチチャネル向け、データ・コンバータの DDC と NCO の同期機能のリファレンス・デザイン 英語版 2019年 6月 26日
アプリケーション・ノート JESD204B Multi-Device Synchronization Using LMK0461x 2017年 8月 16日
Analog Design Journal JESD204B multi-device synchronization: Breaking down the requirements 2015年 4月 28日
アプリケーション・ノート Defining Skew, Propagation-Delay, Phase Offset (Phase Error) 2001年 11月 28日

関連する設計リソース

ハードウェア開発

評価ボード
ADC12DJ3200EVM ADC12DJ3200 12 ビット、デュアル 3.2GSPS またはシングル 6.4GSPS、RF サンプリング ADC の評価基板 TSW14J57EVM データ・キャプチャ / パターン・ジェネレータ:16 レーン JESD204B 搭載、1.6 ~ 15Gbps 対応データ・コンバータの EVM

リファレンス・デザイン

リファレンス・デザイン
TIDA-01027 12.8GSPS データ・アクイジション・システムで性能を最大化する低ノイズ電源のリファレンス・デザイン

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