LMK04208 LMK04208 - 超低雑音、クロック・ジッタ・クリーナ、6 つのプログラマブル出力付き | TIJ.co.jp

LMK04208
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LMK04208 - 超低雑音、クロック・ジッタ・クリーナ、6 つのプログラマブル出力付き

 

概要

LMK04208は高性能のクロック・コンディショナーであり、高度な機能によってクロックの生成、分配、ジッタのクリーニングに優れた性能を発揮し、次世代システムの要件を満たします。デュアル・ループ PLLatinumアーキテクチャにより、低ノイズのVCXOモジュールを使用して111 fsのRMSジッタ(12kHz~20MHz)、または低コストの外付け水晶振動子およびバラクタ・ダイオードを使用して200fs以下のRMSジッタ(12kHz~20MHz)を実現できます。

デュアル・ループ・アーキテクチャは、2つの高性能な位相調整されたループ(PLL)、低ノイズの水晶発振器回路、高性能な電圧制御発振器(VCO)で構成されます。最初のPLL (PLL1)は低ノイズのジッタ・クリーナ機能を提供し、2番目のPLL (PLL2)はクロック生成を行います。PLL1は、外付けのVCXOモジュール、または内蔵の水晶発振器と外付けの調整可能水晶振動子およびバラクタ・ダイオードとともに動作するよう構成できます。非常に狭いループ帯域幅と組み合わせた場合、PLL1はVCXOモジュールまたは調整可能水晶振動子の優れたクローズイン位相ノイズ(50kHzより低いオフセット)を使用して、入力クロックをクリーニングします。PLL1の出力は、PLL2へのクリーンな基準入力として使用され、内蔵のVCOをロックします。PLL2のループ帯域幅は、ファーアウト位相ノイズ(50kHzよりも高いオフセット)をクリーニングするよう最適化でき、この場合は内蔵のVCOが、PLL1で使用されているVCXOモジュールや調整可能水晶振動子よりも高性能になります。

特長

  • 非常に低いRMSジッタ性能
    • 111 fs、RMSジッタ(12kHz~20MHz)
    • 123 fs、RMSジッタ(100Hz~20MHz)
  • デュアル・ループ PLLatinumPLLアーキテクチャ
  • PLL1
    • 低ノイズの水晶発振器回路を内蔵
    • 入力クロック消失時のホールドオーバー・モード
      • 自動または手動のトリガ/回復
  • PLL2
    • -227dBc/Hzの正規化PLLノイズフロア
    • 最高速度155MHzの位相検出器
    • OSCin周波数ダブラー
    • 内蔵の低ノイズVCOまたは外部VCOモード
  • 2つの冗長化されたLOS付き入力クロック
    • 自動および手動スイッチオーバー・モード
  • 50%デューティ・サイクルの出力分割、1~1045 (偶数または奇数)
  • 6つのLVPECL、LVDS、LVCMOSプログラマブル出力
  • デジタル遅延: 固定または動的に可変
  • 25ps単位のアナログ遅延制御
  • 7つの差動出力、シングルエンドで最大14
    • 最大6つのVCXO/水晶振動子バッファ付き出力
  • 最高クロック速度: 1536MHz
  • 0遅延モード
  • 電源オン時の3つのデフォルト・クロック出力
  • マルチモード: デュアルPLL、シングルPLL、クロック分配
  • 工業用温度範囲: -40℃~+85℃
  • 3.15V~3.45Vで動作
  • 64ピンWQFNパッケージ(9.0×9.0×0.8mm)

アプリケーション

  • データ・コンバータのクロック供給
  • ワイヤレス・インフラ
  • ネットワーキング、SONET/SDH、DSLAM
  • 医療、ビデオ、軍事、航空宇宙
  • 試験/測定機器

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WEBENCH® Designer LMK04208

Recommend Input Frequency Output Frequencies
 MHz
Input Frequency  MHz
 MHz  MHz

機能一覧

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Part number オーダー・オプション Function Number of outputs Output frequency (Min) (MHz) Output frequency (Max) (MHz) Supply voltage (Min) (V) RMS jitter Supply voltage (Max) (V) Input type Output type Features Rating Operating temperature range (C) Package Group Package size: mm2:W x L (PKG) Number of Inputs
LMK04208 ご注文 Dual-loop PLL     7     0.329     3072     3.15     0.111     3.45     LVCMOS
LVDS
LVPECL    
LVCMOS
LVDS
LVPECL    
0 Delay     Catalog     -40 to 85     WQFN | 64     64WQFN: 81 mm2: 9 x 9 (WQFN | 64)     2    
LMK04610 ご注文 Dual-loop PLL     10     0.03     2000     1.7     0.065     3.465     LVCMOS
LVDS
LVPECL    
LVDS
LVPECL    
JESD204B     Catalog     -40 to 85     QFN | 56     56QFN: 64 mm2: 8 x 8 (QFN | 56)     2    
LMK04616 ご注文 Single-loop PLL     16     0.03     2000     1.7     0.065     3.465     LVCMOS
LVDS
LVPECL    
LVDS
LVPECL    
JESD204B     Catalog     -40 to 85     NFBGA | 144     144NFBGA: 100 mm2: 10 x 10 (NFBGA | 144)     4    
LMK04808 ご注文 Dual-loop PLL     14     0.22     3072     3.15     0.111     3.45     LVCMOS
LVDS
LVPECL    
LVCMOS
LVDS
LVPECL    
0 Delay     Catalog     -40 to 85     WQFN | 64     64WQFN: 81 mm2: 9 x 9 (WQFN | 64)     2    
LMK04821 ご注文 Dual-loop PLL     15     0.045     2075     3.15     0.091     3.45     LVCMOS
LVDS
LVPECL    
LVCMOS
LVDS
LVPECL    
JESD204B     Catalog     -40 to 85     WQFN | 64     64WQFN: 81 mm2: 9 x 9 (WQFN | 64)     3    
LMK04906 ご注文 Dual-loop PLL     7     0.22     2600     3.15     0.1     3.45     LVCMOS
LVDS
LVPECL    
LVCMOS
LVDS
LVPECL    
0 Delay     Catalog     -40 to 85     WQFN | 64     64WQFN: 81 mm2: 9 x 9 (WQFN | 64)     3