DS320PR1601
- PCIe 5.0、CXL 2.0、CCIX、UPI 2.0 をサポートする 16 レーン・リニア・リドライバ
- 最大 32Gbps のデータ・レートをサポート
- Intel リタイマの共通フットプリントと互換
- パッケージ内の TX ピンに 64 個の AC カップリング・コンデンサを内蔵しているため、基板面積の削減が可能
- 16GHz で 21dB の CTLE 昇圧
- 非常に短いレイテンシ：130ps
- 小さい付加ランダム・ジッタ (PRBS データ)： 50fs
- 3.3V 単電源
- 低消費電力：チャネルあたり 164mW (動作時)
- I 2C/SMBus または EEPROM プログラミング
- PCIe 用途での自動レシーバ検出
- PCIe リンク・トレーニングのシームレスなサポート
- 内部電圧レギュレータによる電源ノイズへの耐性
- x4、x8、x16 バス幅をサポート
- 8.90mm × 22.80mm BGA パッケージ
DS320PR1601 は、32 チャネル (各方向に 16 チャネル) または x16 (16 レーン) の低消費電力、高性能のリニア・リピータまたはリドライバで、 PCIe 5.0、CXL 2.0、UPI 2.0 のほか、最大 32Gbps のインターフェイスをサポートするよう設計されています。
DS320PR1601 のレシーバは、連続時間リニア・イコライザ (CTLE) を搭載し、プログラマブルな高周波数での昇圧を実現しています。イコライザは、相互接続媒体 (例：PCB 配線) に起因する符号間干渉 (ISI) によって完全に閉じた入力アイ・パターンを開くことができます。CTLE レシーバにはリニア出力ドライバが接続されています。 DS320PR1601 のリニアなデータパスは、送信プリセット信号特性を維持します。リニア・リドライバは、最良の送受信イコライゼーション設定になるようにリンク・トレーニングされた受動チャネルの一部になります。このリンク・トレーニング・プロトコルの透過性は、最良の電気的リンクと最短のレイテンシをもたらします。チャネル間クロストークが少なく、付加ジッタが小さく、反射損失特性が非常に優れた本デバイスは、イコライゼーション機能を備えていることを除いて、リンク内でほとんど受動素子のように振舞います。
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技術資料
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7 をすべて表示 | 種類 | タイトル | 最新の英語版をダウンロード | 日付 | |||
|---|---|---|---|---|---|---|
| * | データシート | DS320PR1601 32Gbps、16 レーン PCIe 5.0、CXL 2.0 リニア・リドライバ データシート | PDF | HTML | 英語版 | PDF | HTML | 2020年 10月 1日 |
| アプリケーション・ノート | Eye Scan With TI PCI-Express Gen5.0 Redrivers (Rev. A) | PDF | HTML | 2024年 1月 16日 | |||
| アプリケーション・ノート | How to Tune TI PCIe Gen5 Redrivers | PDF | HTML | 2023年 8月 29日 | |||
| ユーザー・ガイド | DS160PR1601 and DS320PR1601 Programming Guide (Rev. A) | PDF | HTML | 2023年 6月 20日 | |||
| アプリケーション・ノート | High-Speed PCB Layout for PCIe Gen 5 | PDF | HTML | 2023年 6月 20日 | |||
| EVM ユーザー ガイド (英語) | DS320PR1601-RSC-EVM User's Guide (Rev. A) | PDF | HTML | 2023年 1月 26日 | |||
| 証明書 | DS320PR1601RSC-EVM EU Declaration of Conformity (DoC) | 2021年 4月 23日 |
設計と開発
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評価ボード
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DS320PR1601RSC-EVM 評価基板 (EVM) は、32 チャネル PCIe® 5.0 リニア・リドライバである TI (テキサス・インスツルメンツ) の DS320PR1601 のシグナル・コンディショニング機能を評価するための包括的な高帯域幅プラットフォームを実現します。この評価ボードは、アドインカードの標準準拠試験、性能評価、初期のシステム・プロトタイプ製作に使用できます。
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PSpice® for TI は、各種アナログ回路の機能評価に役立つ、設計とシミュレーション向けの環境です。設計とシミュレーションに適したこのフル機能スイートは、Cadence® のアナログ分析エンジンを使用しています。PSpice for TI は無償で使用でき、アナログや電源に関する TI の製品ラインアップを対象とする、業界でも有数の大規模なモデル・ライブラリが付属しているほか、選択された一部のアナログ動作モデルも利用できます。
設計とシミュレーション向けの環境である PSpice for TI (...)
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TINA-TI をインストールするには、約 500MB が必要です。インストールは簡単です。必要に応じてアンインストールも可能です。(そのようなことはないと思いますが)
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TINA は DesignSoft (...)
| パッケージ | ピン数 | ダウンロード |
|---|---|---|
| NFBGA (ZDG) | 354 | オプションの表示 |
購入と品質
記載されている情報：
- RoHS
- REACH
- デバイスのマーキング
- リード端子の仕上げ / ボールの原材料
- MSL 定格 / ピーク リフロー
- MTBF/FIT 推定値
- 材質成分
- 認定試験結果
- 継続的な信頼性モニタ試験結果
記載されている情報：
- ファブの拠点
- 組み立てを実施した拠点
推奨製品には、この TI 製品に関連するパラメータ、評価基板、またはリファレンス デザインが存在する可能性があります。