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SN65LVDS302

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プログラマブル 27 ビット・ディスプレイ・シリアル・インターフェイス・レシーバ

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製品詳細

Function Deserializer Protocols Channel-Link I Supply voltage (V) 1.8 Signaling rate (MBits) 1755 Input signal LVDS Output signal CMOS Rating Catalog Operating temperature range (°C) -40 to 85
Function Deserializer Protocols Channel-Link I Supply voltage (V) 1.8 Signaling rate (MBits) 1755 Input signal LVDS Output signal CMOS Rating Catalog Operating temperature range (°C) -40 to 85
NFBGA (ZXH) 80 25 mm² 5 x 5
  • シリアル・インターフェイス・テクノロジー
  • SN65LVDS301 などの FlatLink™3G と互換性あり
  • 1、2、または 3 つの SubLVDS 差動ライン経由で受信される、最大 24 ビットの RGB データと 3 つの制御ビットを持つビデオ・インターフェイスをサポート
  • SubLVDS 差動電圧レベル
  • 最大 1.755Gbps のデータ・スループット
  • 消費電力を節約するための 3 つの動作モード
    • アクティブ・モードの QVGA：17mW
    • シャットダウン (標準値)：0.7µW
    • スタンバイ・モード (標準値)：27µW (標準値)
  • バス・スワップ機能による PCB レイアウトの柔軟性
  • ESD 定格 > 4kV (HBM)
  • 4MHz～65MHz のピクセル・クロック範囲
  • すべての CMOS 入力でのフェイルセーフ
  • 5mm × 5mm の nFBGA、0.5mm ボール・ピッチでパッケージ
  • 非常に低い EMI は SAE J1752/3 「KH」 仕様に適合
  • シリアル・インターフェイス・テクノロジー
  • SN65LVDS301 などの FlatLink™3G と互換性あり
  • 1、2、または 3 つの SubLVDS 差動ライン経由で受信される、最大 24 ビットの RGB データと 3 つの制御ビットを持つビデオ・インターフェイスをサポート
  • SubLVDS 差動電圧レベル
  • 最大 1.755Gbps のデータ・スループット
  • 消費電力を節約するための 3 つの動作モード
    • アクティブ・モードの QVGA：17mW
    • シャットダウン (標準値)：0.7µW
    • スタンバイ・モード (標準値)：27µW (標準値)
  • バス・スワップ機能による PCB レイアウトの柔軟性
  • ESD 定格 > 4kV (HBM)
  • 4MHz～65MHz のピクセル・クロック範囲
  • すべての CMOS 入力でのフェイルセーフ
  • 5mm × 5mm の nFBGA、0.5mm ボール・ピッチでパッケージ
  • 非常に低い EMI は SAE J1752/3 「KH」 仕様に適合

SN65LVDS302 レシーバは、FlatLink™3G 準拠のシリアル入力データを 27 のパラレル・データ出力にデシリアライズします。SN65LVDS302 レシーバには、1、2、または 3 つのシリアル入力から 30 ビットをロードする 1 つのシフト・レジスタが含まれており、パリティ・ビットをチェックした後、24 のピクセル・ビットと 3 つの制御ビットをパラレル CMOS 出力にラッチします。パリティ・チェックで正しいパリティが確認された場合、チャネル・パリティ・エラー (CPE) 出力は Low のままです。パリティ・エラーが検出された場合、CPE 出力は高パルスを生成し、データ出力バスは新しく受信したピクセルを無視します。代わりに、最後のデータ・ワードが、別のクロック・サイクルの間、出力バスに保持されます。

SN65LVDS302 レシーバは、FlatLink™3G 準拠のシリアル入力データを 27 のパラレル・データ出力にデシリアライズします。SN65LVDS302 レシーバには、1、2、または 3 つのシリアル入力から 30 ビットをロードする 1 つのシフト・レジスタが含まれており、パリティ・ビットをチェックした後、24 のピクセル・ビットと 3 つの制御ビットをパラレル CMOS 出力にラッチします。パリティ・チェックで正しいパリティが確認された場合、チャネル・パリティ・エラー (CPE) 出力は Low のままです。パリティ・エラーが検出された場合、CPE 出力は高パルスを生成し、データ出力バスは新しく受信したピクセルを無視します。代わりに、最後のデータ・ワードが、別のクロック・サイクルの間、出力バスに保持されます。
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技術資料

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* データシート SN65LVDS302 プログラマブル 27 ビット・シリアル / パラレル・レシーバ データシート (Rev. E 翻訳版) PDF | HTML 英語版 (Rev.E) PDF | HTML 2023年 5月 23日

設計と開発

その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページをご覧ください。

シミュレーション・モデル

SN65LVDS302 IBIS Model

SLLC436.ZIP (31 KB) - IBIS Model
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シミュレーション・ツール

PSPICE-FOR-TI — TI Design / シミュレーション・ツール向け PSpice®

PSpice® for TI は、各種アナログ回路の機能評価に役立つ、設計とシミュレーション向けの環境です。設計とシミュレーションに適したこのフル機能スイートは、Cadence® のアナログ分析エンジンを使用しています。PSpice for TI は無償で使用でき、アナログや電源に関する TI の製品ラインアップを対象とする、業界でも有数の大規模なモデル・ライブラリが付属しているほか、選択された一部のアナログ動作モデルも利用できます。

設計とシミュレーション向けの環境である PSpice for TI (...)
リクエスト
シミュレーション・ツール

TINA-TI — SPICE ベースのアナログ・シミュレーション・プログラム

TINA-TI は、DC 解析、過渡解析、周波数ドメイン解析など、SPICE の標準的な機能すべてを搭載しています。TINA には多彩な後処理機能があり、結果を必要なフォーマットにすることができます。仮想計測機能を使用すると、入力波形を選択し、回路ノードの電圧や波形を仮想的に測定することができます。TINA の回路キャプチャ機能は非常に直観的であり、「クイックスタート」を実現できます。

TINA-TI をインストールするには、約 500MB が必要です。インストールは簡単です。必要に応じてアンインストールも可能です。(そのようなことはないと思いますが)

TINA は DesignSoft (...)

ユーザー ガイド: PDF
英語版 (Rev.A): PDF
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NFBGA (ZXH) 80 オプションの表示
TI の評価品に関する標準契約約款が適用されます。

購入と品質

記載されている情報：
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL 定格 / ピーク リフロー
  • MTBF/FIT 推定値
  • 材質成分
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果
記載されている情報：
  • ファブの拠点
  • 組み立てを実施した拠点

推奨製品には、この TI 製品に関連するパラメータ、評価基板、またはリファレンス デザインが存在する可能性があります。

サポートとトレーニング

TI E2E™ フォーラムでは、TI のエンジニアからの技術サポートを提供

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