CD4066B
- 15V のデジタルまたは ±7.5V のピーク・ツー・ピーク・スイッチング
- 15V 動作で 125Ω (標準値) のオン抵抗
- 15V の信号入力範囲にわたってスイッチのオン抵抗の変動が 5Ω 以下
- ピーク・ツー・ピーク信号範囲全体にわたってオン抵抗が平坦
- 高いオン / オフ出力電圧比:
fis = 10kHz、RL = 1kΩ で 80dB (標準値) - 優れた直線性:fis = 1kHz、Vis = 5Vp-p、
VDD - VSS ≥ 10V、RL = 10kΩ で 0.5% (標準値) 未満の歪み - 非常に小さいオフ状態スイッチ・リークによる非常に小さいオフセット電流と高い実効オフ抵抗:VDD - VSS = 10V、TA = 25°C で 10pA (標準値)
- 非常に高い制御入力インピーダンス
(制御回路を信号回路から絶縁):
1012Ω (標準値) - 小さなスイッチ間クロストーク:fis = 8MHz、RL = 1kΩ で –50dB (標準値)
- 整合した制御入力容量と信号出力容量:出力信号の過渡を低減
- スイッチ・オンでの周波数応答
= 40MHz (標準値) - 20V で静止電流を 100% テスト済み
- 5V、10V、15V のパラメータ定格
CD4066B デバイスは、アナログまたはデジタル信号の伝送 / 多重化を目的としたクワッド双方向スイッチです。CD4016B デバイスとピン互換ですが、はるかに小さなオン抵抗を示します。また、このオン抵抗は信号入力範囲全体にわたって比較的一定です。
CD4066B デバイスは 4 つの双方向スイッチで構成され、それぞれ独立して制御できます。各スイッチの P と N の両方のデバイスが、制御信号によって同時にオンまたはオフにバイアスされます。図17 に示すように、各スイッチの N チャネル・デバイスのウェルは入力 (スイッチがオンの場合) または VSS (スイッチがオフの場合) に接続されます。この構成により、スイッチ・トランジスタのスレッショルド電圧の入力信号による変動が除去され、動作信号範囲全体にわたってオン抵抗が低く保たれます。
シングル・チャネル・スイッチに対する利点として、ピーク入力信号電圧スイングが電源電圧と完全に等しいことと、オン・インピーダンスが入力信号範囲全体にわたってより均一であることが挙げられます。しかし、サンプル・アンド・ホールドのアプリケーションには、CD4016B デバイスを推奨します。
技術資料
種類 | タイトル | 最新の英語版をダウンロード | 日付 | |||
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* | データシート | CD4066B CMOS クワッド双方向スイッチ データシート (Rev. H 翻訳版) | PDF | HTML | 英語版 (Rev.H) | PDF | HTML | 2020年 6月 1日 |
アプリケーション・ノート | Selecting the Correct Texas Instruments Signal Switch (Rev. E) | PDF | HTML | 2022年 6月 2日 | |||
アプリケーション・ノート | Multiplexers and Signal Switches Glossary (Rev. B) | PDF | HTML | 2021年 12月 1日 | |||
セレクション・ガイド | Logic Guide (Rev. AB) | 2017年 6月 12日 | ||||
アプリケーション・ノート | Understanding and Interpreting Standard-Logic Data Sheets (Rev. C) | 2015年 12月 2日 | ||||
セレクション・ガイド | ロジック・ガイド (Rev. AA 翻訳版) | 最新英語版 (Rev.AB) | 2014年 11月 6日 | |||
ユーザー・ガイド | LOGIC Pocket Data Book (Rev. B) | 2007年 1月 16日 | ||||
アプリケーション・ノート | Semiconductor Packing Material Electrostatic Discharge (ESD) Protection | 2004年 7月 8日 | ||||
ユーザー・ガイド | Signal Switch Data Book (Rev. A) | 2003年 11月 14日 | ||||
アプリケーション・ノート | Understanding Buffered and Unbuffered CD4xxxB Series Device Characteristics | 2001年 12月 3日 |
設計と開発
その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページをご覧ください。
LEADED-ADAPTER1 — TI の 5、8、10、16、24 ピン・リード付きパッケージの迅速なテスト向けの表面実装から DIP ヘッダーへのアダプタ
EVM-LEADED1 ボードは、TI の一般的なリード付きパッケージによる迅速なテストとブレッド・ボードへの対応を可能にします。 TI の D、DBQ、DCT、DCU、DDF、DGS、DGV、PW 表面実装パッケージを 100mil DIP ヘッダに変換するフットプリントを用意しています。
パッケージ | ピン数 | ダウンロード |
---|---|---|
PDIP (N) | 14 | オプションの表示 |
SOIC (D) | 14 | オプションの表示 |
SOP (NS) | 14 | オプションの表示 |
TSSOP (PW) | 14 | オプションの表示 |
購入と品質
- RoHS
- REACH
- デバイスのマーキング
- リード端子の仕上げ / ボールの原材料
- MSL 定格 / ピーク リフロー
- MTBF/FIT 推定値
- 材質成分
- 認定試験結果
- 継続的な信頼性モニタ試験結果
- ファブの拠点
- 組み立てを実施した拠点
推奨製品には、この TI 製品に関連するパラメータ、評価基板、またはリファレンス デザインが存在する可能性があります。