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製品の詳細

パラメータ

Function Ultra-low jitter clock generator Number of outputs 14 Output frequency (Max) (MHz) 2600 Core supply voltage (V) 3.3 Output supply voltage (V) 3.3 Input type XTAL, LVCMOS, LVDS, LVPECL Output type LVCMOS, LVDS, LVPECL Operating temperature range (C) -40 to 85 Features uWire Rating Catalog open-in-new その他の クロック・ジェネレータ

パッケージ|ピン|サイズ

WQFN (NKD) 64 81 mm² 9 x 9 open-in-new その他の クロック・ジェネレータ

特長

  • 高性能、超低ジッタ・クロック・ジェネレータ
  • 低ジッタ
    • 312.5MHzの出力周波数で50fs未満のジッタ(1.875MHz~20MHz)
    • 312.5MHzの出力周波数で150fs未満のジッタ(12kHz~20MHz)
  • 低コストの水晶振動子または外部クロックから複数のクロックを生成。
  • プログラマブル出力フォーマット(LVDS、LVPECL、CMOS)による14の出力
  • 最大8つの固有の出力周波数。
  • 工業用温度範囲: -40~85℃
  • 調整可能なVCO周波数: 2.37~2.6GHz
  • プログラミング可能な分周器により、低コストの水晶振動子から複数のクロックを生成。
  • 3.15V~3.45Vで動作
open-in-new その他の クロック・ジェネレータ

概要

LMK03806は、高性能かつ超低ジッタのマルチレート・クロック・ジェネレータであり、最高2.6GHzの周波数で14の出力において8つの異なる周波数を同時生成できます。各出力クロックはLVDS、LVPECL、またはLVCMOSフォーマットでプログラミング可能です。LMK03806は高性能な整数N PLL、低ノイズVCO、プログラマブル出力分周器を内蔵しており、低コストの水晶振動子からSONET、イーサネット、ファイバ・チャネル、XAUI、バックプレーン、PCIe、SATA、ネットワーク・プロセッサ用に複数の基準クロックを生成できます。

open-in-new その他の クロック・ジェネレータ
ダウンロード

技術資料

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種類 タイトル 英語版のダウンロード 日付
* データシート LMK03806 超低ジッタ・クロック・ジェネレータ、14のプログラマブル出力付き データシート (Rev. J 翻訳版) 英語版をダウンロード (Rev.J) 2018年 6月 27日
セレクション・ガイド TI Components for Aerospace and Defense Guide (Rev. E) 2017年 3月 22日
技術記事 How to select an optimal clocking solution for your FPGA-based design 2015年 12月 9日
技術記事 Clocking sampled systems to minimize jitter 2014年 7月 31日
アプリケーション・ノート Crystal or Crystal Oscillator Replacement with Silicon Devices 2014年 6月 18日
技術記事 Timing is Everything: How to optimize clock distribution in PCIe applications 2014年 3月 28日
その他の技術資料 クロック&タイミング・ソリューション (Rev. A 翻訳版) 2013年 12月 11日
ユーザー・ガイド LMK03806B Evaluation Board User Guide (Rev. A) 2013年 11月 26日

設計と開発

追加の事項や他のリソースを参照するには、以下のタイトルをクリックすると、詳細ページを表示できます。

ハードウェア開発

評価ボード ダウンロード
document-generic ユーザー・ガイド
299
概要

The LMK03806 Evaluation Board allows functional and performance verification of the LMK03806 ultra-low jitter clock generator.

特長
  • Low-jitter clock generation via 14 differential outputs
  • Selectable differential output type (LVPECL, LVDS, LVCMOS), selectable per clock output pair via uWire control
  • Crystal oscillator interface and buffered oscillator outputs
  • Single 3.3 V operation using onboard regulator options or direct supply (...)

ソフトウェア開発

アプリケーション・ソフトウェアとフレームワーク ダウンロード
クロック設計ツール - ループ・フィルタおよびデバイス構成+シミュレーション
CLOCKDESIGNTOOL The Clock Design Tool software helps with part selection, loop filter design and simulation of timing device solutions. When you enter desired output frequencies and a reference frequency (optional), the tool provides TI devices to meet the specified requirements, divider values and a recommended (...)
アプリケーション・ソフトウェアとフレームワーク ダウンロード
テキサス・インスツルメンツのクロックおよびシンセサイザ(TICS)プロ・ソフトウェア
TICSPRO-SW The TICS Pro software is used to program the evaluation modules (EVMs) for device numbers with these prefixes: CDC, LMK and LMX. These devices include PLLs and voltage-controlled oscillators (PLL+VCO), synthesizers and clocking devices.
特長
  • Program EVMs through the USB2ANY Interface Adaptor or onboard USB interface.
  • Export programming configurations for use in end application.
IDE (統合開発環境)、構成機能、またはデバッガ ダウンロード
CodeLoader デバイス・レジスタ・プログラミング
CODELOADER The CodeLoader 4 software is used to program the LMX PLLs and LMK timing devices through either the USB or line print terminal (LPT) port of a computer. This software also provides information on how to program the device by showing the bits that are actually sent.


Which software do I use?

Product

Loop (...)

設計ツールとシミュレーション

シミュレーション・モデル ダウンロード
SNAM102B.ZIP (101 KB) - IBIS Model
シミュレーション・ツール ダウンロード
PSpice® for TI design and simulation tool
PSPICE-FOR-TI — PSpice® for TI は、各種アナログ回路の機能評価に役立つ、設計とシミュレーション向けの環境です。設計とシミュレーションに適したこのフル機能スイートは、Cadence® のアナログ分析エンジンを使用しています。PSpice for TI は無償で使用でき、アナログや電源に関する TI の製品ラインアップを対象とする、業界でも有数の大規模なモデル・ライブラリが付属しているほか、選択された一部のアナログ動作モデルも利用できます。

設計とシミュレーション向けの環境である PSpice for TI を使用すると、内蔵のライブラリを活用して、複雑なミックスド・シグナル設計のシミュレーションを実施することができます。完成度の高い最終機器を設計し、レイアウトの確定や製造開始より前に、ソリューションのプロトタイプを製作することができます。この結果、市場投入期間の短縮と開発コストの削減を実現できます。 

設計とシミュレーション向けのツールである PSpice for TI の環境内で、各種 TI デバイスの検索、製品ラインアップの参照、テスト・ベンチの起動、設計のシミュレーションを実施し、選定したデバイスをさらに分析することができます。また、複数の TI デバイスを組み合わせてシミュレーションを実行することもできます。

事前ロード済みの複数のモデルで構成されたライブラリ全体に加えて、PSpice for TI ツール内で各種 TI デバイスの最新の技術関連資料に簡単にアクセスすることもできます。開発中のアプリケーションに適したデバイスを選定できたことを確認した後、TI 製品の購入ページにアクセスして、その製品を購入することができます。 

PSpice for TI を使用すると、回路の検討から設計の開発や検証まで、作業の進展に合わせて設計サイクルの各段階で、シミュレーションのニーズに適した各種ツールにアクセスできます。コスト不要で入手でき、開発を容易に開始できます。設計とシミュレーションに適した PSpice スイートをダウンロードして、今すぐ設計を開始してください。

 開発の開始

  1. PSpice for TI シミュレータへのアクセスの申請
  2. ダウンロードとインストール
  3. シミュレーション方法説明ビデオのご視聴
特長
  • Cadence の PSpice テクノロジーを活用
  • デジタル・モデル・スイートが付属する事前インストール済みのライブラリを活用して、ワーストケース・タイミング分析を実現可能
  • 動的更新により、最新のデバイス・モデルに確実にアクセス可能
  • 精度の低下を招かずに、シミュレーション速度を重視して最適化済み
  • 複数製品の同時分析をサポート
  • OrCAD Capture フレームワークを土台とし、業界で最も幅広く使用されている回路図のキャプチャとシミュレーションの環境へのアクセスを実現
  • オフライン作業が可能
  • 以下の点を含め、多様な動作条件とデバイス公差にまたがって設計を検証
    • 自動的な測定と後処理
    • モンテカルロ分析法
    • ワーストケース分析
    • 熱解析
設計ツール ダウンロード
Clock tree architect プログラミング・ソフトウェア
CLOCK-TREE-ARCHITECT Clock tree architect はクロック・ツリーの合成ツールであり、開発中システムの要件に基づいてクロック・ツリー・ソリューションを生成する方法で、お客様の設計プロセスの効率化に貢献します。このツールは、多様なクロック供給製品を収録した包括的なデータベースからデータを抽出し、システム・レベルのマルチチップ・クロック供給ソリューションを生成します。
特長
  • 入力周波数、出力周波数、クロックの形式、クロックの数など、お客様固有の設計要件を受け入れ
  • ノイズ・フロアや位相決定の要件など、多様で高度な仕様を考慮に入れて、複数のクロック・ツリーを生成
  • 明確で直観的なブロック図を提示
  • 各製品とシステムに関する主な性能指標 (面積、価格、ジッタ、電力) を推定
  • 今後参照できるように、データシート、トレーニング資料、ソフトウェア・ツールなどへのクイック・リンクを含めた設計レポートを生成

CAD/CAE シンボル

パッケージ ピン数 ダウンロード
WQFN (NKD) 64 オプションの表示

購入と品質

含まれる情報:
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL rating/ リフローピーク温度
  • MTBF/FIT の推定値
  • 原材料組成
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果

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サポートとトレーニング

TI E2E™ Forums (英語) では、TI のエンジニアからの技術サポートが活用できます

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